- 基于FPGA的虚拟现实定位系统-虚拟现实技术是目前计算机信息科学中的前沿学科，文中设计了一种以FPGA 为核心的数据采集处理系统.利用HMC5883L和ADXL345对虚拟场景中物体的方位和朝向进行确定并通过以太网给虚拟场景主机发送数据.整个系统以 FPGA作为主控制器，配以传感器数据采集，内部FIFO存储，以太网高速传输，从而把定位系统参数实时传送到上位机中，具有传输速度快.实时性等优点，实现了虚拟现实高精度定位的功能.
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FPGA 虚拟现实
- 电路设计常见的八个误区-电路设计常见的八个误区：现象一：这板子的PCB设计要求不高，就用细一点的线，自动布吧；现象二：这些总线信号都用电阻拉一下，感觉放心些；现象三：CPU和FPGA的这些不用的I/O口怎么处理呢？先让它空着吧，以后再说。
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电路设计 PCB fpga
- FPGA实战开发技巧（6）-时序性能是FPGA 设计最重要的指标之一。造成时序性能差的根本原因有很多，但其直接原因可分为三类：布局较差、逻辑级数过多以及信号扇出过高。
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FPGA 时序性能
- FPGA实战开发技巧（7）-通常我们会为工程添加UCF 约束指定时序要求和管脚约束。但是UCF 约束是给MAP，PAR 等实现使用的，综合工具XST 并不能感知系统的时序要求。而为XST 添加XCF 约束却是使实现结果拥有最高频率的关键。
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FPGA XCF UCF
- 利用FPGA的自身特性实现随机数发生器-本文主要介绍利用FPGA的自身的特性实现随机数发生器，在Virtex-II Pro开发板上用ChipScope观察随机数序列，以及在PCIe4Base（基于Virtex-4 FPGA）上实现。
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fpga
- 谈谈如何利用FPGA开发板进行ASIC原型开发-ASIC设计在尺寸和复杂性上不断增加，现代FPGA的容量和性能的新进展意味着这些设计中的2/3能够使用单个FPGA进行建模。
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FPGA ASIC
- FPGA实战开发技巧（5）-一般来讲，添加约束的原则为先附加全局约束，再补充局部约束，而且局部约束比较宽松。其目的是在可能的地方尽量放松约束，提高布线成功概率，减少ISE 布局布线时间。典型的全局约束包括周期约束和偏移约束。
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FPGA 周期约束
- FPGA实战开发技巧（4）-在代码编写完毕后，需要借助于测试平台来验证所设计的模块是否满足要求。ISE 提供了两种测试平台的建立方法，一种是使用HDL Bencher 的图形化波形编辑功能编写，另一种就是利用HDL 语言，相对于前者使用简单、功能强大。
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FPGA ISE
- FPGA实战开发技巧（3）-所谓综合，就是将HDL语言、原理图等设计输入翻译成由与、或、非门和RAM、触发器等基本逻辑单元的逻辑连接( 网表)，并根据目标和要求( 约束条件) 优化所生成的逻辑连接，生成EDF 文件。XST 内嵌在ISE 3 以后的版本中，并且在不断完善。
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FPGA 赛灵思
- FPGA电路必须遵循的原则和技巧-在调试FPGA电路时要遵循必须的原则和技巧，才能降低调试时间，防止误操作损坏电路。通常情况下，能够参考以下步骤执行 FPGA硬件系统的调试。
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FPGA
- 写verilog代码要有硬件的概念-因为Verilog是一种硬件描述语言，所以在写Verilog语言时，首先要有所要写的module在硬件上如何实现的概念，而不是去想编译器如何去解释这个module
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verilog FPGA
- 学好FPGA应该要具备的知识-阅读本文的人群：熟悉数字电路基本知识（如加法器、计数器、RAM等），熟悉基本的同步电路设计方法，熟悉HDL语言，对FPGA的结构有所了解，对FPGA设计流程比较了解。
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FPGA 同步电路
- 解密业界首款16nm产品核心技术-以赛灵思 20nm UltraScale 系列的成功为基础，赛灵思现又推出了全新的 16nm UltraScale+ 系列 FPGA、3D IC 和 MPSoC，凭借新型存储器、3D-on-3D 和多处理SoC（MPSoC）技术，再次领先一代提供了遥遥领先的价值优势。
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赛灵思 FPGA 16nm制程
- FPGA实战开发技巧（13）-基于IP的设计已成为目前FPGA设计的主流方法之一，本章首先给出IP的定义，然后以FFT IP核为例，介绍赛灵思IP核的应用。
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FPGA 赛灵思 IP核
- FPGA实战开发技巧（12）-在大规模设计的调试应该按照和设计理念相反的顺序，从底层测试，主要依靠ChipScope Pro 工具。下面主要介绍ChipScope Pro、FPGA Editor 组件的使用方法。
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FPGA Xilinx
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