通常情况下，在设计基于FPGA的大型信号处理系统的时候，设计人员往往需要进行费时费力的仿真。以Xilinx System Generator for DSP为代表的FPGA设计工具，通过提供可靠的硬件在环接口（该接口可以直接将FPGA硬件置入设计仿真），来解决这种问题。 通过在硬件上模拟部分设计，这些接口可以大大提高仿真的速度——通常可以提高一个甚至多个数量级。使用硬件在环还可以让设计人员实时进行FPGA硬件调试和验证。
System Generator for DSP 可以为多类FPGA开发平台提供
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DSP 单片机 仿真 高带宽 嵌入式系统 通讯 网络 无线
摘要: 本文主要介绍了基于CPCI 总线设计的实时信号处理业务所需的一种专用设备平台。关键词： CPCI BUS；平台；实时信号处理；DSP+FPGA
系统设计DSP+FPGA混用设计为了提高算法效率，实时处理图像信息，本处理系统是基于DSP+FPGA混用结构设计的。业务板以FPGA为处理核心，实现数字视频信号的实时图像处理，DSP实现了部分的图像处理算法和FPGA的控制逻辑，并响应中断，实现数据通信和存储实时信号。首先，本系统要求DSP可以满足算法控制结构复杂、运算速度高、寻址灵
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0704_A BUS CPCI DSP+FPGA 单片机 平台 嵌入式系统 实时信号处理 杂志_设计天地
目前，DSP以其卓越的性能、独有的特点，已经成为通信、计算机、消费类电子产品等领域的基础器件。同时，随着对知识产权的重视，在利用DSP进行产品设计时，如何保护自己的成果，防止破译者窃取，也成为设计者工作在一个重要方面[1,2]。如果产品大批量生产，那么可以利用掩膜技术等工艺将操作程序及数据写入芯片，使它们不能被读出，达到保护的效果。对于还没有形成规模的产品，使用这样的方法就会使成本大大增加。因此，本文提出一种方法，利用3DES、Geffe发生器和MD5等算法，构造一种加密体制，来保护DSP程序。
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DSP 单片机 加密 嵌入式系统
本文提出了一种基于PI 控制算法的三阶全数字锁相环，采用EDA 技术进行系统设计，并用可编程逻辑器件予以实现。
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FPGA 全数字 锁相环
DS18B20是DALLAS公司生产的一线式数字温度传感器，采用3引脚TO-92型小体积封装；温度测量范围为-55℃～+125℃，可编程为9位～12位A/D转换精度，测温分辨率可达0.0625℃，被测温度用符号扩展的16位数字量方式串行输出。 一线式(1-WIRE)串行总线是利用1条信号线就可以与总线上若干器件进行通信。具体应用中可以利用微处理器的I/O端口对DS18B20直接进行通信，也可以通过现场可编程门阵列(FPGA)等可编程逻辑器件(PLD)实现对1-WIRE器件的通信。
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DS18B20 FPGA 传感器 单片机 嵌入式系统
SYNPLICITY 公司日前宣布推出最新 Synplify DSP ASIC版，进一步丰富了其旗下的 ESL 软件系列。在该公司致力于提供各种技术独立的解决方案这一发展战略的引导下，新型 Synplify® DSP ASIC 版软件将帮助用户根据算法级设计的要求自动开发高质量 RTL 代码，以适应 FPGA 或 ASIC 器件的需求。 S
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ASIC DSP SYNPLICITY 消费电子 EDA IC设计 消费电子
重庆交通大学计算机通讯学院TI DSP联合实验室是TI在重庆地区大学挂牌的第三家联合实验室(前两家为：重庆大学和重庆邮电大学),该校领导对实验室的建设极为重视，前期投入了专向资金并对实验室产品的采购进行了多方选择，最终选择了合众达30套三DSP教学实验箱SEED-DTK多DSP教学实验箱作为该实验室DSP唯一的教学科研设备, 在此衷心感谢重庆交通大学校领导以及将相关老师们对合众达电子的大力支持与信任，同时合众达电子对该实验室的成功建立表示衷心祝贺！ 重庆
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DSP TI 重庆交通大学
本文介绍一种利用嵌入Blackfin处理器的ADSP-BF537作为处理器进行SoC的FPGA实时验证的方案及其总线接口转换...
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嵌入式 FPGA 功耗
前 言
几年前设计专用集成电路(ASIC) 还是少数集成电路设计工程师的事, 随着硅的集成度不断提高,百万门的ASIC 已不难实现, 系统制造公司的设计人员正越来越多地采用ASIC 技术集成系统级功能(System L evel In tegrete - SL I) , 或称片上系统(System on a ch ip ) , 但ASIC 设计能力跟不上制造能力的矛盾也日益突出。现在设计人员已不必全部用逻辑门去设计ASIC, 类似于用集成电路( IC) 芯片在印制板上的设计,ASIC 设计人员可以应用等
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ASIC CPLD FPGA IP 单片机 嵌入式系统
引 言
IP电话是利用国际互联网Internet为语音传输的媒介，实现语音通信的一种全新的通信技术。其通信费用的低廉(有人称之为廉价电话)，节省带宽；智能化；开放的体系结构；多媒体业务的集成。IP电话网络支持语音、数据、图像的传输，为将来全面提供多媒体业务打下了基础。IP电话是未来“三网合一”的一项服务，有望成为下一代电信基础设施结构的核心，使未来各电信业务综合在同一IP网络上成为可能，导致语音、数据、图像的融合和未来电信市场的重组，并带来新的经济模式和价值链。IP电话的主要特点是语音在Intenet
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AC48801 DSP lP电话 通讯 网络 无线
2007年，与美国Tektronic签订了正式代理协议业务，积极推广FPGA大学计划。
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SEED DSP
您是否曾想在您的 FPGA 设计中使用先进的视频压缩技术，却发现实现起来太过复杂？现在您无需成为一名视频专家就能在您的系统中使用视频压缩。赛灵思新推出的 MPEG-4 编码器/解码器核可以帮助您满足视频压缩需求。
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FPGA MPEG 编解码器
1 并行流水结构FIR的原理
在用FPGA或专用集成电路实现数字信号处理算法时，计算速度和芯片面积是两个相互制约的主要问题。实际应用FIR滤波器时，要获得良好的滤波效果，滤波器的阶数可能会显著增加，有时可能会多达几百阶。因此，有必要在性能和实现复杂性之间做出选择，也就是选择不同的滤波器实现结构。这里运用并行流水线结构来实现速度和硬件面积之间的互换和折衷。
在关键路径插入寄存器的流水线结构是提高系统吞吐率的一项强大的实现技术，并且不需要大量重复设置硬件。流水线的类型主要分为两种：算术流水线和指令流水线
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FIR滤波器 FPGA 并行流水线 单片机 可重配 嵌入式系统
FPGA设计和验证工程师当今面临的最大挑战之一是时间和资源制约。随着FPGA在速度、密度和复杂性方面的增加，完成一个完整时序验证对人力和计算机处理器、存储器提出了更多更高的要求。
随着FPGA器件体积和复杂性的不断增加，设计工程师越来越需要有效的验证方。时序仿真可以是一种能发现最多问题的验证方法，但对许多设计来说，它常常是最困难和费时的方法之一。过去，采用标准台式计算机的时序仿真是以小时或分钟计算的，但现在对某些项目来说，在要求采用高性能64位服务器的情况下，其测试时间却要几天甚至几周。这样，这种
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FPGA 验证
引言
基于SRAM工艺FPGA在每次上电后需要进行配置，通常情况下FPGA的配置文件由片外专用的EPROM来加载。这种传统配置方式是在FPGA的功能相对稳定的情况下采用的。在系统设计要求配置速度高、容量大、以及远程升级时，这种方法就显得很不实际也不方便。本文介绍了通过ＡＲＭ对可编程器件进行配置的的设计和实现。
1 配置原理与方式
1.1 配置原理
在FPGA正常工作时，配置数据存储在SRAM单元中，这个SRAM单元也被称为配置存储（Configuration RAM）。由于SRAM是易失性的存
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ARM FPGA 单片机 配置 嵌入式系统
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