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BLACKfin DSP体系结构：能实现带电源管理功能的多样性应用
- 引言 嵌入式系统应用一般可分为两类：一类主要是数字信号处理器(DSP)强大的数值计算功能的应用，其应用实例是V.90语音频段调制解调器的数据泵器件应用中嵌入的增强型DSP；另一类则是控制方面的应用，其应用实例是手持式计算机或数字手表。 人们对这两类不同的应用系统通常采用的设计方法是，根据应用情况选用DSP处理器或微控制器(MCU)。DSP 处理器可为数值计算提供更强大的运算能力；而MCU通常易于编程并且能提供多种片内外围器件，以便使每一种MCU更加适合其相应的应用需求。另外，这些MCU各自的指令集
- 关键字： BLACKfin DSP
DSP入门前的背景知识
- 数字信号处理（DigitalSignal Processing，简称DSP）是一门涉及许多学科而又广泛应用于许多领域的新兴学科。20世纪60年代以来，随着计算机和信息技术的飞速发展，数字信号处理技术应运而生并得到迅速的发展。在过去的二十多年时间里，数字信号处理已经在通信等领域得到极为广泛的应用。 数字信号处理是利用计算机或专用处理设备，以数字形式对信号进行采集、变换、滤波、估值、增强、压缩、识别等处理，以得到符合人们需要的信号形式。 数
- 关键字： DSP 嵌入式
TD-SCDMA系统基带处理的DSP+FPGA实现方案
- 本文首先介绍TD-SCDMA系统无线信道的基带发送方案，说明其对多媒体业务的支持及实现的复杂性。然后，从硬件实现角度，进行了DSP和FPGA的性能比较，提出DSP+FPGA基带发送的实现方案，并以基站分系统(BTS)的发送单元为例，具体给出了该实现方案在下行无线信道基带发送单元中的应用。
- 关键字： TD-SCDMA，DSP+FPGA
开发DSP硬件驱动程序的一种方法
- 本文介绍一种开发TI公司DSP片内及片外硬件外设驱动程序的方法，并以C5000 DSP的McBSP/DMA及TMS320C5509的USB驱动程序开发为具体对象，介绍这种方法的应用。
- 关键字： DSP，硬件驱动程序
用DSP实现CPLD多方案现场可编程配置
- 1 总体描述 系统中的DSP采用TI公司的定点数字信号处理器TMS320C5402。它采用4总线4级流水线的增强型哈佛结构，处理速度为100MIPS；具有片内4K×16位的ROM和16K×16位的DARAM， 2个多通道缓冲串行口(McBSP)，1个直接存储控制器(DMA)等片内外围电路；外部可扩展至1M×16位存储空间，芯片采用3.3V电源电压。 TMS320C5402的多通道缓冲串行口(mu
- 关键字： DSP CPLD
Xilinx宣布Virtex-5 SXT全线产品量产
- 赛灵思公司宣布面向数字信号处理(DSP)优化的Virtex™-5 SXT系列全线产品实现量产。这些产品是Xilinx™ XtremeDSP™ 解决方案的一部分，该解决方案包括开发套件、设计软件、IP和参考设计。Virtex-5 SXT平台器件针对高性能而优化，能够为包括无线、测试和测量以及国防应用在内的众多应用提供超过350 GMACs的定点运算性能，并为诸如医疗影像等应用提供高达82.5 GFLOPS的浮点DSP性能。 65nm Virtex-5 SXT系列
- 关键字： 赛灵思 DSP Virtex-5 SXT
采用DSP的铁路道口图像监控系统设计
- 目前，铁路道口基本有这样3种类型：有人看管、有人监护和无人看守监护。长期以来，铁路部门对有人看管道口和有人监护道口投入了人量的人力、物力，采取了安全措施，特别是有人看管道口，以道口自动报警信号为主要设施的技术装备已基本完善，为道口自身的安全管理创造了较好条件。但是，道口自动报警装置仅考虑到了加强道口自身监管、防止道口肇事的问题，而未兼顾到移动的列车存道口出现异常情况时，如何及时防止道口冲突的问题。为了使道口安全得到进一步控制，设计了一套基于DSP铁路道口图像监控系统，使列车在通过道口前的适当距离内，司
- 关键字： DSP 铁路道口图像监控系统
基于DSP的电动汽车CAN总线通讯技术设计
- 德国Bosch公司为了解决现代车辆中众多的控制和数据交换问题,开发出一种CAN(Controller AreaNetwork) 现场总线通讯结构. CAN总线硬件连接简单,有良好的可靠性、实时性和性能价格比. CAN总线能够满足现代自动化通讯的需要,已成为工业数据总线通讯领域中最为活要跃的一支。 其主要特点是: ①CAN总线为多主站总线,各节点均可在任意时刻主动向网络上的其它节点发送信息,不分主从,通信灵活; ②CAN总线采用独特的非破坏性总线仲裁技术,优先级高的节点优先传送数据,能满足实时性要
- 关键字： DSP 电动汽车CAN总线
多核处理器构架的高速JPEG解码算法
- JPEG(Joint Photographlc Experts Group)是一个适用范围很广的静态图像数据压缩标准，目前广泛应用于照相机、打印机等方面的图像处理。在这些应用中，设计出一个高速高效的JPEG解码器已经成为一个重要的研究方向。随着对嵌入式系统实时性、高性能和可扩展性要求的提高，多核(multi—core)嵌入式处理器的应用场合日益增多。 1 JPEG解码算法原理 JPEG 压缩是一种有损压缩。它利用人的视角系统特性，使用量化和无损压缩编码相结合的方式去掉视角的冗余信息
- 关键字： MCU/DSP
TMS320C61416 EMIF下双FPGA加载设计
- 基于SRAM结构的FPGA容量大，可重复操作，应用相当广泛;但其结构类似于SRAM，掉电后数据丢失，因此每次上电时都需重新加载。 目前实现加载的方法通常有两种：一种是用专用Cable通过JTAG口进行数据加载，另一种是外挂与该FPGA厂商配套的PROM芯片。前者需要在PC机上运行专用的加载软件，直接下载到FPGA片内，所以掉电数据仍然会丢失，只适用于FPGA调试阶段而不能应用于工业现场的数据加载。 后者虽然可以解决数据丢失问题，但这种专用芯片成本较高，供货周期也较长(一般大于2个月)，使F
- 关键字： SRAM TMS320C61416 FPGA
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