- 为充分利用硬件资源，满足不同的应用需求,本文提出了一种基于JTAG边界扫描模式配置的重构控制器，详细介绍控制器的硬件实现以及配置流程，该控制器通过模拟JTAG接口时序及TAP状态机的功能，实现在系统配置目标可编程器件。
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FPGA TAP状态机 JTAG边界扫描 重构 201001
- 随着2010年的来临，当今的全球电子公司纷纷做出明智而审慎的研发投资决定，以便借助创新的新产品，快速抓住新的市场机遇。FPGA越来越多地成为这些公司成功的关键。除了少数可超大批量生产的商品外，应用ASIC的高成本和高风险无法让绝大多数的商品赢利;现在面临着加速替代ASIC所带来的机遇，这主要体现在以下不同方面：芯片体系结构，也就是能够推出某种架构和相关的I/O，而且，密度和性能还能够达到一定水平，从而可以替代ASIC的功能。 软件在加速替代ASIC过程中也扮演了重要角色。高效的软件和设计工具大大提高了
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赛灵思 FPGA ASIC 摩尔定律
- 据业者透露，台积电公司将于今年中期开始为Altera公司生产28nm制程FPGA芯片产品。这种FPGA芯片将集成有28Gbps收发器，产品面向云计算，在线存储以及移动视频等应用，Altera公司两年前曾推出该系列产品的 40nm制程版本。台积电还宣布其28nm制程将为全代制程(full node:即制程升级时需要对芯片电路进行重新设计),而且年内其28nm制程还将具备可按客户的需求制作出HKMG(High-K绝缘层+金属栅极)或SiON(SiON绝缘层+硅栅极)这两种不同栅极结构的能力.
台积电
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台积电 28nm FPGA Altera
- 基于DSP和ST7920的液晶显示模块的实现, DSP是一种适合于数字信号处理的实时高速的高性能微处理器，已广泛应用于自动控制、图像处理、通信技术、网络设备、仪器、仪表和家电领域。液晶显示屏以其显示直观、便于操作的特点被用作各种便携式系统的显示终端。
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模块 实现 液晶显示 ST7920 DSP 基于
- 理解FPGA 中的压稳态 本白皮书介绍FPGA 中的压稳态，为什么会出现这一现象，它是怎样导致设计失败的。介绍怎样计算压稳态MTBF，重点是对结果造成影响的各种器件和设计参数。
引言
当信号在不相关或者异步时钟域
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FPGA 压稳态
- 人们对宽带服务的带宽要求越来越高，促使芯片供应商使用更多的高速串行收发器。因此，下一代应用采用了多种数据速率，从几Mbps 到数百Gbps，在一种设备中集成了多种协议和服务。以太网等迅速发展的标准以及对提高
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FPGA ASIC 40 nm
- 介绍了基于SOPC技术的嵌入式数字图像处理系统的设计方法，该系统以Alteral公司的Nios嵌入式软件处理器为核心来分别对图像的采集、存储，图像处理，显示等功能模块进型结构设计，最后把处理数据通过网络发送到接收端，从而完成了利用嵌入式系统和Internet技术的信息沟通。
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处理 理系 设计 图像 数字 FPGA MB86S02 基于
- 本工程设计完全符合IP核设计的规范流程，而且完成了Verilog HDL建模、功能仿真、综合、时序仿真等IP核设计的整个过程，电路功能正确。实际上，本系统在布局布线后，其系统的最高时钟频率可达80MHz。虽然使用浮点数会导致舍入误差，但这种误差很小，可以忽略。实践证明，本工程利用流水线结构，方便地实现了高速、连续、大数据量浮点数的加法运算，而且设计结构合理，性能优异，可以应用在高速信号处理系统中。
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FPGA 流水线 浮点 加法器
- 介绍扫频电路和DDS技术的原理，利用FPGA设计一个以DDS技术为基础的扫频信号源，给出用Verilog语言编程的实现方案和实现电路。并通过采用流水线技术提高了相位累加器的运算速度，通过改进ROM压缩算法以减小存储器的容量，完成了对整个系统的优化设计。运用QuartusⅡ软件仿真验证了程序设计的正确性，最终在硬件电路上实现了该扫频信号源。
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FPGA 扫频信号源
- Altera公司今天宣布了在即将推出的28nm FPGA中采用的创新技术：嵌入式HardCopy®模块、部分重新配置新方法以及嵌入式28-Gbps收发器，这些技术将极大的提高下一代Altera® FPGA的密度和I/O性能，并进一步巩固相对于ASIC和ASSP的竞争优势。
快速增长的宽带应用如高清晰(HD)视频、云计算、网络数据存储和移动视频等对基础设备和最终用户设备开发人员提出了新挑战。他们怎样才能够迅速提高系统带宽，同时满足严格的功耗和成本要求呢?Altera开发了最新的创新
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Altera 28nm FPGA
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