- 你接到要求用FPGA实现FIR滤波器的任务时，也许会想起在学校里所学的FIR基础知识，但是下一步该做什么呢?哪些参数是重要的?做这个设计的最佳方法是什么?还有这个设计应该怎样在FPGA中实现?现在有大量的低成本IP核和工具来帮助你进行设计，因为FIR是用FPGA实现的最普通的功能。
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FIR滤波器 DSP LUT FPGA
- 对于实际的DSP应用系统特别是产品化的DSP系统而言，可靠性是一个不容忽视的问题。由于DSP系统的时钟频率比较高，因此在运行时极有可能发生干扰和被干扰的现象，严重时系统可能会出现死机。为了克服这种情况，除了在软件上作一些保护措施外，硬件上也必须作相应的处理。硬件上最有效的保护措施就是采用具有监视(Watchdog)功能的自动复位电路。各大公司生产了多种微处理器监控器，用来监测微处理器的运行状态，一旦微处理器失控就强行复位微处理器，引导程序重新运行。
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MAX706S DSP 监控电路
- 在卫星姿态和轨道控制计算机(AOCC)分系统的设计和室内联调阶段，为方便系统调试，需设计动量轮模拟器，模拟执行机构动量轮所决定的卫星姿态和控制效果，代替真实部件进行分系统的开环和闭环试验。
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动量轮 模拟器 DSP
- 目前基于铜电缆的高速串口能够以数千兆位速率进行数据传送，并可通过使用多个并行通道达成超过100Gbps的数据传输率，不过传送的距离却受到限制，一个可以改善传输距离的作法是使用光互连来取代铜电缆，Alt
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DSP LGA FPGA DDM
- 设计了一组基于CPLD的PLC背板总线协议接口芯片，协议芯片可以区分PLC的背板总线的周期性数据和非周期性数据。详细介绍了通过Verilog HDL语言设计状态机、协议帧控制器、FIFO控制器的过程，
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PLC FIFO CPLD 总线协议
- 1 引言近年来，由于微电子学和计算机技术的迅速发展，给EDA技术行业带来了巨大的变化。 HDL（hardware description language）硬件描述语言是一种描述电路行为的
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Verilog CPLD FPGA HDL 汉明码
- 介绍了一种基于CPLD的图像采集系统,详细论述了线阵CCD的驱动方法、图像信号的处理与传输,并给出了测试结果。此系统很好地完成了高速运动状态下的图像采集工作。
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CCD 图像采集 CPLD
- GPIB控制器芯片是组建自动测试系统的核心，在测试领域应用广泛。本文拟讨论用ALTERA公司的低成本 CPLD 来实现 GPIB 控制器的功能。GPIB 控制器芯片的硬件设计主 要分为状态机的实现、数据通道和微处理接口的设计。本文重点介绍了各个模块的实现原理。
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GPIB控制器 自动测试系统 CPLD
- 现场可编程逻辑门阵列（FPGA）在通信系统中的应用越来越广泛。随着通信系统的复杂化和功能多样化,很多系统需要在不同时刻实现不同的功能,多数场合需要FPGA能够支持在线动态配置;在某些安全领域,需要对FPGA程序进行加密存储、动态升级。这里根据应用趋势提出了一种基于CPU＋CPLD的可靠的FPGA动态加载方法。该方法具有灵活、安全、可靠的特点,在通信电子领域具有一定的参考价值。
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动态配置 FPGA CPLD
- 文本信息用户可能乐意以体积换取 QWERTY 键盘，因为文本输入大为简便了，而且两个大拇指都可以用来输入文本信息或数据。最近，有些手机生产商已经推出了面向文本用户的带 QWERTY 键盘的手机。
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QWERTY键盘 GPIO CPLD
- 提出了一种基于CPLD的频率响应特性测试卡设计方案,分析了DDS原理的CPLD实现方法,给出了数据处理算法流程,并进行了设计验证实验,结果表明在逐点单频测试状态下,相位和幅值测量与标准仪器相比相位差小于0.5°,幅值差小于0.1dB。
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频率响应 DDS原理 CPLD
- 本文结合实际应用需要，设计了基于复杂可编程逻辑器件(CPLD)的线阵CCD数据采集系统。着重介绍了数据采集的特点及该系统软、硬件设计和最后的性能评价。
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数据采集系统 CCD CPLD
- 为实现智能车全景视觉系统的应用研究平台，设计了一种基于FPGA+双DSP的实时6通道数字图像采集与处理系统。该系统由两片FPGA与两个DSP组成。第一个FPGA进行多通道视觉图像采集的同步控制、逻辑处理，第二片FPGA辅助DSP进行海量图像数据的高速并行处理。
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全景视觉系统 FPGA+DSP 数字图像采集与处理系统
- 如果能充分利用P89C669的丰富的线性地址资源，将能大大增强系统能力。在一个嵌入式系统开发中，笔者采用ALTERA公司的CPLD芯片EPM7032利用这款单片机的线性地址扩展了丰富的外部设备资源。
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线性地址 存储器扩展 CPLD
- 提出了一种基于DSP及CPLD的掘进机控制系统设计方案,介绍了系统总体设计、CPLD数据采集模块及CPLD逻辑控制模块的设计。该系统采用CPLD实现数据采集,在AD采样环节节省DSP等待时间12μs,25路模拟信号每个采样周期节省300μs;采用CPLD代替标准逻辑器件实现各种逻辑功能,简化了硬件电路的设计,提高了控制系统集成度。实际应用表明,该系统能够满足掘进机正常生产的要求,具有较强的实时性和较高的可靠性。
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掘进机控制系统 AD采样 CPLD
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