- 嵌入式系统中DRAM控制器的CPLD解决方案,介绍怎样在嵌入式CPU 80C186XL DRAM刷新控制单元的基础上，利用CPLD技术和80C196XL的时序特征设计一个低价格、功能完整的DRAM控制器的方法，并采用VHDL语言编程实现。
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CPLD 解决方案 控制器 DRAM 系统 嵌入式
- 由于系统带宽不断的增加，因此针对更高的速度和性能，设计人员对存储技术进行了优化。下一代双数据速率（DDR）SDRAM芯片是DDR3 SDRAM。 DDR3 SDRAM具有比DDR2更多的优势。这些器件的功耗更低，能以更高的速度工作，有更高的性能（2倍的带宽），并有更大的密度。
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FPGA DDR3 存储器 控制器
- 全球可编程逻辑解决方案领导厂商赛灵思公司(Xilinx, Inc. )与全球领先的半导体代工厂商联华电子( UMC (NYSE: UMC; TSE: 2303))今天共同宣布，采用联华电子高性能40nm工艺的Virtex®-6 FPGA，已经完全通过生产前的验证。这是双方工程团队为进一步提升良率、增强可靠性并缩短生产周期而努力合作的成果。Virtex-6系列通过生产验证， 意味着联华电子继2009年3月发布首批基于40nm工艺的器件后，正式将该工艺转入量产。
“对于我们长
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Xilinx 40nm Virtex FPGA
- 引言
DSP芯片具有高速的信息处理能力、较好的系统支持、硬件配置强等优良技术和较低的价格特性。嵌入式系统的实时性好、占用资源少、功能强、可靠性高、模块化结构、便于移植和定制的特点。基于 DSP平台的嵌入式系统
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模块 设计 液晶 CPLD DSP 基于
- 1概述随着大规模集成电路和单片机的迅速发展，复杂可编程逻辑器件（CPLD）具有使用灵活、可靠性高、功...
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CPLD 通信数据传输
- 0引言现代通讯电子设备的抗干扰测试已经成为必须的测试项目，主要的干扰类型为噪声干扰。在通信信...
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FPGA 高斯白噪声发生器
- 2010年1月12日，安富利电子元件 (Avnet Electronics Marketing) 与赛灵思公司(Xilinx, Inc.)携手举办X-Fest 2010系列研讨会于北京拉开亚洲活动的帷幕。这次X-Fest技术研讨会在全球37个城市举办，其中包括亚洲地区的11个城市，预计到场人数是全球不同领域里最多的。本次北京的会议计划吸引300名工程师，实际到场人数接近600人，足见X-Fest的吸引力。
为期一天的研讨会为FPGA、DSP和嵌入式系统设计人员提供实用的技能培训，它将提供多种时长
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安富利 电子元件 FPGA DSP
- 赛灵思今天宣布第一批Virtex®-6 LX760系列FPGA已经开始发货上市。随着这款拥有即时设计工具支持的行业最大容量FPGA的上市，那些需要单纯大容量逻辑和行业领先I/O性能的赛灵思客户，将能够利用赛灵思ISE® 设计套件11.4版本立即开始进行项目设计开发。
Synopsys公司副总裁和Synplicity业务部门总经理Gary Meyers表示：“Virtex-6 LX760 器件所提供的逻辑密度比前一代最大的Virtex-5 器件高出2.5倍以上，因此，随
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赛灵思 Virtexk FPGA
- 据业者透露，包括台积电在内的各家芯片生产公司目前的40nm制程良率均无法突破70%大关。这种局面恐将对下一代显卡和FPGA芯片等产品的市场供货造成一 定的影响。台积电不久前在股东会上曾透露40nm制程产线遭遇工艺腔匹配问题，由此造成40nm产品良率不佳，不过目前他们去年底似乎已经解决了这个问 题。
另外，联电目前也正在其12英寸厂房中实施40nm制程芯片的量产。据业内人士透露，目前提供40nm制程FPGA芯片代工服务的Xilinx公司也出于保险起见开始推行多品种经营策略，以免受到40nm制程良率
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台积电 40nm FPGA
- 0引言磁浮轴承(MagneticBearing)是以磁性力完全非接触式支持旋转体的轴承，其广义上的定义是可支...
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FPGA 磁浮轴承控制系统
- Altium 继续为电子产品设计人员扩大器件选项。目前，最新版 Altium Designer 可提供 Xilinx Spartan®-6 器件系列的全面支持。
电子设计人员可针对首选 的FPGA(目前，Altium Designer 可支持 60 多款 FPGA产品)，或各种备选解决方案，采用 Altium Designer 对其性能、功耗以及其它设计参数进行比较。进而获得高度的设计灵活性，不必再为必须选择多个厂商的开发软件而困扰。电子产品设计人员在开发过程中，无需大量软硬件的重复设计
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Altium Spartan FPGA
- 随着红外焦平面阵列技术的快速发展，红外成像系统实现了高帧频、高分辨率、高可靠性及微型化，在目标跟踪、智能交通监控中得到了越来越多的应用，并向更加广泛的军事及民用领域扩展。
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DSP FPGA ASIC
- 引言 在高速源同步应用中，时钟数据恢复是基本的方法。最普遍的时钟恢复方法是利用数字时钟模块(DCM、)产生的多相位时钟对输入的数据进行过采样。但是由于DCM的固有抖动，在频率很高时，利用DCM作为一种数据恢复的
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SoftSerdes FPGA
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