Actel 公司宣布推出业界最低功耗的现场可编程门阵列 (FPGA) -- IGLOO™ 系列。这个以 Flash 为基础的产品系列的静态功耗为5µW，是最接近竞争产品功耗的四分之一；与目前领先的PLD产品比较，更可延长便携式应用的电池寿命达5倍，因而奠定了低功耗的新标准。
由于便携式产品的生命周期短及市场竞争激烈，设计人员必需不断增加新的功能和复杂性，但却不能耗用更多的电池能量。这个需求使到可重编程及全功能的Actel IGLOO 方案别具吸引力，足以取代ASIC和 C
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Actel FPGA 单片机 嵌入式系统
您是否曾想在您的FPGA设计中使用先进的视频压缩技术，却发现实现起来太过复杂？现在您无需成为一名视频专家就能在您的系统中使用视频压缩。赛灵思新推出的 MPEG-4 编码器/解码器核可以帮助您满足视频压缩需求。
视频和多媒体系统正变得日益复杂，因此能否获得适用于您的系统的低成本的可靠 IP 核对您的产品上市极为关键。特别是，视频压缩算法与标准已变成极为复杂的电路，需要花费很长时间来设计，并且常常成为系统测试和发货的瓶颈。这些 MPEG-4 简易 (simple profile) 编码器/解码器核也许正好
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FPGA MPEG-4 编解码器 单片机 嵌入式系统
Altera公司(NASDAQ: ALTR)今天宣布推出低成本Arria™ GX系列，继续扩大了公司在收发器FPGA市场上的领先优势。Arria GX FPGA经过优化，支持速率高达2.5Gbps的PCI Express (PCIe)、千兆以太网(GbE)和Serial RapidIO™ (SRIO)标准；这些标准迅速成为很多市场和应用领域的主流协议。Arria GX系列的特性包括成熟的Str
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Altera Arria FPGA GX 单片机 嵌入式系统
亚科鸿禹科技有限公司（HyperSilicon）于近日在北京推出了名为StarFire6S-DARM的系列新型FPGA原型验证系统。该公司原有的StarFire5S-V系列主要针对各类视音频SOC的设计验证，被国内设计公司广泛采用累计达20多套。这款新的StarFire6S-DARM系列继承了StarFire5S-V系列的大部分优点，在容量、灵活性和性能指标方面有了进一步提高，同时支持采用各类型ARMTM处理器的SOC验证，从而适应更广泛的SOC/ASIC/IP/FPGA的原型验证和算法实现的要求。
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FPGA StarFire6S-DARM 单片机 嵌入式系统 亚科鸿禹
摘要: 本文主要介绍了基于CPCI 总线设计的实时信号处理业务所需的一种专用设备平台。关键词： CPCI BUS；平台；实时信号处理；DSP+FPGA
系统设计DSP+FPGA混用设计为了提高算法效率，实时处理图像信息，本处理系统是基于DSP+FPGA混用结构设计的。业务板以FPGA为处理核心，实现数字视频信号的实时图像处理，DSP实现了部分的图像处理算法和FPGA的控制逻辑，并响应中断，实现数据通信和存储实时信号。首先，本系统要求DSP可以满足算法控制结构复杂、运算速度高、寻址灵
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0704_A BUS CPCI DSP+FPGA 单片机 平台 嵌入式系统 实时信号处理 杂志_设计天地
本文提出了一种基于PI 控制算法的三阶全数字锁相环，采用EDA 技术进行系统设计，并用可编程逻辑器件予以实现。
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FPGA 全数字 锁相环
DS18B20是DALLAS公司生产的一线式数字温度传感器，采用3引脚TO-92型小体积封装；温度测量范围为-55℃～+125℃，可编程为9位～12位A/D转换精度，测温分辨率可达0.0625℃，被测温度用符号扩展的16位数字量方式串行输出。 一线式(1-WIRE)串行总线是利用1条信号线就可以与总线上若干器件进行通信。具体应用中可以利用微处理器的I/O端口对DS18B20直接进行通信，也可以通过现场可编程门阵列(FPGA)等可编程逻辑器件(PLD)实现对1-WIRE器件的通信。
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DS18B20 FPGA 传感器 单片机 嵌入式系统
SYNPLICITY 公司日前宣布推出最新 Synplify DSP ASIC版，进一步丰富了其旗下的 ESL 软件系列。在该公司致力于提供各种技术独立的解决方案这一发展战略的引导下，新型 Synplify® DSP ASIC 版软件将帮助用户根据算法级设计的要求自动开发高质量 RTL 代码，以适应 FPGA 或 ASIC 器件的需求。 S
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ASIC DSP SYNPLICITY 消费电子 EDA IC设计 消费电子
本文介绍一种利用嵌入Blackfin处理器的ADSP-BF537作为处理器进行SoC的FPGA实时验证的方案及其总线接口转换...
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嵌入式 FPGA 功耗
前 言
几年前设计专用集成电路(ASIC) 还是少数集成电路设计工程师的事, 随着硅的集成度不断提高,百万门的ASIC 已不难实现, 系统制造公司的设计人员正越来越多地采用ASIC 技术集成系统级功能(System L evel In tegrete - SL I) , 或称片上系统(System on a ch ip ) , 但ASIC 设计能力跟不上制造能力的矛盾也日益突出。现在设计人员已不必全部用逻辑门去设计ASIC, 类似于用集成电路( IC) 芯片在印制板上的设计,ASIC 设计人员可以应用等
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ASIC CPLD FPGA IP 单片机 嵌入式系统
您是否曾想在您的 FPGA 设计中使用先进的视频压缩技术，却发现实现起来太过复杂？现在您无需成为一名视频专家就能在您的系统中使用视频压缩。赛灵思新推出的 MPEG-4 编码器/解码器核可以帮助您满足视频压缩需求。
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FPGA MPEG 编解码器
1 并行流水结构FIR的原理
在用FPGA或专用集成电路实现数字信号处理算法时，计算速度和芯片面积是两个相互制约的主要问题。实际应用FIR滤波器时，要获得良好的滤波效果，滤波器的阶数可能会显著增加，有时可能会多达几百阶。因此，有必要在性能和实现复杂性之间做出选择，也就是选择不同的滤波器实现结构。这里运用并行流水线结构来实现速度和硬件面积之间的互换和折衷。
在关键路径插入寄存器的流水线结构是提高系统吞吐率的一项强大的实现技术，并且不需要大量重复设置硬件。流水线的类型主要分为两种：算术流水线和指令流水线
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FIR滤波器 FPGA 并行流水线 单片机 可重配 嵌入式系统
日前，赛普拉斯半导体公司为其飞速发展的PSoC®混合信号阵列推出了两款新型评估套件。这两款最新上市的套件专为热释电红外（PIR）运动探测及I2C 端口拓展而设计，为设计者提供了简便易用的设计工具，协助他们迅速而高效地完成基于PSoC的多种应用设计。
•CY3236A-PIRMOTION：PIR运动探测套件包含使用PIR运动传感器实施运动探测所需的全部软硬件资源，该传感器采用赛普拉斯PSoC器件——CY8C27443进行智能控制。套件包括PIR运动传感器电路板、一只12V电源、
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PSoC 测量 测试 赛普拉斯 SoC ASIC
FPGA设计和验证工程师当今面临的最大挑战之一是时间和资源制约。随着FPGA在速度、密度和复杂性方面的增加，完成一个完整时序验证对人力和计算机处理器、存储器提出了更多更高的要求。
随着FPGA器件体积和复杂性的不断增加，设计工程师越来越需要有效的验证方。时序仿真可以是一种能发现最多问题的验证方法，但对许多设计来说，它常常是最困难和费时的方法之一。过去，采用标准台式计算机的时序仿真是以小时或分钟计算的，但现在对某些项目来说，在要求采用高性能64位服务器的情况下，其测试时间却要几天甚至几周。这样，这种
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FPGA 验证
引言
基于SRAM工艺FPGA在每次上电后需要进行配置，通常情况下FPGA的配置文件由片外专用的EPROM来加载。这种传统配置方式是在FPGA的功能相对稳定的情况下采用的。在系统设计要求配置速度高、容量大、以及远程升级时，这种方法就显得很不实际也不方便。本文介绍了通过ＡＲＭ对可编程器件进行配置的的设计和实现。
1 配置原理与方式
1.1 配置原理
在FPGA正常工作时，配置数据存储在SRAM单元中，这个SRAM单元也被称为配置存储（Configuration RAM）。由于SRAM是易失性的存
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ARM FPGA 单片机 配置 嵌入式系统
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