DSP+FPGA的机载总线接口板研究（二）

作者：时间：2013-09-24 来源：网络

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e="PADDING-RIGHT: 0px; PADDING-LEFT: 0px; PADDING-BOTTOM: 0px; MARGIN: 0px 0px 20px; WORD-SPACING: 0px; FONT: 14px/24px 宋体, arial; TEXT-TRANSFORM: none; COLOR: rgb(0,0,0); TEXT-INDENT: 2em; PADDING-TOP: 0px; WHITE-SPACE: normal; LETTER-SPACING: normal; BACKGROUND-COLOR: rgb(255,255,255); orphans: 2; widows: 2; webkit-text-size-adjust: auto; webkit-text-stroke-width: 0px">　　在整个系统的设计中，DSP主要用于控制FPGA工作、数据中转、与外设主机通信。利用DSP向FPGA写控制字，其中包含帧间隔长度大小等信息，可对FPGA进行控制;另外，根据FPGA的反馈状态，可做出相应的控制调整。考虑到用于控制FPGA的I/O口比较多，选用的DSP是TI公司的TMSLF2407A。TMSLF2407A的复用外围I/O口多达39个[2],图6是DSP与FPGA之间的具体连接。

　　图6 DSP与FPGA的连接示意图

　　DSP提供I/O操作信号/IS、读写选定信号R/W、读使能信号/RD、写使能信号/WE以及地址线低四位A0、A1、A2、A3。通过这些控制逻辑信号可区分四路通道及每路通道的高低字。

　　DSP和FPGA提供的其它辅助的控制和状态信号还包括：四路发送使能信号/ENTX[03],低电平有效;四路发送停止信号/TXT[03],低电平有效;接收数据到达信号/RER[03],用于告知DSP准备接收某一路通道已经到达的数据;发送数据准备好信号/TXR[03]信号，用于告知各个发送通道中是否还有未发出的数据暂存在FIFO里，低电平表示没有数据;发送通道FIFO满信号FUL[03],高电平有效;GLOBCLRN信号，用于FPGA初始化时对其内部进行全局清零;TESTREQ信号，用于对整个系统的自检。

　　整个电路板是通过双口RAM与外设主机进行通信的，双口RAM负责暂存外设要发送的数据和暂存FPGA处理过的数据。可把它大致分为8个区，每一个区负责存放四路接收通道和四路发送通道中的一路数据及控制字。利用双口RAM左右两中断的信箱可指挥接口板进行相应的操作。4 软件设计

　　软件的设计主要是DSP编程，DSP程序的主要任务就是初始化、管理DSP外围电路、控制FPGA的收发数据以及与外设交互。DSP的主程序流程图如图7所示。