其设计进行回归测试。这使他们能够识别出有待进一步分析的潜在问题区域。 
尽管HDL协同仿真速度较慢，但它却提高了HDL代码的可见性。因此，它很适合针对FPGA在环仿真过程中发现的问题区域进行更详细的分析。
总结
如果工程师遵循本文所述的四种最佳方法，开发FPGA原型将比传统的手动工作流程快出许多，并能使工程师信心倍增。此外，工程师还可以在整个开发过程中继续优化自己的模型，并快速地重新生成有关FPGA实现的代码。与依赖手工编写HDL的传统工作流程相比，这种能力可以显著缩短设计迭代的周期。
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