高速PCB中电源完整性的设计

二是电流回路上存在的电感。所谓地电源完整性问题是指在高速PCB中，当大量的芯片同时开启或关闭时，在电路中就会产生较大的瞬态电流，同时由于电源线和地线上电感电阻的存在，就会在两者之上产生电压波动。了解到电源完整性问题的本质，我们知道，要解决电源完整性问题，首先对于高速器件来说，我们通过加去耦电容来去掉它的高频噪声分量，这样就减少信号的瞬变时间;对于回路中所存在的电感来说，我们则要从电源的分层设计来考虑。

三、去耦电容的应用

在高速PCB设计中，去耦电容起着重要的作用，它的放置位置也很重要。这是因为在电源向负载短时间供电中，电容中的存储电荷可防止电压下降，如电容放置位置不恰当可使线阻抗过大，影响供电。同时电容在器件的高速切换时可滤除高频噪声。我们在高速PCB设计中，一般在电源的输出端和芯片的电源输入端各加一个去耦电容，其中靠近电源端的电容值一般较大（如10μF），这是因为PCB中我们一般用的是直流电源，为了滤除电源噪声电容的谐振频率可以相对较低;同时大电容可以确保电源输出的稳定性。对于芯片接电源的引脚处所加的去耦电容来说，其电容值一般较小（如0.1μF），这是因为在高速芯片中，噪声频率一般都比较高，这就要求所加去耦电容的谐振频率要高，即去耦电容的容值要小。

对于去耦电容的放置，我们知道，如果位置不当的话会增大线路阻抗，降低其谐振频率同时影响供电。对于去耦电容和芯片或电源中的电感，我们可以通过公式：求出，在公式中，l：电容与芯片间的线长;r：线半径;d：电源线与地之间的距离;

由此我们知道，要减少电感L，则必须减少l和d，即减少去耦电容和芯片所形成的环路面积，也就是要求电容与芯片尽可能靠近芯片器件。

四、电源回路的设计

要保证电源完整性，我们知道，良好的电源分配网络是必不可少的。首先对电源线和地线的设计，我们要保证线宽加粗（如宽为40mil，而普通信号线为10mil），这样才能尽可能地减少其阻抗值。随着芯片的速度越来越高，根据5/5规则，我们越来越多地使用多层板，通过专用的电源层进行供电和专用的地层构成回路，这样就减少了线路的电感。

图4中所示的是一个四层板的信号回路图，高频信号将从地层返回，在地层理想的情况下（没有分隔和过多的过孔），高频信号线将在地层上形成射频的镜像回路，返回电流将主要从高频信号在地层上的镜像路径返回，而在PCB中，信号线与地层之间的距离非常小（大约是0.3mm），这样就形成了小环路，不仅可以减少电源完整性的问题，也能够减少环路的射频辐射，避免引起其它的电磁兼容性问题。但在当今高集成度的PCB设计中，由于芯片集成度过高，过孔过密，多电源供电及数字器件及模拟器件共存所引起的电源层和地层的分隔等因素，要保证电源回路的畅通无阻则是很难的。