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TMS320LF2407与LAN91C111型嵌入式以太网接口电路的实现

作者:时间:2011-10-09来源:网络收藏
TX INT:当TX completion FIFO不为空时置1e;

本文引用地址:http://www.eepw.com.cn/article/150129.htm

  TX EMPTY INT:当TX FIFO为空时置to;

  AUTO RELEASE:如果置为1,发送包成功后,packet number不写到TX completion FIFO中,而且它所使用的存储空间被自动释放。

  

嵌入式以太网通信电路图

  (7)使用“每发送一个包产生一个中断”方案时,AUTO RELEASE=0,该方案的流程如上文所述。使用“每发送一个序列的包产生一个中断”方案时允许TX EMPTY INT和TX INT,AUTORELEASE=1,当发送完FIFO中的最后一个包后,产生TX EMPTY INT中断。若出现严重的发送错误,则产生TX INT中断,同时将发送失败的包的packet number保存到FIFO Ports寄存器,这样DSP就可以知道发送过程停止了。这种方案可以减少DSP的负担,而且存储空间的释放也更迅速。当AUTO RELEASE=1时,DSP不能得到成功发送包的packet number。

  4.2.3 接收数据包流程

  (1)DSP设置receive control寄存器中的RXEN位,允许接收包。

  (2)含有正确地址的包被接收到,从MMU请求存储空间,并分派一个packet number,内部的DMA逻辑产生连续的地址,并将接收到的字写到memory中,如果超界,包被丢弃,存储空间被释放。当检测到包的结束,Status Word被写到接收包的最前面,byte count写到第二个字。如果CRC校验正确,packet number被写到RX FIFO,由于RX FIFO非空时,因此将产生RCV INT中断;如果RCR校验不正确,则存储空间被释放,而且不产生中断。

  (3)DSP接收到中断后开始执行中断处理程序,首先读入Interrupt Status寄存器,如果产生接收中断(RCV INT位为1),则可从FIFO ports寄存器得到接收包的packet number,而且可从data register将接收包传送到DSP的内存或外存中。当处理结束,DSP向处理器发送REMOVE AND RELEASE FROM TOP OF RX命令(即设置寄存器MMUCOM为0x0060)以释放使用的存储空间和packet number。

  5 结束语

  该系统能够正确地接入快速,具备100/10Mbit/s、全双工/半双工自适应等多种功能,符合IEEE802.3/802.3μ-100Base-TX/1Obase-T规范,其支持RJ45和的连接,可以通过以太网接入Internet,从而从Internet上监控设备。

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