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ADI高速ADC为通信应用建立新标准

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作者:电子产品世界时间:2006-05-17来源:电子产品世界收藏


——新的ADC功耗降低了40%以上


  
 
美国模拟器件公司(Analog Devices, Inc.,纽约证券交易所代码: ADI),全球领先的高性能信号处理解决方案供应商和数据转换技术领先公司,今日在马萨诸塞州诺伍德市(NORWOOD, Mass.)推出其高速10 bit、 11 bit、12 bit模数转换器(ADC)系列产品,适合用于宽带通信和基础设施应用——例如电缆调制解调器终端系统、第三代和第四代微区和皮区基站以及固定点到点射频通信——需要降低功耗、小封装尺寸,但又不能牺牲高质量ADC性能的应用场合。其舰旗产品是12 bit 分辨率250  MSPS(每秒百万取样率)采样速率ADC,其功耗降低了40%以上,封装尺寸比同类产品减小20%,同时保证高中频(IF)条件下优良的性噪比(SNR)和无杂散动态范围(SFDR)。

 “AD9230是仅有的一款将功耗降低到500 mW 阈值 以下的12 bit 250 MSPS ADC,因此降低了功耗,减小了系统尺寸,并使散热管理的成本降到最低——对于当今高性能和有线应用是极其重要的属性,” 高速信号处理器部产品线总监Kevin Kattmann说,“AD9230用于微区和皮区基站传输路径优化了功率放大器的线性性能, 同时由于减小终端系统的尺寸有利于加快系统配置。在电缆终端系统中,数据宽带业务需求的增长在带宽中占据越来越重要的位置,要求允许提高信道密集度的低功耗ADC。”

低功耗、高速ADC系列

AD9230 12 bit 250 MSPS ADC是当今推出的引脚兼容、低功耗系列ADC的舰旗产品。该产品采用1.8V单电源,功耗仅425 mW,在70 MHz输入频率条件下能保持优良的SNR(65.5 dB FS)和SFDR (82 dBc)。AD9230还含有内置基准电压源和采样保持,两个并行低压差分信号(LVDS)输出模式(ANSI-644 和  IEEE 1596.3减小链接范围)容易与现场可编程门阵列(FPGA)连接以及双数据速率模式(DDR)将需要的并行输出数据印制线数量减半。DDR模式结合IEEE 1596.3减小链接范围的LVDS输出模式,可将功耗进一步降低到385 mW。

为获得最佳系统性能,AD9230可与ADI公司的AD8368, AD8369 和AD8370射频(RF)可变增益放大器一起使用。该系列的12 bit  AD9230包括三种速度等级(250 MSPS, 210 MSPS, 170 MSPS), 11bit AD9230-11 以200 MSPS采样速率工作,10 bit  AD9211也包含三种速度等级(250 MSPS, 200 MSPS, 170 MSPS)。



关键词: 通讯 网络 无线

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