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莱迪思推出适用于SERDES 和视频时钟分配的开发平台

作者:时间:2009-12-14来源:电子产品世界收藏

  半导体公司今日发布ispClock 5400D 可编程时钟器件的评估板,价格为169美元。这款新的评估板是适用于ispClock5400D差分时钟分配器件的评估和设计的易于使用的。该款评估板还可以用于查看5400D器件的性能和在系统编程,或者用作™ FPGA串行协议或视频协议评估板的副板或时钟源。

本文引用地址:http://www.eepw.com.cn/article/101175.htm

  通常,只有带有LVDS或LVPECL接口的价格昂贵的振荡器才可用作FPGA SERDES接口应用的参考时钟源。而现在ispClock5400D器件提供超低抖动差分时钟输出,可以用来驱动FPGA、ASSP和ASIC的通用时钟源以及SERDES参考时钟源。该评估板演示了如何将低成本的CMOS振荡器连接到ispClock5400D器件,为XAUI应用或270 MHz SDI视频应用产生高质量的时钟。

  混合信号器件产品经理Shyam Chandra 表示:“新款评估板为使用ispClock5400D器件实现差分时钟提供了一个优异的。该平台提供了一种快速接口到测试设备平台的方法,以确保5400D系列较低的周期和相位抖动性能。传统的时钟分配IC并不能很好地解决电路板上有关时序问题的设计挑战;事实上,在许多情况下,解决时序问题需要重新进行电路板布局和生产。我们的新款评估板展示了ispClock5400D器件相偏控制的灵活性,其成本远低于传统的时钟分配IC。”



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