- 近年来,随着信息科技的发展,电子存包系统由于其安全性高、可靠性高、方便快捷等特点,在车站码头、超市、图书馆、宾馆、游泳馆、俱乐部等公共场所及机关、企事业单位文件档案管理等部门得到了广泛的应用,有着广阔的市场前景。
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CPLD
- 本模块的功能是验证实现和PC机进行基本的串口通信的功能。需要在PC机上安装一个串口调试工具来验证程序的功能。程序实现了一个收发一帧10个bit（即无奇偶校验位）的串口控制器，10个bit是1位起始位，8个数据位，1个结束位。串口的波特律由程序中定义的div_par参数决定，更改该参数可以实现相应的波特率。程序当前设定的div_par 的值是0x104，对应的波特率是9600。用一个8倍波特率的时钟将发送或接受每一位bit的周期时间划分为8个时隙以使通信同步。
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VHDL 串口通信 PC机
- CPLD（Complex Programmable Logic Device）是Complex PLD的简称,一种较PLD为复杂的逻辑元件。CPLD是一种用户根据各自需要而自行构造逻辑功能的数字集成电路。其基本设计方法是借助集成开发软件平台，用原理图、硬件描述语言等方法，生成相应的目标文件，通过下载电缆（“在系统”编程）将代码传送到目标芯片中，实现设计的数字系统。
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CPLD
- 基于单片机和CPLD的DDS正交信号源，其频率幅度可精密控制，扩展输出频率达300 kHz，增加扫频输出功能。采用红外键盘控制频率和幅度，采用液晶同步显示信号的频率和幅度；输出端产生正弦波、方波、三角波、锯齿波，梯形波、短形波、频率突变的方波、尖脉冲数字信号等，且具有扫频输出的功能。测试结果表明，系统稳定可靠，人机交互界面友好，操作简单方便。
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DDS 正交信号源 CPLD 滤波器 DT9205 AT28C64
- SOPC一词主要是源自Altera, 其涵义是因为目前CPLD/FPGA的容量愈來愈大, 性能愈來愈好, 加上价格下跌的推波助澜之下, 以往ASIC产品才能具有的 SoC观念, 也能移植到CPLD/FPGA上, 并且因为CPLD/FPGA的可编程(Programmable)能力, 使得CPLD/FPGA不仅能实现一个高复难度的系统, 而且还能快速改变系统的特性. 类似的观念也鉴于Xilinx的Platform FPGA.
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SOPC CPLD FPGA
- 本文提出一种基于CPLD的简易字符叠加器，具有成本低、抗干扰性能好等特点，适用于视频监控。由于采用了CPLD器件，增强了系统集成度和设计灵活性。
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字符叠加器 RAM CPLD VHDL
- 功能强大的EDA开发软件和专业的综合工具的不断发展，使应用VHDL进行PLD设计变得更简单、更快捷。但决不能忽视VHDL语言的使用。随着所设计电路规模的增大，对有限的芯片资源的利用率问题就显得尤其重要。在不影响速度要求前提下，应尽可能地进行面积优化。适当地进行编码是优化设计的重要保障，对高质量、高效率地完成VHDL是十分有意的。
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VHDL 编码 面积优化
- 刚毕业的时候，我年少轻狂，以为自己已经可以独当一面，庙堂之上所学已经足以应付业界需要。然而在后来的工作过程中，我认识了很多牛人，也从他们身上学到了很多，从中总结了一个IC设计工程师需要具备的知识架构，想跟大家分享一下。 技能清单 作为一个真正合格的数字IC设计工程师，你永远都需要去不断学习更加先进的知识和技术。因此，这里列出来的技能永远都不会是完整的。我尽量每年都对这个列表进行一次更新。如果你觉得这个清单不全面，可以在本文下留言，我会尽可能把它补充完整。 语言类：Verilog-2001/&nb
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IC设计 VHDL
- 设计了一组基于CPLD的PLC背板总线协议接口芯片，协议芯片可以区分PLC的背板总线的周期性数据和非周期性数据。详细介绍了通过Verilog HDL语言设计状态机、协议帧控制器、FIFO控制器的过程，
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PLC FIFO CPLD 总线协议
- 1 引言近年来，由于微电子学和计算机技术的迅速发展，给EDA技术行业带来了巨大的变化。 HDL（hardware description language）硬件描述语言是一种描述电路行为的
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Verilog CPLD FPGA HDL 汉明码
- 介绍了一种基于CPLD的图像采集系统,详细论述了线阵CCD的驱动方法、图像信号的处理与传输,并给出了测试结果。此系统很好地完成了高速运动状态下的图像采集工作。
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CCD 图像采集 CPLD
- GPIB控制器芯片是组建自动测试系统的核心，在测试领域应用广泛。本文拟讨论用ALTERA公司的低成本 CPLD 来实现 GPIB 控制器的功能。GPIB 控制器芯片的硬件设计主 要分为状态机的实现、数据通道和微处理接口的设计。本文重点介绍了各个模块的实现原理。
- 关键字：
GPIB控制器 自动测试系统 CPLD
- 在Altera Cyclone II平台上采用“自顶向下”的模块化设计思想及VHDL硬件描述语言，设计了串行通信控制系统。在Quartus II软件上编译、仿真后下载到FPGA芯片EP2C5Q208上，进行在线编程调试，实现了串行通信控制功能。基于FPGA的系统设计调试维护方便、可靠性高，而且设计具有灵活性，可以方便地进行扩展和移植。
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模块化设计 串行通信控制系统 VHDL
- 现场可编程逻辑门阵列（FPGA）在通信系统中的应用越来越广泛。随着通信系统的复杂化和功能多样化,很多系统需要在不同时刻实现不同的功能,多数场合需要FPGA能够支持在线动态配置;在某些安全领域,需要对FPGA程序进行加密存储、动态升级。这里根据应用趋势提出了一种基于CPU＋CPLD的可靠的FPGA动态加载方法。该方法具有灵活、安全、可靠的特点,在通信电子领域具有一定的参考价值。
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动态配置 FPGA CPLD
- 文本信息用户可能乐意以体积换取 QWERTY 键盘，因为文本输入大为简便了，而且两个大拇指都可以用来输入文本信息或数据。最近，有些手机生产商已经推出了面向文本用户的带 QWERTY 键盘的手机。
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QWERTY键盘 GPIO CPLD
vhdl-cpld介绍
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