VHDL超高速集成电路硬件描述语言是随着集成电路系统化和高度集成化逐步发展起来的，是一种用于数字系统设计、测试，面向多领域、多层次的IEEE标准硬件描述语言。
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VHDL Max+PlusⅡ EDA
针对开关磁阻电机APC方式，本文介绍了一种基于CPLD的纯硬件控制方式。该系统采用一台1KW 6/4结构开关磁阻电机作为机电能量转换装置，采用EP1K30TC144-3型CPLD(复杂可编程逻辑器件)和外围电路构成数字控制器。实验结果表明，本文提出的开关磁阻电机纯硬件控制系统在实践上是可行的，基于CPLD的纯硬件控制器可获得优良的控制效果。
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开关磁阻电机 APC CPLD
无论是在通讯，消费电子，计算还是工业领域，MAX II CPLD都是进行控制路径应用最好的选择，这些应用都受成本和功耗预算的约束。MAX II器件提供更低的架构、更低的功耗以及更高的密度，使之成为复杂控制应用的最理想的解决方案，包括那些以前不可能采用CPLD的应用。
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MAXII 控制路径 CPLD
MAX® II CPLD 体系结构中两个独特的功能是其他 CPLD 所不具有的：内部振荡器和 8 Kbits 非易失用户闪存 ( 请参考图 1) 。
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MAX®II 体系结构 CPLD 独特功能
CPLD 最常见的应用是键盘编码器。处理器、ASSP 或者ASIC 一般无法提供足够的引脚来实现键盘功能。I/O 扩展是CPLD 很普通的功能，使处理器采用很少的I/O 便可以解码规模较大的键盘。虽然MAX® 和MAX® II 等CPLD 可以提供足够的低成本I/O，但是在键盘解码时没有必要为每一开关提供一个I/O。采用较少的连线进行键盘解码的优点在于减少了键盘到主电路板的走线数量，降低了键盘区开关矩阵的复杂度。本应用笔记解释怎样利用MAX II 器件资源来解码只有两个I/O 和一个GND 引脚的大规模开
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MAXII 模拟键盘 CPLD 编码器
Altera 的 MAX® II CPLD 系列自从推出以来，在低功耗应用上大展身手，特别是新的零功耗 MAX IIZ ，它的动态功耗和待机功耗都是业界最低的。 Altera新的零功耗 MAX IIZ CPLD ，在 CPLD 业界实现了最低的静态和动态功耗。 Altera® CPLD 能够帮助您提高性能，同时降低功耗。
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Altera 低功耗 MAXII CPLD
基于极具突破性的新型CPLD架构，MAX® II器件重新定义了CPLD的价值定位。传统意义上，CPLD由基于宏单元的逻辑阵列块（LAB）和特定的全局布线矩阵组成。对于基于宏单元的构架，随着逻辑密度的增加，布线区域呈指数性增长，因此当密度大于512宏单元时，该架构不具有高效的可升级性。
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架构 CPLD Max
心率计是常用的医学检查设备，实时准确的心率测量在病人监控、临床治疗及体育竞赛等方面都有着广泛的应用。心率测量包括瞬时心率测量和平均心率测量。瞬时心率不仅能够反映心率的快慢。同时能反映心率是否匀齐；平均心率虽只能反映心率的快慢，但记录方便，因此这两个参数在测量时都是必要的。
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VHDL 数字式 FPGA 心率计 设计
所谓结构体的行为描述（behavioral descriptions），即对设计实体按算法的路径来描述。行为描述在EDA工程中称为高层次描述或高级描述，
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VHDL 结构体 行为描述法
本文给出了一个利用格雷码对地址编码的羿步FIFO的实现方法，并给出了VHDL程序，以解决异步读写时钟引起的问题。
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异步 FIFO VHDL 设计
在结构体中，设计任务的程序包内定义了一个8输入与门（and8）和一个二异或非门（xnor2）。把该程序包编译到库中，可通过USE从句来调用这些元件，并从work库中的gatespkg程序包里获取标准化元件。
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VHDL 结构体 结构化 描述法
据流描述（dataflow description）是结构体描述方法之一，它描述了数据流程的运动路径、运动方向和运动结果。例如，同样是一个8位比较器采用数据流法编程
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VHDL 结构体 数据流 描述法
无论是设计通信、消费、计算机或工业应用，MAX?II器件都能够为成本和功率受限的控制通道应用提供所需的功能。MAX II更低的价格，更低的功率和更大的容量使其成为复杂控制应用的理想方案，包括以往不可能在CPLD中实现的新应用。MAX II器件采用了全新 CPLD体系结构，比以往的MAX器件有重大改进。
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应用手册 CPLD
vhdl-cpld介绍
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