- 以AT45DB041B为例，将FPGA和大容量串行flash存储芯片的优点有效地结合起来，实现了FPGA对串行存储芯片的高效读写操作，完成了对大量测量数据的存储处理和与上位机的交换，并在某电力局项目工频场强环境监测仪中成功应用。
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Flash 串行存储 FPGA
- 介绍了一种基于ARM和FPGA的嵌入式控制系统，该系统既能独立运行又能在计算机辅助下运行，是一种兼具柔性和开放性的系统。利用ARM的强大的数据流转换功能和FPGA的快速配置能力，实现硬件可重构。给出了系统的总体结构、ARM和FPGA之间的通信设计，重点给出了基于NiosII的嵌入式可重构底层控制设计，PWM功能模块在FPGA上的实现。设计的系统集成度高、灵活。实验表明系统具有高可靠性，能满足服务机器人外围器件多样性控制的要求。ARM和FPGA不仅可以并行运行处理数据，其之间又可以互相通信，实现了系统的扩展
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硬件可重构 NiosII FPGA
- 介绍一种基于FPGA的精密离心机光栅信号细分系统。说明了光栅信号的产生过程和基本处理方法，提出了一种综合EDA技术与光栅莫尔条纹电子学细分技术的设计方案。通过VerilogHDL实现该系统的主要设计，并利用ISE软件进行了仿真试验。试验表明,该系统具有捕捉速度快、跟踪精度高、相位误差小、成本低廉等特点。
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ISE 信号细分系统 光栅信号 FPGA
- 针对模型预测控制在微型设备及嵌入式系统应用中的实时性问题,从硬件实现控制算法的角度研究了基于FPGA（field programmable gate array）的预测控制器的设计和实现。采用基于Nios II嵌入式软核处理器的FPGA/SOPC（system on pro-grammable chip,可编程片上系统）方案,在FPGA芯片上构建SOPC系统,设计SOPC的硬件及软件系统,实现了基于FPGA的预测控制器;建立了基于FPGA和dSPACE系统的实时仿真平台,并进行了控制器实时仿真实验。实时
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模型预测控制 SOPC FPGA
- 设计工程师通常在FPGA上实现FIFO(先进先出寄存器)的时候，都会使用由芯片提供商所提供的FIFO。本文提供了一种基于信元的FIFO设计方法以供设计者在适当的时候选用。这种方法也适合于不定长包的处理。
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FIFO 信元 FPGA
- 介绍大规模、高速度的FPGA在小型渔用声纳系统设计中的应用。在该系统设计中，采用了Xilinx公司的FPGA芯片XCS40作为主要器件,基本上将整个系统的功能集成在了一片芯片上。实践证明,即降低了成本,又缩短了设计和调试的时间。
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渔用声纳系统 片上系统 FPGA
- 本文从实际应用的角度出发，采用FPGA作为主控芯片，设计了一款数字视频接口转换设备，该设备针对于MT9M111这款数字图像传感器产生的ITU-R BT.656格式数据进行采集、色彩空间变换、分辨率转换等操作，完成了从ITU-R BT.656格式数据到DVI格式数据的转换，使得MT9M111数字图像传感器的BT656数据格式图像能够以1280×960(60Hz)和1280×1024(60Hz)两种显示格式在DVI-I接口的显示器上显示，并且还具有图像静止功能，在系统空闲时的待机状态实现了整机的低功耗，适用于
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图像分辨率 视频接口转换 FPGA
- Altera低功耗28-nm器件的优点包括，降低产品成本，降低或者放宽功耗预算，较低的散热要求，能够满足更多的市场需求，在同样的散热和功耗预算内进一步提高性能等。采用最全面的方法降低28-nm产品的功耗，Altera帮助设计人员满足了迫切的低功耗需求。
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Altera 28nm FPGA
- 通过 FPGA实现音乐流水灯的控制, 实质上就是将不同音阶与特定频率的方波信号对应起来, 以方波信号驱动蜂鸣器发出音乐, 再根据不同音阶来控制流水灯的闪烁。与借助微处理器实现乐曲演奏相比, 以纯硬件方式完成乐曲演奏电路更直观。EDA工具和硬件描述语言发挥了强大功能,提供了设计可能性。
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ALU 音乐流水灯 FPGA
- 设计了一款嵌入FPGA的乘法器，该乘法器能够满足两个18 b有符号或17 b无符号数的乘法运算。该设计基于改进的布斯算法，提出了一种新的布斯译码和部分积结构，并对9-2压缩树和超前进位加法器进行了优化。该乘法器采用TSMC 0．18μn CMOS工艺，其关键路径延迟为3．46 ns。
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布斯算法 18×18乘法器 FPGA
- 为实现频谱监测、通信侦察等任务，提出了一种基于软件无线电的数字侦察接收机的软、硬件体系结构。该接收机基于高速数字信号处理器、大规模现场可编程门阵列、高速AD芯片、高精度大动态范围AGC电路，实现了信号的宽频段、宽带接收；采用盲信号处理技术，实现了对未知信号的参数辨识、分类、盲解调。
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频谱监测 软件无线电 FPGA
- 介绍以图像处理为应用背景、基于FPGA芯片建立的多软核系统设计。系统中包含两个Nios II软核处理器和两个用于进行图像颜色空间转换的CSC MegaCore IP核。两个Nios II软核处理器共享程序存储器、数据存储器及启动存储器。在硬件设计方面，CSC MegaCore IP作为外围组件通过一个自定义的接口控制器连接到以Nios II软核处理器为核心的SoPC系统中。在软件设计方面，运行在每个Nios II软核处理器上的程序通过硬件Mutex核协调对共享数据存储器的访问。
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图像处理 多软核系统 FPGA
- 以Altera公司的QuartusⅡ7．2作为开发工具，研究了基于FPGA的DDS IP核设计，并给出基于Signal TapⅡ嵌入式逻辑分析仪的仿真测试结果。将设计的DDS IP核封装成为SOPC Builder自定义的组件，结合32位嵌入式CPU软核NiosII，构成可编程片上系统(SOPC)，利用极少的硬件资源实现了可重构信号源。该系统基本功能都在FPGA芯片内完成，利用SOPC技术，在一片FPGA芯片上实现了整个信号源的硬件开发平台，达到既简化电路设计、又提高系统稳定性和可靠性的目的。
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直接数字频率合成 IP核 FPGA
- 基于遗传算法的组合逻辑电路的自动设计，依据给出的真值表，利用遗传算法自动生成符合要求的组合逻辑电路。由于遗传算法本身固有的并行性，采用软件实现的方法在速度上往往受到本质是串行计算的计算机制约，因此采用硬件化设计具有重要的意义。为了证明基于FPGA的遗传算法的高效性，设计了遗传算法的各个模块，实现了基于FPGA的遗传算法。
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遗传算法 自然进化 FPGA
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