- 摘 要：在对G.726语音编解码标准分析的基础上给出了基于FPGA的DSP设计流程,利用MATLAB/Simulink、DSP Builder和SOPC Builder工具设计了G.726语音编解码器,通过仿真实验验证了所设计的编解码器模型的正确性,实现了编解码器在SoPC系统中的综合。 关键词：ADPCM MATLAB/Simulink DSP Builder FPGA SoPC
G.726是ITU前身CCITT于1990年在G.721和G.723标准的基础上提出的关于把64kbps非线性PCM信号
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ADPCM Builder DSP FPGA MATLAB/Simulink SoPC 消费电子 消费电子
- 基于FPGA的IPV6数据包的拆装实现 王志远, 杜诗武, 曲 晶(信息工程学院 信息技术研究所,河南 郑州 450002) 摘 要：介绍了一种运用FPGA将IPV6数据包的包头和数据部分分离并重新封装的方法。利用该方法,可以使IPV6数据包的拆装处理速度达到2Gbit/s以上。 关键词：FPGA IPV6数据包 拆装 FIFO
笔者在参与国家“863”重大专题项目“高速密码芯片及验证平台系统”的过程中,遇到了将IPV6数据包的包头和数据部分拆开,然后把数据部分送密码芯片进行加
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FIFO FPGA IPV6数据包 拆装
- 基于DSP和FPGA的ARINC429机载总线接口板的硬件设计 西安交通大学电子与信息工程学院(710049) 种稚萌 王 亮 韩崇昭 李 峰 摘 要：介绍了民用飞机机载数据总线ARINC429的硬件接口板,该接口板采用DSP和FPGA实现四路ARINC429信号收发通道,使整个系统的处理速度大大提高。 关键词：ARINC429总线 DSP FPGA
机载数据总线 ARINC429在当代的运输机和相当数量的民航客机 (如A310、A300、A600、B757、B767)中有着广
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ARINC429总线 DSP FPGA
- 基于FPGA实现FIR滤波器的研究 武汉大学电气工程学院(430072) 郭晓宇 潘 登 杨同中 摘 要：针对在FPGA中实现FIR滤波器的关键——乘法运算的高效实现进行了研究,给出了将乘法化为查表的DA算法,并采用这一算法设计了FIR滤波器。通过FPGA仿真验证,证明了这一方法是可行和高效的,其实现的滤波器的性能优于用DSP和传统方法实现的FIR滤波器。最后介绍了整数的CSD表示和还处于研究阶段的根据FPGA实现的要求改进的最优表示。 关键词：FPGA DA FIR滤波器 CSD
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CSD DA FIR滤波器 FPGA
- 内嵌ARM核的FPGA芯片EPXA10及其在图像驱动和处理方面的应用 北京航空航天大学自动化科学与电气工程学院(100083) 尹 娜 江 洁 张广军 摘 要：介绍了内嵌 ARM核的FPGA芯片EPXA10的主要功能特点、内部结构及工作方式，通过其在图像驱动和处理方面的应用，体现了EPXA10逻辑控制实现简单、对大量数据做简单处理速度快以及软件编程灵活的特点。 关键词：ARM FPGA EPXA10 图像驱动 图像处理
随着亚微米技术的发展，FPGA芯片密度不断增加，并以强大的
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ARM EPXA10 FPGA 图像处理 图像驱动
- 高速数字串行加法器及其应用 深圳南山区科技园中兴通讯IC开发一部(518057) 钟信潮上海盛立亚光网络系统有限公司 薛小刚深圳南山区科技园中兴通讯3G开发(518057) 王 诚
摘 要：与传统加法器相比，数字串行加法器具有工作频率高、占用资源少、设计灵活等优点。介绍了数字串行加法器的原理，说明了该加法器在FPGA上的实现要点及其在匹配滤波器设计中的应用。 关键词：加法器 位并行 数字串行 FPGA 匹配滤波器
与传统DSP相比，定制DSP具有速度更高、设计灵活、易于更改
- 关键字：
FPGA 加法器 匹配滤波器 数字串行 位并行
- 在FPGA系统设计中，要达到性能最大化需要平衡具有混合性能效率的元器件，包括逻辑构造(fabric)、片上存储器、DSP和I/O带宽。在本文中，我将向你解释怎样能在追求更高系统级性能的过程中受益于Xilinx® 的Virtex™-5 FPGA构建模块，特别是新的ExpressFabric™技术。以针对逻辑和算术功能的量化预期性能改进为例，我将探究ExpressFabric架构的主要功能。基于实际客户设计的基准将说明Virtex-5ExpressFabric技术性能平均比前一
- 关键字：
FPGA Virtex-5 单片机 嵌入式系统
- 具有嵌入式处理器的 平台 FPGA 为您提供前所未有的灵活性、集成度和高性能。目前，在单个可编程逻辑设备中开发极其复杂且高度定制化的嵌入式系统已成为可能。 随着芯片性能的不断增加，如何使设计方法始终高效、多产，成为人们面临的主要挑战。嵌入式系统开发的关键活动之一是开发板支持包 (BSP)。利用 BSP，可以使嵌入式软件应用程序成功地初始化，并与连接到处理器的硬件资源进行通信。典型的 BSP 组件包括引导代码、设备驱动程序代码和
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FPGA PowerPC 处理器的Virtex 单片机 嵌入式系统
- 在FPGA系统设计中，要达到性能最大化需要平衡具有混合性能效率的元器件，包括逻辑构造(fabric)、片上存储器、DSP和I/O带宽。在本文中，我将向你解释怎样能在追求更高系统级性能的过程中受益于Xilinx? 的Virtex?-5 FPGA构建模块，特别是新的ExpressFabric?技术。以针对逻辑和算术功能的量化预期性能改进为例，我将探究ExpressFabric架构的主要功能。基于实际客户设计的基准将说明Virtex-5ExpressFabric技术性能平均比前一代Virtex-4 FPGA要高
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FPGA Virtex-5 单片机 逻辑构造 嵌入式系统
- 可重构计算（Reconfigurable Computing） 技术是指在软件的控制下，利用系统中的可重用资源（如FPGA等可重构逻辑器件），根据应用的需要重新构造一个新的计算平台，达到接近专用硬件设计的高性能。它避免了微处理器计算模式因为取指、译码等步骤导致的性能损失，同时也消除了专用集成电路（ASIC）计算模式因为前期设计制造的复杂过程带来的高代价和不可重用等缺陷。 从某种意义上来说，可重构计算技术并不是什么新技术，
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FPGA 可重构计算 嵌入式
- 引言
车辆在动态称重时，作用在平台上的力除真实轴重外，还有许多因素产生的干扰力，如：车速、车辆自身谐振、路面激励、轮胎驱动力等，给动态称重实现高精度测量造成很大困难。若在消除干扰的过程中采用模拟方法滤波，参数则不能过大，否则将产生过大的延迟导致不能实现实时处理，从而造成滤波后的信号仍然含有相当一部分的噪声。所以必须采用数字滤波消除干扰。
FIR滤波的原理及实现
本文采用FIR数字滤波，其原理如公式1所示。
Y(n)= (1)
其中h(k)为系统滤波参数，x(n)为采集的信号，
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FIR算法 FPGA 动态称重仪 汽车电子 汽车电子
- 一、前言 随着系统功率预算的不断紧缩，迫切需要新型低功率元器件。对通信基础设施而言，电路板冷却、机箱体积小型化以及系统可靠性在系统设计中都起着重要的作用。对e-应用，电池寿命、热耗散和小体积尺寸是主要的设计难点。选用智能器件，辅以正确的设计技巧增加了符合功率预算的可能性。尽管可编程逻辑器件（PLD）有很好的性能，然而却以牺牲功耗为代价。Actel公司的抗熔断型FPGA提供低功耗且高性能应用的理想解决方案。本文涵盖Actel eX系列以及SX/SX-A系列器件，详细描述了器件的结构特点与设计技巧。
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FPGA 低功耗
- 可免费下载并同时支持Windows和Linux平台的设计套件，能降低平均10%的动态功耗并提供扩展的FPGA器件支持
2007年1月30日，北京 - 全球领先的可编程逻辑解决方案提供商赛灵思公司(Xilinx, Inc.) (NASDAQ:XLNX) 日前宣布推出最新版本、可免费下载的逻辑设计套件——集成软件环境 (ISE™) WebPACK™ 9.1i，目前用户可立即下载使用。这一新版本包含了使用广泛的赛灵思 ISE Foundatio
- 关键字：
FPGA Linux Windows
- 管ＦＰＧＡ和ＣＰＬＤ都是可编程ＡＳＩＣ器件,有很多共同特点,但由于ＣＰＬＤ和ＦＰＧＡ结构上的差异,具有各自的特点:①ＣＰＬＤ更适合完成各种算法和组合逻辑,ＦＰ ＧＡ更适合于完成时序逻辑。换句话说,ＦＰＧＡ更适合于触发器丰富的结构,而ＣＰＬＤ更适合于触发器有限而乘积项丰富的结构。②ＣＰＬＤ的连续式布线结构决定了它的时序延迟是均匀的和可预测的,而ＦＰＧＡ的分段式布线结构决定了其延迟的不可预测性。
③在编程上ＦＰＧＡ比ＣＰＬＤ具有更大的灵活性。ＣＰＬＤ通过修改具有固定内连电路的逻辑功能来编程,ＦＰＧＡ主要通过
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CPLD FPGA
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