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- 许多高速数据采集应用，如激光雷达或光纤测试等，都需要从嘈杂的环境中采集小的重复信号，因此对于数据采集系统的设计来说，最大的挑战就是如何最大限
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- 中国广州，2018年8月16日，国内领先的可编程逻辑器件供应商——广东高云半导体科技股份有限公司(如下简称“高云半导体”)，今日宣布发布基于高云半导体FPGA的RISC-V微处理器早期使用者计划，该计划是基于晨熙家族 GW2A 系列FPGA芯片的包括系统级参考设计的FPGA编程BIT文件、GW2A开发板等的完整解决方案，其中系统级参考设计包括RISC-V MCU内核、AHB & APB总线、存储器控制单元及若干外设。 RISC-V作为指令集体系结构(ISA)的开放规范，RISC-V ISA设
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- 这里我谈谈我的一些经验和大家分享，希望能对 IC 设计的新手有一定的帮助，能使得他们能少走一些弯路!在 IC 工业中有许多不同的领域， IC 设计者的特征
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- FPGA已经变得如此成本效益的，它们越来越多地与微控制器配合使用，以提高整个系统的效率。使用包括添加额外的功能在电路板空间最小，增加功率高效处理
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- I2S总线是一种用于音频设备间传输数据的串行总线标准，该总线采用独立的时钟线与数据线，避免了时差诱发的失真。随着多媒体的广泛应用，该总线已被应用
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- 由于结构化ASIC具有单位成本低、功耗低、性能高和转换快(fast turnaound)等特点，越来越多的先进系统设计工程师正在考虑予以采用。在结构化ASIC中，像
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- 最近几年数据量和可访问性的迅速增长，使得人工智能的算法设计理念发生了转变。人工建立算法的做法被计算机从大量数据中自动习得可组合系统的能力所取
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- 最近几年，深度学习成为计算机视觉、语音识别、自然语言处理等关键领域中所最常使用的技术，被业界大为关注。然而，深度学习模型需要极为大量的数据和
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- 凭借出色的性能和功耗指标，赛灵思 FPGA 成为设计人员构建卷积神经网络的首选 XE XE XE XE 。新的软件工具可简化实现工作。人工智能正在经
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- 从最近一段时间工作和学习的成果中，我总结了如下几种进行时序约束的方法。按照从易到难的顺序排列如下： 1. 核心频率约束 这是最基本的，所以标号为0。 2. 核心频率约束+时序例外约束 时序例外约束包括FalsePath、MulticyclePath、MaxDelay、MinDelay。但这还不是最完整的时序约束。如果仅有这些约束的话，说明设计者的思路还局限在FPGA芯片内部。 3. 核心频率约束+时序例外约束+I/O约束 I/O约束包括引脚分配位置、空闲引脚驱动方式、外部走线延时(Inpu
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- 国产FPGA起步较国外厂商晚30年，技术和专利基础薄弱。中兴事件爆发和中美贸易战升级，为本土FPGA国产化发展带来新的契机。
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- 一、总线：我们知道，一个电路总是由元器件通过电线连接而成的，在模拟电路中，连线并不成为一个问题，因为各器件间一般是串行关系，各器件之间的连线
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