在高速移动下，OFDM系统载波间正交性被破坏，出现载波间干扰(ICI)，严重影响系统性能，必须采用适当的均衡技术以补偿ICI。为了保证通信的有效性和实时性要求，使用FPGA实现了一种低复杂度的最小均方误差(MMSE)OFDM均衡器算法。在ISE软件平台上使用Verilog语言编写程序，并在Xilinx公司Virtex-2实验板(XC2V930芯片)上对设计进行了验证。
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OFDM FPGA 移动 均衡器
摘要：基于FPGA的应用技术，采用Altera公司DE2-70开发板的CycloneⅡ系列EP2C70作为核心器件，设计了一种基于FPGA的新型可调信号发生器。通过QuartusⅡ软件及Vetilog HDL编程语言设计LPM_ROM模块定制数据ROM，并通过地
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FPGA 信号发生器
随着数字技术的飞速发展，各种数字显示屏也随即涌现出来有led、LCD、DLP等，各种数字大屏幕的控制系统多种多样，有用ARM+FPGA脱机控制系统，也有用PC+DVI接口解码芯片+FPGA芯片联机控制系统，在这里我们讲述一种不仅
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图像 显示系统 系统 设计 大屏幕 LED FPGA 芯片 控制
摘要：在水下激光成像系统中，由于复杂的水下环境对激光传输的影响较大，为了更加有效地实现距离选通功能，该同步控制电路的设计选用高性能的Altera Stratix III系列的FPGA。电路分为距离延迟和门延迟2个模块，创新地
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控制 电路设计 同步 距离 激光 成像 FPGA
基于NiosⅡ的SD卡驱动程序开发,摘要：提出一种在FPGA NiosⅡ软核处理器下SD卡驱动设计的方法。采用Altera公司的FPGA可编程逻辑器件，构建了NiosⅡ软核处理器平台，并在此之上实现了SD卡的驱动设计。实验结果表明：设计提高了FPGA系统的设计灵活度，
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程序开发 驱动 SD Nios 基于 FPGA ARM
全球可编程平台领导厂商赛灵思公司(Xilinx, Inc. (NASDAQ:XLNX) )今天宣布推出其第四代部分可重配置设计流程，以及智能时钟门控技术的多项全新强化方案，可针对Virtex™®-6 FPGA设计中BRAM(block-RAM)降低24%的动态功耗。设计人员即日起即可下载ISE12.2设计套件，利用其简便易用、直观的部分可重配置设计流程，进一步降低功耗和整体系统成本。同时，最新推出的ISE版本还可提供一项低成本仿真方案， 支持嵌入式设计流程。
赛灵思 ISE
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Xilinx FPGA ISE12.2
引言随着FPGA技术的发展，出现了一种新概念的嵌入式系统，即SOPC（SystemOnProgrammableChip）。SOPC技...
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FPGA SOPC NOR Flash 嵌入式
美国赛灵思(Xilinx)发布了抗辐射性和性能均高于其原产品的航天领域用FPGA“Virtex-5QV FPGA”。将耐辐射总剂量(TID)提高到了该公司原产品的2倍以上之外，其规模也达到了13万个逻辑单元，作为航天领域用FPGA中属业界最高水准。此外，还集成了最高速度为3.125Gbit/秒的高速收发器，并强化了DSP功能。主要面向人造卫星和宇宙飞船上的遥感处理、图像处理以及导航仪等用途。目前正在样品供货，将从2011年1～3月开始65nm工艺的量产。赛灵思表示：&ldquo
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Xilinx Virtex FPGA
带服务能够支持三重应用（即支持语音、视频和数据）至第一英里的客户，例如持续发展的小商业和住宅。FTTx中的...
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FPGA GPON 低功耗
DDR3存储器系统可以大大提升各种数据处理应用的性能。然而，和过去几代（DDR和DDR2）器件相比，DDR3存储器器件...
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FPGA IP核 DDR3 数据处理
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