- 在直流电机控制系统中，被控制量一般都是电机的转速，控制的目的是保持电机的转速在所需要的定值上。但在实际生产过程中，电机带动生产机械或者其他负载运动的表现不一定都是转速，也可能是使生产机械或其机构产生一定的位置变化，这时需要的控制量就不再是电机的转速，而是控制对象的直线位移，因此需将电机的转速输出转换为电机的位移输出。
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直流电机 位置控制 FPGA
- 无线TEM（电信设备制造商）正受到布署基站架构的压力，这就是用更小体积、更低功耗、更低制造成本来建立，部署和运营。达到此目的的关键策略是从基站中分离出RF接收器和功率放大器，用它们来直接驱动各自的天线。这称为射频拉远技术(RRH)。通过基于SERDES的公共无线接口(CPRI)将基带数据传回到基站。本文主要阐述特定的低延迟变化的设计思想，在低成本FPGA上利用嵌入式SERDES收发器和CPRI IP（知识产权）核实现。
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CPRI 远程基站 FPGA
- 实时操作系统RTOS(Real Time Operating System)由于具有调度的实时性、响应时间的可确定性、系统高度的可靠性等特点，被越来越多地应用在嵌入式系统中，如：航空航天、工业控制、汽车电子和核电站建设等众多领域。
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μC／OS－II FPGA RTOS
- FPGA概述 现场可编程门阵列(FPGA)是一种可编程逻辑器件，由成千上万个完全相同的可编程逻辑单元组成，周围是输入/输出单元构成的外设。制造完成后，FPGA可以在工作现场编程，以
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I/O模块 VCCINT FPGA
- 引言随着大规模集成电路的快速发展，系统设计已从传统的追求大规模、高密度逐渐转向提高资源利用率，使有限的资源可以实现更大规模的逻辑设计。利用现场可编程逻辑器件FPGA的多次可编程配置特点，通过重新下
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VC＋＋ PCI总线 FPGA
- 电机在现代生活中扮演着重要角色。出于对安全、成本及效率的考虑，工程师——尤其是混合电动力汽车(HEV)工程师——往往希望在特定的真实环境下通过仿真电机模型对电机控制器进行测试。
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环仿真器 电机控制器 FPGA
- 数字波束形成技术充分利用阵列天线所获取的空间信息，通过信号处理技术使波束获得超分辨率和低副瓣的性能，实现了波束的扫描、目标的跟踪以及空间干扰信号的零陷，因而数字波束形成技术在雷达信号处理
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数字波束形成技术 信号处理器 FPGA
- 可编程逻辑器件FPGA以其开发周期短、成本低、功耗低、可靠性高等优势，广泛应用于通信、航空、医疗等领域，近年来在消费电子领域中的应用也日渐增加。为进一步挖掘FPGA在家庭娱乐如游戏机开发与应用中的巨大
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LED 控制器 FPGA
- 可编程逻辑解决方案领导厂商赛灵思公司（Xilinx, Inc. (NASDAQ: XLNX)）在德国纽伦堡召开的 2010 年全球嵌入式展览会（Embedded World 2010）上推出赛灵思 Spartan®-6 FPGA 工业影像目标设计平台，为低成本、低功耗的工业影像系统加速高性能视频处理应用开发。工业设备 OEM 厂商现在就可快速构建并评估具有高清影像分辨率、专用影像传感器接口，以及智能视频和高级影像处理算法的可再编程影像解决方案。
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赛灵思 OEM FPGA
- 系统采用现场FPGA作为硬件设计核心，使用Veritog语言。进行硬件描述，使系统更灵活，可在线编程，便于扩展和升级。这里的CCD驱动时序采用状态机与分频相结合的新方法，实际测试驱动波形稳定且没有毛刺，CCD输出信号质量高。USB应用于Slave FIFO高速传输模式，满足了高速CCD声光信号采集的要求，具有实时性、高速、稳定、可靠等特点。
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USB2.0 CCD FPGA 声光信号采集
- FPGA 设计人员可以通过增大tMET ，采用增加同步寄存器时序余量等设计方法来提高系统可靠性，增大亚稳态MTBF。Altera 确定了其 FPGA 的MTBF 参数，改进器件技术，从而增大了亚稳态MTBF。使用Altera FPGA 的设计人员可以利用Quartus II 软件功能来报告设计的亚稳态MTBF，优化设计布局以增大MTBF。
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压稳态 MTBF FPGA
- 在上世纪最后的十年里，重复可编程逻辑器件大放异彩，在通信行也得到了广泛的应用，这一时期FPGA 竞争基本上集中在容量，性能， IO 标准方面。而在便携应用方面因为FPGA 的高昂的价格，惊人的功耗基本上很少应用。
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Actel 便携式系统 FPGA
- 交织技术能很好地纠正信息传输过程中出现的突发性错误。在数字信息传输系统中得到了广泛应用。本文将在讨论信息产业部重点支持发展的TETRA数字集群通信系统语音信道编码结构和流程的基础上，重点研究交织技术在其语音信道编码中的应用及用FPGA实现该交织器的方法。
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TETRA 数字集群 FPGA 通信系统 语音信道编码 交织器
- 从制造的角度来讲，FPGA测试是指对FPGA器件内部的逻辑块、可编程互联线、输入输出块等资源的检测。完整的FPGA测试包括两步，一是配置FPGA、然后是测试FPGA，配置FPGA是指将FPGA通过将配置数据下载编程使其内部的待测资源连接成一定的结构，在尽可能少的配置次数下保证FPGA内部资源的测试覆盖率，配置数据称为TC，配置FPGA的这部分时间在整个测试流程占很大比例；测试FPGA则是指对待测FPGA施加设计好的测试激励并回收激励，测试激励称为TS。
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重复配置 测试 FPGA
- 在对H．264标准中二进制化部分研究和分析的基础上，提出其FPGA电路结构，采用并行结构及流水线方式设计电路。该结构经Spartan3 FPGA实现，其吞吐量为每周期1 bit，最大时钟频率为100 MHz，能够满足H．264中第3级及其以上档次实时视频编码的要求。
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H.264 二进制化 编码器 FPGA
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