- VSAT是一种小卫星通信系统,可为边远地区的家庭和商业用户提供可靠的、具有成本效应的宽带数据和其它业务。VSAT采用一种小型天线来发送和接收卫星信号,可为所有处于卫星覆盖区域内的用户提供高带宽连接,无论用
- 关键字:
PLL 设计 高频 单芯片 噪音 基于
- 芯片设计解决方案供应商微捷码(Magma®)设计自动化有限公司日前宣布,消费电子产品全球供应商Technology Leaders & Innovators (TLi)公司已采用FineSim™ SPICE作为大型模拟IP设计的标准验证工具。TLi是在对大量商用SPICE仿真产品进行彻底详尽的评估,结果显示具有线性多CPU功能的FineSim SPICE提供了较传统多线程仿真器快上一个数量级的运行时间后才决定选用这款微捷码软件。
“我们设计着许多不同类型的
- 关键字:
Magma FineSim PLL ADC/DAC 高速I/O
- 概述
ATA5749是一款集成了完整小数分频器(fractional-N)的PLL射频发送器IC,适用于轮胎气压计、遥控无键入口和被动式入口汽车应用。ATA5749采用幅移键控(ASK)和闭环频移键控(FSK)调制,仅使用13.000 0 MHz晶体
- 关键字:
分频 应用 ATA5749 发送 集成 PLL 完全
- 现代频率合成技术正朝着高性能、小型化的方向发展,应用最为广泛的是直接数字式频率合成器(DDS)和锁相式频率合成器(PLL)。介绍直接数字频率合成器和锁相环频率合成器的基本原理,简述用直接数字频率合成器(AD9954)和锁相环频率合成器(ADF4112)所设计的本振源的实现方案,重点阐述了系统的硬件实现,包括系统原理、主要电路单元设计等,并且对系统的相位噪声和杂散性能做了简要分析,最后给出了系统测试结果。
- 关键字:
DDS PLL
- 致力于丰富数字媒体体验、提供领先的混合信号半导体解决方案供应商 IDT® 公司(Integrated Device Technology, Inc.)推出其 VersaClock™ 计时器件的最新产品系列。VersaClock III 器件是专为高性能消费、电信、网络和数据通信应用设计的可编程时钟发生器,可以更经济有效地在多个晶体和振荡器之间进行选择。这些可编程计时解决方案对节省占板空间和保持功效非常关键,因其体积可能不允许全定制解决方案。多个具有各种不同需求的系统能够整合成更少的
- 关键字:
IDT VersaClock 可编程时钟发生器 PLL
- MIPS 科技公司宣布,中国科学院计算技术研究所已获得 MIPS32 和 MIPS64 架构授权,以进一步推动龙芯系列处理器的开发与商业化工作。在 2007 年,MIPS 科技的授权客户意法半导体(STMicroelectronics)选用 MIPS64 架构来支持 ICT 的龙芯处理器研发。本次则是该机构首度直接取得 MIPS 架构授权。
中国科学院计算技术研究所(ICT)所长李国杰先生表示:“我们非常高兴能与 MIPS 强化合作关系,以持续推动新技术在中国的创新与采用。业界标准
- 关键字:
MIPS 龙芯 MIPS32 MIPS64 MIPS-based
- 为家庭娱乐、通信、网络和便携多媒体市场提供业界标准处理器架构和内核的领导厂商 MIPS 科技公司(MIPS Technologies, Inc)今天宣布,推出其行业标准 MIPS 架构的 Android™ 平台。MIPS 科技还宣布将在 60 天内公开MIPS优化后的源代码。这一举措由若干生态系统合作伙伴共同推动,未来还会有更多合作伙伴加入,将 Android 带给全球广大的 MIPS 开发社区,现在就可以开始采用这一革命性的平台进行数字电视、移动互联网设备(MID)、数码相框(DPF)和
- 关键字:
MIPS 数字电视 Android MIPS-Based
- 摘 要:结合数字式频率合成器(DDs)和集成锁相环(PLL)各自的优点,研制并设计了以DDS芯片AD9954和集成锁相芯片ADF4113构成的高分辨率、低杂散、宽频段频率合成器,并对该频率合成器进行了分析和仿真,从仿真和测试结果
- 关键字:
DDS PLL 驱动 宽带频率
- 多年以来,作为业界主流产品的模拟PLL已被熟知,模拟PLL性能稳定,可为频率合成和抖动消除提供低成本的解决方案,工作频率高达8GHz及以上。然而新兴的基于直接数字频率合成(DDS)的数字PLL在某些应用中极具竞争力。本文比较了模拟PLL和基于DDS的数字PLL之间的差异,以及如何利用这些差异来指导设计人员选择最佳的解决方案。
数字PLL利用数字逻辑实现传统的PLL模块。虽然实现数字PLL的方法有很多,但本文只介绍基于DDS的数字PLL架构。
图1 典型的模拟PLL结构框图
- 关键字:
PLL DDS 分频器 鉴相器 DAC VCO
- 中国 北京——Analog Devices, Inc.(纽约证券交易所代码:ADI),全球领先的高性能信号处理解决方案供应商,最新推出一对时钟发生与分配IC——AD9520与AD9522,实现了业界最佳的器件集成度、低噪声、低抖动性能与信号输出灵活性的完美组合。 AD9520与AD9522多输出时钟发生器内置一个512 Byte的嵌入式EEPROM存储器模块,为系统工程师提供了可用作时钟源和系统时钟的双重可编程时钟解决方案。通过利用片上存储器对具体的输出
- 关键字:
EEPROM 冗余基准 PLL Analog Devices
- Maxim推出基于晶体的锁相环(PLL) VHF/UHF发送器MAX7057,能够在较宽的频率范围内发送OOK/ASK/FSK数据。器件配合适当的晶体频率,可以发送300MHz至450MHz范围内的任何信号,并能够以高达100kbps的速率发送NRZ码(50kbps曼彻斯特码)。
MAX7057集成了可编程分数N PLL合成器和宽带VCO,因而具有极大的灵活性。此外,还可以设置内部电容,实现功率放大器(PA)与天线之间的阻抗匹配。这种拓扑结构可确保多个工作频率下的高效率传输,从而使MAX7057
- 关键字:
Maxim PLL 锁相环 发送器
- CDCE937 和 CDCEL937 均为基于 PLL 模块的、低成本、高性能的可编程时钟合成器,可以在单输入频率的不同频率下生成多达七个输出时钟。每一个输出均可以进行系统内编程,从而使用三个独立的可配置 PLL 就可用于任何高达 230MHz 的时钟频率。该器件具有简单的频率同步,使零-PPM 时钟生成成为可能。另外,这两种合成器还具有扩频时钟及片上 EEPROM 和通过 SDA/SCL 进行系统内热编程的特点。对于数字媒体系统、流媒体、GPS 接收机、便携式媒体以及DSP/OMAP/DaVinci
- 关键字:
TI 时钟合成器 可编程 PLL
- 0 引 言
目前,脉冲雷达的脉内信号分析一直是研究的热点和难点,如何能更快速,准确的对脉内载波频率测量成为研究人员关注的目标,与此同时高精度频率源在无线电领域应用越来越广泛,对频率测量设备有了更高的要求,因此研究新的测频方法对开发低成本、小体积且使用和携带方便的频率测量设备有着十分重要的意义。本文根据雷达发射机频率快速变化的特点,采用目前新型的逻辑控制器件研究新型频率测量模块,结合等精度内插测频原理,对整形放大后的脉冲直接计数,实现对下变频后单脉冲包络的载波快速测频。具有测量精度高,测量用时短的
- 关键字:
测频模块 时钟内插 时钟移相 PLL 脉内测频
- 特瑞仕半导体株式会社开发了XC25BS8系列内置分频、倍频电路超小型PLL时钟发生器。
XC25BS8系列是能在低频输入8kHz、4095倍的范围内倍频工作的PLL时钟发生器IC。
输入端分频因子(M)可从1~2047的分频范围内进行选择;输出端分频因子(N)可从1~4095的分频范围内进行选择。输出频率在1MHz~100MHz的范围内,输入时钟为8kHz~36MHz的标准时钟。在内部可进行微调,在少量外置部件的条件下动作。从CE端子输入低电平信号,可停止整个芯片动作,抑制
- 关键字:
半导体 特瑞仕 时钟发生器 PLL
pll-based介绍
您好,目前还没有人创建词条pll-based!
欢迎您创建该词条,阐述对pll-based的理解,并与今后在此搜索pll-based的朋友们分享。
创建词条
关于我们 -
广告服务 -
企业会员服务 -
网站地图 -
联系我们 -
征稿 -
友情链接 -
手机EEPW
Copyright ©2000-2015 ELECTRONIC ENGINEERING & PRODUCT WORLD. All rights reserved.
《电子产品世界》杂志社 版权所有 北京东晓国际技术信息咨询有限公司

京ICP备12027778号-2 北京市公安局备案:1101082052 京公网安备11010802012473