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Silicon Labs PCI Express时钟抖动计算工具简化计时设计
- Silicon Labs(芯科科技有限公司)今日宣布推出一款免费的软件工具，使工程师仅需通过几次简单的点击操作就能够轻松快速的从示波器数据文件中计算出PCI Express®(PCIe®)时钟抖动结果，从而极容易验证PCIe规范兼容性，且能减少系统开发时间。Silicon Labs的时钟抖动计算工具是当前业界首款可用于PCIe 1.0、2.0、3.0、4.0规范的标准抖动计算器，免费提供给致力于开发广受欢迎的PCIe架构应用的所有人员。该工具设计支持PCIe公共时钟和分离时钟架构，面向行业开放，并不仅
- 关键字： Silicon Labs PCIe
挑战铜线互连极限 PCIe 4.0还要等两年
- 开发PCI Express (PCIe) 4.0互连介面规格的工程师们，已经在实验室里将其传输速度推到了16 GT/s (GTransfers/second);但遗憾的是，此恐怕会是铜线互连规格最后一次大跃进的新规格，最终版本恐怕在2017年初之前难以出世。 负责开发最新PCI Express规格的PCI SIG预期，0.7版的PCIe 4.0可在今年底完成，但届时该技术并不会有太大的变化。而在PCIe 4.0正式公布之前，包括Cadence与Synopsys等厂商，都将于近日举行的年度PCI
- 关键字： PCIe
Silicon Labs推出新型PCI Express缓冲器简化数据中心时钟设计
- 为互联网基础设施提供高性能时钟解决方案的领导厂商SiliconLabs(芯科实验室有限公司)今天宣布推出PCIExpress(PCIe)Gen1/2/3扇出缓冲器，此产品为包括服务器、存储器和交换机在内的数据中心应用而设计。针对当今领先的x86主板和服务器系统，新型的Si5310x/11x/019 PCIe缓冲器是业内最高能效的扇出缓冲器，有效扩展了Silicon Labs不断壮大的PCIe计时产品线。凭借灵活的输出数量选项，新型的PCIe缓冲器能够完整满足98%的基于x86的服务器/存储器主板设计需
- 关键字： Silicon Labs 缓冲器 PCI Express
基于PEX8648交换芯片的数据处理模块设计
- 0 引言 PCI Express是第三代高性能IO总线，在总线结构上采取了根本性的变革，主要体现在两个方面：一是由并行总线转变为串行总线;二是采用点到点的互连。将原并行总线结构中桥下面挂连设备的一条总线变成一条链路，一条链路可包含一条或多条通路，每条通路由两对差分信号线组成双单工的串行传输通道，没有专用的数据、地址、控制和时钟线，总线上各种事务组成信息包来传送。点到点的互连方式使得每个设备由独立的链路连接，独享带宽，这是提高传输速率的有效解决方案。 随着数量不断增长的PCIe处理单元和外设
- 关键字： PCI Express PEX8648 PowerPC8640
如何优化PCIe 应用中的时钟分配
- PCI Express® (PCIe®) 是一项业界领先的标准输入/输出 (I/O) 技术，是服务器、个人电脑以及其它应用中最常用的 I/O 接口之一。该标准多年来不断发展，以适应更高的数据速率(见表 1)。第 3 代 PCIe 引入了全新的编码方案，其可在不增加数据速率一倍的情况下，将数据吞吐量提升一倍。PCI-SIG 近期宣布推出的第 4 代 PCIe 具有 16 G 每秒传输 (GT/s) 的比特率。第 4 代的规范预计将在 2014 或 2015 年发布。 表 1：各代
- 关键字： PCI Express 时钟 RefClk
一种基于PCI交换的数据处理模块设计
- 摘要：PCI Express突破传统总线，采用点到点的互连方式，每个设备都由独立的链路连接，独享带宽，提高传输速率。PCIE交换和桥接器提供协议转换能力为系统间的互连带来了便捷的解决方案，同时丰富了整个应用环境。本文基于PEX8648交换芯片设计实现了多PCIE设备互连的数据处理模块，对其硬件结构及软件配置方法进行了详细介绍。 0 引言 PCI Express是第三代高性能IO总线，在总线结构上采取了根本性的变革，主要体现在两个方面：一是由并行总线转变为串行总线;二是采用点到点的互连。将原
- 关键字： PCI Express PEX8648 数据处理模块
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