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Altera MAX10: 3-8译码器
- 在这个实验里我们将学习如何用Verilog来实现组合逻辑。====硬件说明====组合逻辑电路是数字电路的重要部分，电路的输出只与输入的当前状态相关的逻辑电路，常见的有选择器、比较器、译码器、编码器、编码转换等等。在本实验里以最常见的3-8译码器为例说明如何用Verilog实现。3-8译码器的真值表如下：从前面的实验可以知道，当FPGA输出信号到LED为高电平时LED熄灭，反之LED变亮。同时我们可以以开关的信号模拟3-8译码器的输入，这样控制开关我们就能控制特定的LED变亮。====Verilog代码=
- 关键字： 组合逻辑 FPGA Lattice Diamond Verilog
Lattice MXO2: 3-8译码器
- 在这个实验里我们将学习如何用Verilog来实现组合逻辑。硬件说明组合逻辑电路是数字电路的重要部分，电路的输出只与输入的当前状态相关的逻辑电路，常见的有选择器、比较器、译码器、编码器、编码转换等等。在本实验里以最常见的3-8译码器为例说明如何用Verilog实现。3-8译码器的真值表如下：从前面的实验可以知道，当FPGA输出信号到LED为高电平时LED熄灭，反之LED变亮。同时我们可以以开关的信号模拟3-8译码器的输入，这样控制开关我们就能控制特定的LED变亮。Verilog代码// *****
- 关键字： 组合逻辑 FPGA Lattice Diamond Verilog
Altera MAX10: 点亮RGB三色灯
- 在这个实验里我们将学习控制小脚丫STEP-MAX10上的RGB三色LED的显示，基本的原理和点亮LED是相似的。====硬件说明====STEP-MXO2 V2开发板上面有两个三色LED，我们也可以用按键或者开关控制三色LED的显示。这是开发板上的2个三色LED，采用的是共阳极的设计，RGB三种信号分别连接到FPGA的引脚，作为FPGA输出信号控制。当FPGA输出低电平时LED变亮，当FPGA输出高电平时LED熄灭，当两种或者三种颜色变亮时会混合出不同颜色，一共能产生8种颜色。====Verilog代码=
- 关键字： 三色RGBLED FPGA Lattice Diamond 小脚丫
Lattice MXO2: 点亮RGB三色灯
- 在这个实验里我们将学习控制小脚丫STEP-MXO2上的RGB三色LED的显示，基本的原理和点亮LED是相似的。硬件说明STEP-MXO2 V2开发板上面有两个三色LED，我们也可以用按键或者开关控制三色LED的显示。这是开发板上的2个三色LED，采用的是共阳极的设计，RGB三种信号分别连接到FPGA的引脚，作为FPGA输出信号控制。当FPGA输出低电平时LED变亮，当FPGA输出高电平时LED熄灭，当两种或者三种颜色变亮时会混合出不同颜色，一共能产生8种颜色。Verilog代码// ******
- 关键字： 三色RGBLED FPGA Lattice Diamond 小脚丫
Altera MAX10: 点亮LED灯
- 恭喜你拿到我们的小脚丫开发板，在这个系列教程里你将更深入学习FPGA的设计同时更深入了解我们的小脚丫。如果你还没有开始使用小脚丫，也可以从这里一步一步开始你的可编程逻辑学习。请先准备好软硬件文档，因为FPGA的设计是和硬件息息相关，会经常用到这些文档。你还必须先安装好Quartus Prime设计工具，这是用小脚丫STEP-MAX10必须用到的。 硬件说明STEP-MAX10开发板虽然很小巧，上面也集成了不少外设，在本实验里我们就看看如何用FPGA控制简单外设，如何用按键或者开关控制LED的亮和
- 关键字： LED FPGA Lattice Diamond 小脚丫
Lattice MXO2: 点亮LED灯
- 恭喜你拿到我们的小脚丫开发板，在这个系列教程里你将更深入学习FPGA的设计同时更深入了解我们的小脚丫。如果你还没有开始使用小脚丫，也可以从这里一步一步开始你的可编程逻辑学习。请先到云盘准备好软硬件文档，因为FPGA的设计是和硬件息息相关，会经常用到这些文档。你还必须先安装好Diamond设计工具，这是用小脚丫STEP-MXO2必须用到的。1. 硬件说明STEP-MXO2 V2开发板虽然很小巧，上面也集成了不少外设，在本实验里我们就看看如何用FPGA控制简单外设，如何用按键或者开关控制LED的亮和灭。这是开
- 关键字： LED FPGA Lattice Diamond 小脚丫
实验22 4位串行累加器
- 实验目的（1）熟悉和掌握FPGA开发流程和Lattice Diamond软件使用方法；（2）通过实验了解累加器的意义及原理方法（3）掌握使用Verilog HDL语言基于FPGA实现累加器的原理及实现方法实验任务设计一个4位串行累加器，电路原理框图如图所示，在开关K处设置串行输入数据，在CP端输入8个脉冲，将完成一次，两个四位串行数据的相加，结果存D-A中。实验原理根据上述电路框图，可以分割系统任务。累加器是一个具有特殊功能的二进制寄存器，可以存放计算产生的中间结果，省去了计算单元的读取操作，能加快计算单
- 关键字： 累加器 FPGA Lattice Diamond Verilog HDL
实验21：智力竞赛抢答器
- 实验目的（1）熟悉和掌握FPGA开发流程和Lattice Diamond软件使用方法；（2）通过实验理解和掌握抢答器原理；（3）学习用Verilog HDL描述方法描述抢答器。实验任务本实验的任务是设计一个智力竞赛抢答器，带复位和主持人控制功能。一共4组选手，用开关k1,k2,k3,k4表示主持人复位开始抢答，获得抢答的选手显示对应led，答题时间超过30秒报警每位选手初始分数5分（RESET复位），主持人控制加分减分按键，每次增加或减少1分（最多9分），答题选手分数显示在数码管实验原理根据抢答器的功能，
- 关键字： 抢答器 FPGA Lattice Diamond Verilog HDL
实验20：步进电机2
- 实验目的（1）熟悉和掌握FPGA开发流程和Lattice Diamond软件使用方法；（2）通过实验理解和掌握步进电机技术与实现方法；（3）学习用Verilog HDL行为描述方法描述步进电机。实验任务本实验的任务设计一个步进电机运行控制电路，A、B、C、D分别表示步进电机的四相绕组，步进电机按四相四拍的方式运行。如要求电机正传时，控制端T＝1，电机的四相绕组的通电顺序为AC—DA—BD—CB—AC……如要求电机反传时，控制端T＝0，电机的四相绕组的通电顺序为AC—CB—BD—DA—AC……。实验原理为了
- 关键字： 步进电机 FPGA Lattice Diamond Verilog HDL
FPGA 江湖，山雨欲来
- 前不久，英特尔通过官网宣布将负责开发英特尔的 Agilex、Stratix 和其他 FPGA 产品的可编程解决方案部门（PSG）剥离，作为独立业务运营，目标是在两到三年后 IPO 中出售部分业务。当英特尔正式宣布分拆 FPGA 业务时，FPGA 江湖的风又开始飞扬。FPGA 江湖之争FPGA 起源FPGA（现场可编程门阵列）是可重构的计算机芯片，可以通过编程实现任何数字硬件电路。FPGA 可以在制造后重新编程以模拟数字电路，非常适合在批量生产前制作新功能的原型，或者服务于对于定制芯片来说不经济的罕见用例。
- 关键字： FPGA
实验19：步进电机1
- 实验目的（1）熟悉和掌握FPGA开发流程和Lattice Diamond软件使用方法；（2）通过实验理解和掌握步进电机的原理和设计方法；（3）学习用Verilog HDL描述一个步进电机电路。实验任务本实验的任务是设计控制四相绕组的步进电机电机正转、反转、停止的控制电路。要求如下：电机运转规律为：正转30s→停10s→反转30s→停10s→正转30s……实验原理步进电机是将电脉冲信号转变为角位移或线位移的开环控制元步进电机件。当电流流过定子绕组时，定子绕组产生一矢量磁场。该磁场会带动转子旋转一角度，使得转
- 关键字： 步进电机 FPGA Lattice Diamond Verilog HDL
实验18：秒表计数器
- 实验目的（1）熟悉和掌握FPGA开发流程和Lattice Diamond软件使用方法；（2）通过实验理解和掌握计数器原理；（3）掌握用Verilog HDL数据流和行为级描述寄存器单元的方法。实验任务设计简单秒表(60进制），并要求带启动、复位、暂停功能。实验原理如下所示，秒表（60进制）即显示从00到59循环跳转计数。并且通过开关设置，达到复位至00，任意时刻暂停和启动的功能。我们通过将开发板的12M晶振分频（参考分频程序）出1Hz的计时频率，实现秒钟的效果。将clk_1s的上升沿作为触发信号计时。通过
- 关键字： 秒表计数器 FPGA Lattice Diamond Verilog HDL
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