摘要：通过模糊自整定PID控制器的设计，本文提出了一种基于VHDL描述、DSP Builder和Modelsim混合仿真、FPGA实现的智能控制器设计及测试新方法。首先，通过MATLAB仿真，得出智能控制器的结构和参数。然后，基于VHDL进行智能控制器的数字化实现及其开环测试。在此基础上，通过分析一般智能控制器的测试特点，采用DSP Builder构建闭环测试系统，Modelsim运行DSP Builder生成文件来验证QuartusII中所做VHDL设计的测试方法。实验表明，该测试方法能有效模拟控制器的
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嵌入式系统 单片机 FPGA 智能控制器 嵌入式
Altera公司日前宣布为EtherCAT技术协会的EtherCAT协议提供知识产权(IP)支持。此前IP是针对Cyclone® II器件，现在将针对Altera新的低成本、低功耗Cyclone III FPGA。
EtherCAT技术协会执行总监Martin Rostan说：“在竞争非常激烈的工厂自动化设备市场上，企业正在寻找能够迅速突出产品优势的新功能和特性。Cyclone III FPGA实现对EtherCAT的支持，使设计人员能够以高性价比方式，轻松加入实时以太网功能。”
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嵌入式系统 单片机 Altera FPGA Cyclone EtherCAT IP 嵌入式
引 言
随着计算机技术的发展和广泛应用，尤其是在工业控制领域的应用越来越广泛，计算机通信显的尤为重要。串行通信虽然使设备之间的连线大为减少，但随之带来串／并转换和位计数等问题，这使串行通信技术比并行通信技术更为复杂。串／并转换可用软件实现，也可用硬件实现。用软件实现串行传送大多采用循环移位指令将一个字节由高位到低位(或低位到高位)一位一位依次传送，这种方法虽然简单但速度慢，而且大量占用CPU的时间，影响系统的性能。更为方便的实现方法是用硬件，目前微处理器串行接口常用的LSI 芯片是UART(通用异
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嵌入式系统 单片机 FPGA UART 嵌入式
使用这些设计技巧和ISE功能分析工具来控制功耗
新一代 FPGA的速度变得越来越快，密度变得越来越高，逻辑资源也越来越多。那么如何才能确保功耗不随这些一起增加呢？很多设计抉择可以影响系统的功耗，这些抉择包括从显见的器件选择到细小的基于使用频率的状态机值的选择等。
为了更好地理解本文将要讨论的设计技巧为什么能够节省功耗，我们先对功耗做一个简单介绍。
功耗包含两个因素：动态功耗和静态功耗。动态功耗是指对器件内的容性负载充放电所需的功耗。它很大程度上取决于 频率、电压和负载
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嵌入式系统 单片机 FPGA 功耗 嵌入式
扩频通信自上世纪50年代中期被美国军方开始研究以来，一直为军事通信所独占，广泛应用于军事通信、电子对抗以及导航、测量等各个领域。进入上世纪90年代以后，扩频通信又开始向各种民用通信领域发展，典型的如CDMA和GPS等。应用最广的是直接序列扩频方式(DSSS)。它是将待传送的信息数据被伪随机码调制，实现频谱扩展后再传输，接收端则采用相同的编码进行解调及相关处理，恢复原始信息数据。
本文采用VHDL语言、Altera公司的集成开发环境QuartusII 6.0和Cyclone系列芯片EPlC3T14
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通讯 无线 网络 FPGA 无线 通信
引言
目前，用FPGA(现场可编程门阵列)实现FIR(有限冲击响应)滤波器的方法大多利用FPGA中LUT(查找表)的特点采用DA(分布式算法)或CSD码等方法，将乘加运算操作转化为位与、加减和移位操作。这些结构需要占用器件较多的LE(逻辑元件)资源，设计周期长，工作频率低，实时性差。本文提出一种基于Stratix系列FPGA器件的新的实时高速脉动FIR滤波器的快速实现方法。利 用FGPA集成的DSP(数字信号处理器)乘加模块定制卷积运算单元，利用VHDL(甚高速集成电路硬件描述语言)元件例化语句快
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嵌入式系统 单片机 FPGA 脉动FIR滤波器 嵌入式
现代化生产和科学研究对视频图像采集系统的要求日益提高。传统的图像采集卡速度慢、处理功能简单、采用分立元件、电路非常复杂；而且可靠性差、不易调试、不能很好地满足特殊要求。FPGA(现场可编程门阵列)是专用集成电路中集成度最高的一种，用户可对FPGA内部的逻辑模块和I／O模块重新配置，以实现用户所需逻辑功能。用户对FPGA的编程数据放入芯片，通过上电加载到FPGA中，对其进行初始化；也可在线对其编程，实现系统在线重构。基于FPGA技术的图像采集主要是通过集成的FPGA开发板，使用软件编程把图像的采集控制程
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嵌入式系统 单片机 FPGA 图像采集卡 嵌入式
在本文中，我将分析功耗降低所带来的好处。还将介绍 Virtex-5 器件中所使用的多种技术和结构上的革新，它们能提供功耗最低的解决方案，并且不会在性能上有任何折扣。
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Virtex FPGA 低功耗
根据软件无线电的思想，以FPGA器件为核心实现了OQPSK的解调，大部分功能由FPGA内部资源来实现。
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OQPSK FPGA 解调器
引言
分频器是FPGA设计中使用频率非常高的基本单元之一。尽管目前在大部分设计中还广泛使用集成锁相环(如altera的PLL，Xilinx的DLL)来进行时钟的分频、倍频以及相移设计，但是，对于时钟要求不太严格的设计，通过自主设计进行时钟分频的实现方法仍然非常流行。首先这种方法可以节省锁相环资源，再者，这种方式只消耗不多的逻辑单元就可以达到对时钟操作的目的。
1 整数分频器的设计
1.1 偶数倍分频
偶数分频器的实现非常简单，通过计数器计数就完全可以实现。如进行N倍偶数分频，就可以通过由待
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嵌入式系统 单片机 FPGA 嵌入式
本文介绍了一种实用的基于FPGA的以太网视频广播接收系统，由于采用了FPGA技术，使得系统结构简单，可靠性高。
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FPGA 以太网 视频广播 接收系统
赛灵思公司宣布低成本Spartan™-3AN入门套件开始提供。该套件是宽带接入、数字显示屏、机顶盒、数据采集和低功耗移动以及手持设备等需要更高系统集成度或安全性能的大批量非易失应用原型设计的理想选择。 “新一代Spartan-3系列产品为需要非易失性单芯片解决方案且对空间敏感的应用提供了最灵活、可靠和成本效益最高的解决方案。”赛灵思公司通用产品部市场和应用总监Harry Raftopoulos说，“
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嵌入式系统 单片机 赛灵思 Spartan™ -3AN 嵌入式
Xilinx, Inc. 宣布低成本Spartan™-3AN入门套件开始提供。该套件是宽带接入、数字显示屏、机顶盒、数据采集和低功耗移动以及手持设备等需要更高系统集成度或安全性能的大批量非易失应用原型设计的选择。 保证开箱即用（Out-of-the-box） 该入门套件配备了必要的硬件、软件工具、评估板、电源、参考设计和其它附件，因此用户可在数分钟内上手，真正保证了开箱即用的功能。SPARTAN-3AN器件采用了DeviceDN
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嵌入式系统 单片机 Xilinx SPARTAN-3AN 嵌入式
引 言
现代科技对系统的可靠性提出了更高的要求，而FPGA技术在电子系统中应用已经非常广泛，因此FPGA易测试性就变得很重要。要获得的FPGA内部信号十分有限、FPGA封装和印刷电路板(PCB)电气噪声，这一切使得设计调试和检验变成设计中最困难的一个流程。另一方面，当前几乎所有的像CPU、DSP、ASIC等高速芯片的总线，除了提供高速并行总线接口外，正迅速向高速串行接口的方向发展，FPGA也不例外。每一条物理链路的速度从600 Mbps到10 Gbps，高速I／O的测试和验证更成为传统专注于FPG
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嵌入式系统 单片机 测试 测量 FPGA 测试测量
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