赛灵思公司今天宣布为成本敏感型应用推出灵活的 I/O 密集型器件——Spartan®-7 FPGA系列。该新型系列器件可满足汽车、消费类电子、工业物联网、数据中心、有线/无线通信和便携式医疗解决方案等多种不同市场领域的连接需求。全新的 Spartan-7 FPGA 将得到免费 Vivado® 设计套件 WebPACK™ 版本以及 Vivado 设计版本和系统版本的支持，能够快速集成和实现。
Spartan-7 FPGA 系列采用小型封装却拥有高
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赛灵思 Spartan-7
面对清华紫光集团董事长赵伟国再次放话，将先把收购目光集中在美国半导体产业的说法，日前台系IC设计公司均表达不意外，毕竟台湾政府目前尚未通过相关法令限制，加上相关配套措施还需产官学界互相讨论，与其现在买市值不大的台湾IC设计公司，对清华紫光集团并无法产生立即性的帮助。
产业界人士指出，以清华紫光的大陆内需市场色彩，加上先前出手目标多锁定具备一定程度寡占特性的产业来看，全球三强鼎立的EDA市场、绘图芯片与FPGA产业，或许是清华紫光集团在谈判桌上的下一个目标。
确实从清华紫光收购动作一路多锁定
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紫光 FPGA
Altera公司(Nasdaq)公开业界第一款异构系统级封装(SiP，System-in-Package)器件，集成了来自SK Hynix的堆叠宽带存储器(HBM2)以及高性能Stratix® 10 FPGA和SoC。Stratix 10 DRAM SiP代表了新一类器件，其特殊的体系结构设计满足了高性能系统对存储器带宽最严格的要求。
数据中心、广播、固网和高性能计算等系统要处理的数据量不断攀升，需要的带宽非常高。相对于目前的分立DRAM解决方案，Stratix 10 DRAM SiP的
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Altera FPGA
Altera公司今天公开业界第一款异构系统级封装(SiP，System-in-Package)器件，集成了来自SK Hynix的堆叠宽带存储器(HBM2)以及高性能Stratix® 10 FPGA和SoC。Stratix 10 DRAM SiP代表了新一类器件，其特殊的体系结构设计满足了高性能系统对存储器带宽最严格的要求。
数据中心、广播、固网和高性能计算等系统要处理的数据量不断攀升，需要的带宽非常高。相对于目前的分立DRAM解决方案，Stratix 10 DRAM SiP的存储器带宽提
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Altera FPGA
以上为小梅哥为了对特权同学的串口收发模块进行测试所展开的部分工作，到这里，仿真测试所需要的准备工作我们就做好了，接下来将实际进行仿真，通过仿真来分析该模块的性能。 这里极力推荐大家使用modelsim进行仿真，因为quartusII自带的仿真工具灵活性和功能都赶modelsim相差甚远。Modelsim作为一款强大的仿真软件，在业界被广泛使用。同时，modelsim针对不同的EDA厂家，也推出了OEM版本，modelsim-altera就是为Altera公司开发的OEM版本，此版本针对Altera公
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FPGA 串口调试
大家好，这几天在各个论坛上，经常就有人在向我咨询基于FPGA的串口通信代码，大部分都是在网上下载一个现成的代码，但是在使用中就遇到了各种问题，于是就发到了论坛上来求助。在阅读了他们的代码之后，我发现几乎出自同一个版本(目前确定为特权同学的基于EPM240入门实验的代码)。他们在调试这个代码的时候，经常存在这样几个问题：1、部分人对该串口通讯模块完全不理解，对每句话，甚至每个模块的功能都不理解;2、部分人采用最原始的画波形的方式来对该模块进行仿真，结果无法得到仿真结果;3、部分人不会使用modelsim
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FPGA 串口调试
“数十个合作伙伴，数百家客户，数千计的工程师，这三股强大的力量构成了Altera SoC大的生态系统，也是Altera在SoC领域投入5年所获得的成就。”Altera公司嵌入式处理营销资深总监Chris Balough在一年一度的Altera SoC开发者大会上自豪地表示。
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Altera FPGA
Altera公司荣获分析公司Frost & Sullivan的全球FPGA技术创新领先奖，表彰Altera在技术特性和未来业务价值方面更胜一筹。该奖项彰显Altera在其Arria® 10 FPGA中实现IEEE 754单精度硬核浮点DSP (数字信号处理)模块——处理速率高达1.5 TFLOPS (每秒万亿次浮点运算)，进一步提高了数字系统设计的能效和生产效率。Altera的可编程器件帮助客户针对大数据和搜索应用、数据中心加速、军事通信和高性能计算等需要高精度
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Altera FPGA
快速傅里叶变换(FFT)是信号处理应用的基础。FPGA供应商一直以来提供了运行良好的FFT库，处理适配到FPGA片内存储器中的大量数据。但是，如果数据规模太大，应该如何应对? 为解决这一问题，FPGA设计人员现在必须要做出设计决定，这些决定互相纠缠在一起，例如，片内FFT内核的配置选择，其数量，它们怎样连接并访问外部存储器，多个内核之间的同步等。分析所有这类设计决定就是要能够很好的结合现有产品，在HDL中编程，这会非常耗时，而且带来了性能问题。采用OpenCL等高级编程语言，能够很快的完成系统设计分析。本
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FPGA 频域滤波器 OpenCL 201511
简介
JESD204是一种连接数据转换器(ADC和DAC)和逻辑器件的高速串行接口，该标准的 B 修订版支持高达 12.5 Gbps串行数据速率，并可确保 JESD204 链路具有可重复的确定性延迟。随着转换器的速度和分辨率不断提升，JESD204B接口在ADI高速转换器和集成RF收发器中也变得更为常见。此外，FPGA和ASIC中灵活的串行器/解串器(SERDES)设计正逐步取代连接转换器的传统并行LVDS/CMOS接口，并用来实现 JESD204B物理层。本文介绍如何快速在Xilinx®
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Xilinx FPGA
EEPW：我想了解一下Patrick Dorsey先生对英特尔收购了Altera的一些看法，其次就是Altera也是OpenPower的一个成员，因为加入了Intel之后，Altera这边会不会继续跟OpenPower合作。
Patrick Dorsey：就像您所说的，我们也是OpenPower机构的一个成员。关于我们的看法，我们FPGA会继续支持不同的架构，包括ARM架构，Power架构还有Intel自己的架构。
6月份我看我们的新闻发布宣布我们的OpenCL这个工具可以支持普通的架构，
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Altera FPGA
编者按：五年来，Xilinx正经历转型: 从FPGA供应商到可以支持系统和软件工程师的全可编程技术(All Programmable technology )公司，致力于未来五年内增长5倍的潜在用户，并为此推出了多处理器SoC和一系列软件定义的设计环境。近日该公司的战略规划师Steve Glaser来华，向我们解释了其构想。
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xilinx FPGA 全可编程 201510
新思科技(Synopsys, Inc.)日前宣布：推出全新HAPS®-80基于FPGA的原型系统，该系统为Synopsys的端到端原型解决方案的一部分。HAPS-80系统提供了高达100MHz的多FPGA性能，以及全新的专用高速时分复用(HSTDM)技术。HAPS-80采用Xilinx最新的Virtex UltraScale VU440 FPGA器件，每颗FPGA可容纳2600万个ASIC门，结合ProtoCompiler设计自动化和调试软件，可支持高达16亿个ASIC门的设计。HAPS硬件与
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Synopsys FPGA
Altera公司宣布，由Altera、西安电子科技大学、友晶科技主办，华为、英特尔、展讯通信赞助的第一届5G算法创新大赛公布进入复赛的团队名单。第一届5G算法创新大赛是业界首个面向未来无线通信技术的高校大赛，旨在促进创新。大赛共有184支队伍报名参赛，462名参赛学生，覆盖全国31个城市、76所高校，其中包括28所985高校和47所211高校。初赛角逐后进入复赛共49支队伍。由于初赛交付的高质量作品较多并不乏创新性，大赛组委会宣布在原定一、二、三等奖基础上，增设优秀奖——&ld
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5G FPGA
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