- 为了给实际应用中选择合适FIR滤波器的FPGA实现结构提供参考，首先从FIR数字滤波器的基本原理出发，分析了FIR滤波器的结构特点，然后分别介绍了基于FPGA的FIR滤波器的串行、并行、转置型、FFT型和分布式结构型的实现方法，对于各种实现的结构做了分析、比较以及优化处理，特别是对基于FFT的FIR滤波器与传统卷积结构进行了精确的数值计算比较，最后得出满足于低阶或高阶的各种FIR滤波器实现结构的适用范围及其优缺点，并针对实际工程应用提出了下一步需解决的问题。
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FPGA FIR 滤波器 实现方法
- 通过对现有编码算法的改进，提出一种新的编码算法，它降低功耗的方法是通过减少部分积的数量来实现的。因为乘法器的运算主要是部分积的相加，因此，减少部分积的数量可以降低乘法器中加法器的数量，从而实现功耗的减低。在部分积的累加过程中．又对用到的传统全加器和半加器进行了必要的改进，避免了CMOS输入信号不必要的翻转，从而降低了乘法器的动态功耗。通过在Altera公司的FPGA芯片EP2CTOF896C中进行功耗测试，给出了测试结果，并与现有的两种编码算法进行了比较。功耗分别降低3．5％和8．4％。
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FPGA 24位 低功耗 乘法器
- 本文介绍了一个基于FPGA 的高效率多时钟的虚拟直通路由器，通过优化中央仲裁器和交叉点矩阵，以争取较小面积和更高的性能。同时，扩展路由器运作在独立频率的多时钟NoC 架构中，并在一个3×3Mesh 的架构下实验，分析其性能特点，比较得出多时钟片上网络具有更高的性能。
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FPGA 多时钟 片上网络
- 针对使用硬件描述语言进行设计存在的问题，提出一种基于FPGA并采用DSP BuildIer作为设计工具的数字信号处理器设计方法。并按照Matlab／Simulink／DSP Builder／QuartusⅡ设计流程，设计了一个12阶FIR低通数字滤波器，通过Quaxtus时序仿真及嵌入式逻辑分析仪signalTapⅡ硬件测试对设计进行了验证。结果表明，所设计的FIR滤波器功能正确，性能良好。
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Builder FPGA DSP 数字信号处理器
- 本文提供的解决方案可防止FPGA设计被拷贝，即使配置比特流被捕获，也可以保证FPGA设计的安全性。通过在握手令牌由MAX II器件传送给FPGA之前，禁止用户设计功能来实现这种安全性。选用MAX II器件来产生握手令牌，这是因为该器件具有非易失性，关电时可保持配置数据。而且，对于这种应用，MAX II器件是最具成本效益的CPLD。本文还介绍了采用这种方案的一个参考设计。
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FPGA MAX 器件 方案
- 针对传统集成电路(ASIC)功能固定、升级困难等缺点，利用FPGA实现了扩频通信芯片STEL-2000A的核心功能。使用ISE提供的DDS IP核实现NCO模块，在下变频模块调用了硬核乘法器并引入CIC滤波器进行低通滤波，给出了DQPSK解调的原理和实现方法，推导出一种简便的引入π／4固定相移的实现方法。采用模块化的设计方法使用VHDL语言编写出源程序，在VIrtex-II Pro开发板上成功实现了整个系统。测试结果表明该系统正确实现了STEL-2000A的核心功能。
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STEL 2000 FPGA 扩频通信
- 波长信号的解调是实现光纤光栅传感网络的关键，基于现有的光纤光栅传感器解调方法，提出一种基于FPGA的双匹配光纤光栅解调方法，此系统是一种高速率、高精度、低成本的解调系统，并且通过引入双匹配光栅有效地克服了双值问题同时扩大了检测范围。分析了光纤光栅的测温原理并给出了该方案软硬件设计，综合考虑系统的解调精度和FPGA的处理速度给出了基于拉格朗日的曲线拟合算法。
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FPGA 光纤光栅 解调系统
- 为满足用户的多种设计需求，Altera公司 今天发布其28-nm器件系列产品，为业界提供最全面的器件选择。Altera在Cyclone V和Arria V FPGA新系列、最新扩展的Stratix V FPGA以及此前发布的HardCopy V ASIC系列中为用户提供突出不同产品优势的解决方案。
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Altera Stratix V FPGA
- 摘要：经典的码盘数字测速方法有M法、T法、M／T法，但都有一定的不足。为了克服原有方法的不足，设计并实现了一种在较大速度范围都有良好精度和良好快速性的测速方法。电路采用FPGA实现，测速得到的数据通过PCI总线从
- 关键字：
FPGA PCI 高精度 测速
- 采用FPGA的模拟动态滤波器，在结构上简易，性能上稳定，测试和设计都十分的方便。FPGA的使用，能根据具体要求很方便的改变控制信号，同时实现超声诊断仪中多个模块并行工作，也为以后的更多模拟部分数字化提供了基础。
- 关键字：
FPGA 超声诊断仪 动态 滤波器
- 本文分析了IL-E2型TDI-CCD 芯片的工作过程和对驱动信号的要求，在此基础上设计出合理的时序电路， 为了满足在实际工作中像移速度异速匹配的要求，在时序电路的设计中时序发生部分是可调的。这种设计方案简单、可靠、实用。
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FPGA CCD 相机 时序
- 基于FPGA+ DSP的实时图像处理系统设计与实现,摘 要: 针对图像处理系统计算量大、实时性高和体积小的要求， 研制了一种以DSP为主处理器FPGA 为辅处理器的高性能实时图像处理系统。利用这两种芯片的各自特点， 将算法分成两部分分别交由FPGA 和DSP处理， 大大提高
- 关键字：
FPGA，DSP
- 1 引 言
微型计算机原理几乎是所有理工科类大学生的必修课目之一， 其重要性不言而喻。然而大多数教学侧重于应用方面， 对计算机的结构及工作原理涉之不深， 因为无法做一个CPU 来演示。这样学生不能真正了解
- 关键字：
8085A FPGA CPU 结构分析
- 随着FPGA融入越来越多的能力，对有效调试工具的需求将变得至关重要。对内部可视能力的事前周密计划将能使研制组采用正确的调试战略，以更快完成他们的设计任务。
“我知道我的设计中存在一个问题，但我没有很
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FPGA 逻辑分析 电路 调试技术
- 全球电子设计创新领先企业Cadence设计系统公司,今天宣布在帮助ASIC与FPGA设计者们提高验证效率方面取得最新重大进展。加上对最新Accellera Universal Verification Methodology (UVM) 1.0业界标准的全面支持，600多种新功能扩展了指标驱动型验证(MDV)的范围，帮助工程师实现更快、更全面的验证闭合与硅实现。
- 关键字：
Cadence FPGA
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