基于FPGA+DSP的高速中频采样信号处理平台的实现,摘要：高速中频采样信号处理平台在实际应用中有很大的前景，提出采用FPGA+DSP的处理结构，结合高性能A／D和D／A处理芯片，设计了一个通用处理平台，并对其主要性能进行了测试。实验与实际应用表明，该系统具有很强的
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信号处理 平台 实现 采样 中频 FPGA DSP 高速 基于
本心率计在数字式心率计的基础上，采用FPGA和VHDL语言实现，减少了元器件使用数量，提高了测量精度和可靠性。该电路能够实时采集并测量人体心跳的瞬时和平均心跳速率，判断并显示心率状态（即心跳是否正常、是否过快或过慢、是否有心率不齐现象）。如果心率过快或过慢或者有心率不齐现象，那么将用不同颜色发光管进行闪烁报警显示。
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FPGA 数字式 电路 工作原理
摘要：飞行试验振动信号具有采样率高、数据量大、处理复杂的特点，在现有条件下，通过遥测链路很难将大量的振动数据实时传输至地面监控系统。针对试飞测试的需要，结合某型号的试飞关键技术攻关研究，突破试飞振动数
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POWER FPGA PC 架构
高性能模拟与混合信号IC领导厂商Silicon Laboratories (芯科实验室有限公司, Nasdaq: SLAB)今日宣布推出两类USB MCU系列产品，为业界提供了最快、最易用和经济的USB连接方案。新型C8051F38x和C8051T62x/32x USB MCU系列产品进一步扩展了Silicon Labs广受欢迎的USB MCU产品组合，适用于大范围应用。
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Silicon MCU USB
DDR SDRAM是Double Data Rate SDRAM的缩写，即双倍速率同步动态随机存储器。DDR内存是在SDRAM内存基础上发展而来的，能够在时钟的上升沿和下降沿各传输一次数据，可以在与SDRAM相同的总线时钟频率下达到更高的数据传输率。虽然DDR2和DDR一样,都采用相同采样方式进行数据传输，但DDR2拥有两倍于DDR的预读取系统命令数据的能力。
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Cyclone FPGA DDR2 III
英飞凌科技股份公司近日宣布，公司2011财年第二季度的营收和运营利润均超过先前预计水平。
英飞凌预计2011财年第二季度的营收将从第一季度的9.22亿欧元提高至9.94亿欧元，运营利润率达到20%。
在2011年2月1日公布的2011财年第二季度业绩展望中，英飞凌预计第二季度的营收略高于上一季度，运营利润率将达到18%至20%。
英飞凌预计，2011财年第三季度的营收和运营利润率将与第二季度基本持平。
英飞凌将于2011年5月3日公布2011财年第二季度的财务数据，届时公司将详
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英飞凌 MCU
本文结合MSP430系列微处理器，详细论述了通过控制改变MCU的时钟频率来降低功耗的设计方法。 1 功耗产生的原因 在CMOS电路中，功耗损失主要包括静态功耗损失和动态功耗损失两部分。其中静态功耗主要是由反偏PN结
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分析 时钟 动态 MCU 功耗
通常吸抽油烟机转速靠人工调节，因此为了达到最佳排油效果及节能目的，往往需要使用者多次人工干预。因此，为了使抽油烟机可实现自动调速、降低噪音、解放人力并最大限度地节能，瑞萨电子（本文涉及产品主要为瑞萨电
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抽油烟机 方案 变频 直流 MCU 8位
为了检测太阳能组件或组件阵列的各项性能参数，提出一种利用数控电阻测试光佚电池输出特性的方法。测试仪采用数控电阻器、高精度ADC和微控制器结合的方案，与传统的电子负载相比，具有便携、精度高、智能化和测量时间短等特点。利用制作的样机，在自然光照条件下进行了光伏电池测试实验，并在Matlab环境中对光伏电池模型进行了仿真验证。通过样机试验结果和仿真结果比较，结果表明测试仪具有较高的精度。
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MCU 光伏电池 试仪设计
引言 串行接口常用于芯片至芯片和电路板至电路板之间的数据传输。随着系统的带宽不断增加至多吉比特范围，并行接口已经被高速串行链接，或SERDES （串化器/ 解串器）所取代 。起初， SERDES是独立的ASSP或ASIC器
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SERDES FPGA 性能 接口
随着IT产业和通信技术、电子技术、计算机技术的高速发展，大量的生产装备和产品的电子化、数字化、自动化、智能化的程度越来越高，与之配套的电子测量设备必须适应这种形势。因此，综合测量技术、电子技术、自动化技
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系统 设计 诊断 测试 MCU 自动 基于
本设计使用硬件描述语言VHDL在FPGA数字逻辑层面上实现AES加解密，为了系统的扩展性和构建良好的人机交互，设计通过PS/2键盘输入加密密钥，并将其显示在LCD上。在软核MicroBlaze上，通过SPI总线读写FIFO和RAM控制射频芯片CC2420，使系统具有信道选择、地址识别、自动CRC校验功能，使系统更加安全、通信误码率更低。
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保密 通信 终端 无线 系统 Xilinx FPGA 基于
摘要 基于FPGA基本数据流的下载控制方式，利用遗传算法，通过单片机控制数据流的方式对FPGA进行编程配置，实现自身重构，使系统具有自适应、自组织和自修复的特性。
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FPGA 数据流 动态可重构
摘要 利用异步FIFO实现FPGA与DSP进行数据通信的方案。FPGA在写时钟的控制下将数据写入FIFO，再与DSP进行握手后，DSP通过EMIFA接口将数据读入。文中给出了异步FIFO的实现代码和FPGA与DSP的硬件连接电路。经验证，利用
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通信 运用 DSP FPGA FIFO 异步
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