- 采用FPGA进行低功耗设计并不是一件容易的事,尽管有许多方法可以降低功耗。FPGA的类型、IP核、系统设计、软件算法、功耗分析工具及个人设计方法都会对产品功耗产生影响。值得注意的是,如果使用不当,有些方法反而会增加功耗,因此必须根据实际情况选择适当的设计方法。
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功率估算 结构设计 FPGA
- 针对319卷积编码,提出一种Viterbi译码器的FPGA实现方案。该方案兼顾了资源消耗和译码效率,通过有效的时钟和存储介质复用,实现了高速并行的译码功能,并利用Verilog语言在Xilinx ISE 6.2中进行了建模仿真和综合实现。
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卷积编码 Viterbi译码器 FPGA
- 针对三维图像重建的经典算法(FDK算法)在FPGA上的加速,提出了并行无等待流水线的实现方法。实验结果表明,该方法获得了较高的加速比。
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三维图像重建 FDK算法 FPGA
- 提出了一种基于MAX-Log-MAP算法的更有效减小译码延时的方法,通过并行计算前向状态度量和后向状态度量,将半次迭代译码延时缩短一半,而译码性能没有损失,同时也减小了硬件实现中的时序控制复杂度。
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Turbo码 迭代译码 FPGA
- 介绍了一种基于NIOS Ⅱ实现数字信号解码器的方法,该系统由FPGA 和相应接口电路组成,将NIOS Ⅱ嵌入式软核CPU 集成到FPGA 中构成片上系统( SOC) ,可以将串行输入的不归零PCM 码转换为可分析的8 位并行码,并通过上位机软件显示解码结果。
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数字信号解码器 嵌入式软核CPU FPGA
- 提出了一种基于FPGA的数字选频器设计方案,该数字选频器应用于八通道的GSM系统直放站,采用低成本的FPGA芯片Xilink Spartan-3A DSP XC3SD3400A进行数字信号处理。给出了较详细的硬件设计方案,并通过Agilent Technologies N5230A网络分析仪对数字选频器进行了测量,被选出的有效相邻信道之间的最小间隔能达到1MHz,能够实现较好的选频功能,可满足实际应用的要求。
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数字选频器 MSP430 FPGA
- 给出了以FPGA为核心、针对自由立体显示器的立体视频格式转换系统的设计与实现方法。详细介绍了系统的硬件构成和FPGA逻辑设计,包括DVI控制、视频格式转换以及数据缓冲系统等。
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视频格式转换 数据缓冲系统 FPGA
- 在选取较优化的指纹识别预处理算法的基础上,根据算法的结构选取具有并行处理、低功耗、速度快等特点的FPGA作为实现算法的基本器件。由于用FPGA实现复杂算法较传统器件从思考角度和实现方向上都有很大区别,所以本次设计从新的方向来完成传统的指纹处理的设计。
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指纹识别 预处理 FPGA
- 用数字触发器的设计思想设计其硬件结构并对软件算法进行了改进。改进后的数字移相触发器简单可靠,产生脉冲的对称性好,抗干扰能力强,能够保证捕获到每一个换相区并及时触发。
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锁相环倍频 脉冲触发模块 FPGA
- 提出了一种采用现场可编程门阵列器件FPGA并利用窗函数法实现线性FIR数字滤波器硬件电路的方案,并以一个十六阶低通FIR数字滤波器电路的实现为例说明了利用Xilinx公司XC4000系列芯片的设计过程。设计的电路通过软件程序进行了验证和硬件仿真,结果表明电路工作正确可靠,能满足设计要求。
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FIR滤波器 窗函数 FPGA
- 本文利用FPGA资源丰富、易于编程的特点设计了纯硬方式的脉冲重复频率跟踪器,实现了在密集信号环境下的信号跟踪,并且将多路并行的跟踪器集成在一片FPGA中,简化了系统结构,缩小了体积。
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多路脉冲重复频率跟踪器 关联比较器 FPGA
- 采用自顶向下的模块化设计思想,介绍了一种采用级联结构在FPGA上实现IIR数字滤波器的设计方案。设计IIR数字滤波器的二阶节,将二阶节IIR数字滤波器级联实现高阶IIR数字滤波器,从而实现通过修改外围参数来改变滤波器的频率响应,根据不同的要求在不同规模的FPGA上加以实现。
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IIR数字滤波器 级联结构 FPGA
- 只要输入信号同时变化,(经过内部走线)组合逻辑必将产生毛刺。将它们的输出直接连接到时钟输入端、清零或置位端口的设计方法是错误的,这可能会导致严重的后果。 所以我们必须检查设计中所有时钟、清零和置位等对毛刺敏感的输入端口,确保输入不会含有任何毛刺。
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毛刺 置位信号 FPGA
- 介绍在QUATUSII环境下,采用FPGA可编程逻辑器件开发的电子密码锁,并利用状态机(FSM)实现键盘消抖及系统主控模块的行为控制,从实际工程设计角度阐述了系统所有模块及其工作原理、软件设计方法,提出了系统设计注意要点。
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QUATUSII 密码锁 FPGA 状态机
- FPGA能满足MP3整个系统的价格、功耗和性能要求,它们灵活的结构使系统设计人员能在每种MP3播放机中最佳地实现各种功能。
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MP3 逻辑模块 FPGA
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