- 日前，Mentor和华为共同宣布共同建立SOC软硬件协同验证环境。旨在加强SoC验证方面双方的全面合作。事先，华为已经利用Mentor公司提供的Seamless软硬件协同验证方案成功建立了ARM-based SoC验证环境。利用Seamless协同验证环境，华为已经成功调试，并解决了多款基于ARM7TDMI、 ARM926ejs、Power PC的SoC芯片软硬件接口问题。华为早在上个世纪90年代就认识到SoC的功能验证比传统的ASIC的功能验证更具有挑战性，需要付出更多的仿真努力，同时产品的开发周期也更
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Mentor Graphics SoC ASIC
- 美国Cadence设计系统公司公司（纽约证券交易所代码：CDN）董事会主席Ray Bingham先生一行，到北京集成电路设计园访问, 设计园公司总经理郝伟亚先生详细介绍了设计园以及北京集成电路设计产业发展情况。Ray Bingham先生表示，Cadence长期致力于中国电子产业的发展，支持北京集成电路产业的发展，对于作为中国7个国家IC设计基地之一的北京集成电路设计园，扩展其数字设计平台，选用Cadence SoC Encounter为实现很复杂、高性能的芯片提供经过验证的设计工具，应对纳米技术挑战，感
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Cadence SoC ASIC
- 美国Cygnal公司专门从事混合信号系统芯片(SoC)单片机的设计与制造。公司更新了原51单片机结构，设计了具有自主产权的CIP-51内核，运行速度高达每秒25MIPS。现已设计并为市场提供了29个品种的C8051F系列SoC单片机，预计今年年内还将完成20多个新的SoC单片机的设计。 C8051F系列是集成的混合信号系统芯片SoC单片机，具有与MCS-51内核及指令集完全兼容的微控制器，除了具有标准8051的数字外设部件之外，片内还集成了数据采集和控制系统中常用的模拟部件和其它数字外设及功能部件(参见图
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SoC ASIC
- 2004年，赛灵思成立20周年庆典。通过表彰员工、用户、股东、合作伙伴和当地社区，公司庆祝了它的20岁生日。
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赛灵思 FPGA
- 摘 要： 椭圆曲线加密是一种目前已知的所有公钥密码体制中能够提供最高比特强度的一种公钥体制。在FPGA实现椭圆曲线加密系统时，基于GF(2)的多项式有限域中的乘法、求逆运算是其中的两大难点。本文提供了一种椭圆曲线加密的FPGA实现的结构，着重讨论了基于GF(2)的多项式有限域中的乘法、求逆运算的实现，并与软件实现的性能进行了比较。关键词： FPGA；多项式有限域；椭圆曲线加密系统加密的安全性从数论的角度来说，任何公钥密码系统都建立在一个NP(无法处理的问题)的基础上，即对于特定的问题，没有办法找到一个
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FPGA 多项式有限域 椭圆曲线加密系统
- 概述在复杂SoC设计中，设计的可复用性是一种公认的能有效提升设计效率的方法。单纯地强调开发和集成硬件IP(intellectual property)模块还不够完全，人们应该继续提高IP的抽象层次——从简单的组件到完整的功能子系统，为SoC设计提供一个灵活而稳定的出发点。目前许多公司都进行基于平台的设计，希望借此来满足越来越紧迫的产品上市时间要求。然而，如果只是简单地把一个原来的设计转移到另一个产品设计中去会带来很多问题。假如这个设计没有考虑到设计的可复用性，并且缺乏足够的文档说明，那么改写该设计花费的时
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SoC
- 摘 要： 为了支持多媒体业务的传输，第三代移动通信WCDMA系统采用了独特的编码复接方案，同时也加大了系统复杂度，并引入了较长的处理时延。速率适配算法是业务复用方案的核心算法。本文具体提出了在FPGA中进行模块合并、产生凿孔图样进行比特积攒搬移的实现方案，缩短了处理延时，大大提高了系统的处理能力。关键词：编码复接；速率适配；FPGA；凿孔图样；保留比特搬移引言随着因特网爆炸性的增长以及各种无线业务需求的增加，传统的无线通信网已经越来越无法适应人们的需要。因此，以大容量、高数据率和承载多媒体业务为目的的
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FPGA 保留比特搬移 编码复接 速率适配 凿孔图样
- 平台FPGA的兴起随着Virtex系列在片上系统（SoC）应用中的广泛应用,赛灵思（Xilinx）公司引入了平台FPGA（Platform FPGA）的概念。作为领先的可编程逻辑供应商，赛灵思公司利用其基于Virtex的支持可编程逻辑、I/O和计算处理的多功能器件，帮助业界涉足并确立了基于FPGA的SoC设计方法。通过实现大量基于FPGA的RISC处理器和处理器内核，赛灵思在这方面已经证实了自己的实力。最早的例子是于1991年实现Philip Freidin的RISC4005/R16 FPGA处理器。Vi
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FPGA Xilinx
- 摘 要： 本文介绍了用FPGA实现的FIR算法，并对这种算法应用于汽车动态称重仪表中的结果做了分析。实践证明此算法用于动态称重具有良好的效果。关键词： FPGA；FIR；动态称重引言车辆在动态称重时，作用在平台上的力除真实轴重外，还有许多因素产生的干扰力，如：车速、车辆自身谐振、路面激励、轮胎驱动力等，给动态称重实现高精度测量造成很大困难。若在消除干扰的过程中采用模拟方法滤波，参数则不能过大，否则将产生过大的延迟导致不能实现实时处理，从而造成滤波后的信号仍然含有相当一部分的噪声。所以必须采用数字滤波消
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FIR FPGA 动态称重
- 日前(4月7日～8日)在甫结束的日本2004年英特尔IDF论坛中，英特尔首度展示了480Mbps的UWB无线传输，打破该公司在去年实现的252Mbps纪录。据日经BP社消息，英特尔是采用FPGA设计LSI收发器，这代表着可以使用CMOS技术，以低成本生无线USB收发器，无线传输技术是多频带OFDM（版本0.8），所用频率3GHz～5GHz，使用3个528MHz的频带
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英特尔 FPGA Wisair
- 半导体器件定标(scaling)在量上的不断进展蕴育着系统级芯片(SoC)器件在设计和结构上质的深刻变化。IC器件定标可以加强功率效率、增加带宽和显著改进功能集成性，而要挖掘出硅的全部性能潜力，还须在设计复杂性管理和改进设计可重用性方面做同样的努力。代表ITRS对半导体定标的一致观点的一个简易技术模型示出了芯片设计上一系列重大变化。较高层次的可编程性可以缓解经济上的压力。专用处理器性能的不断提高和器件的自动生成将使处理器芯核在SoC结构体系中发挥重大作用，诸如从高性能控制到以前只能由硬连接逻辑才可以实现的
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SoC SoC ASIC
- 摘要：本文在说明全数字锁相环的基础上，提出了一种利用FPGA设计一阶全数字锁相环的方法，并给出了关键部件的RTL可综合代码，并结合本设计的一些仿真波形详细描述了数字锁相环的工作过程，最后对一些有关的问题进行了讨论。关键词：全数字锁相环；DPLL；FSK；FPGA 引言锁相环(PLL)技术在众多领域得到了广泛的应用。如信号处理，调制解调，时钟同步，倍频，频率综合等都应用到了锁相环技术。传统的锁相环由模拟电路实现，而全数字锁相环(DPLL)与传统的模拟电路实现的PLL相比，具有精度高且不受温度和电压影响，环路
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DPLL FPGA FSK 全数字锁相环
- 赛普拉斯半导体(Cypress Semiconductor)公司的子公司赛普拉斯微系统有限公司（Cypress MicroSystems）于今日宣布推出用于其可编程系统级芯片（PSOCTM）混合信号阵列的PSoC Designer 4.0集成开发环境（IDE）。PSoC Designer 4.0是一个完整的图形成套工具，它通过提供“点击”系统设计能力而为用户利用PSoC的功能和灵活性给予了帮助。PSoC Designer 4.0提供了设备和应用程序编辑器以及一个简单图形用户接口（GUI）下的编译器、调试器
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赛普拉斯 SoC ASIC
- 来自美国加州弗雷蒙特市的消息--日月光测试有限公司（纳斯达克股票代码：ASTSF）业界最大的独立半导体测试服务供应商定购了22台科利登的SoC 测试系统，包括多台高性能的Octet，用于计算机芯片组和图形器件的高量产生产测试。日月光之所以选用该系统是基于其成熟的成本效益高的系统性能和测试能力，可以满足下一代器件技术，如高速总线系统，不断增长的对测试系统测试容量和范围的要求。日月光美国、欧洲兼日本区总裁Tien Wu说：“科利登的SoC测试系统提供给我们客户可持续的产品面市和成本优势。Octet与科利登Qu
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科利登 SoC ASIC
- 2003年，Wim Roelandts 成为董事会主席。Bernie Vonderschmitt 离职：公司的最后一个创始人为我们留下了宝贵的财富。
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赛灵思 FPGA
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