- 系统以FPGA为控制核心，由MOSFET管全桥逆变电路以及其IR2110对其驱动、SPWM（正弦脉宽调制）波的生成、电压电流的检测、相位频率跟踪等模块组成。其中SPWM波由在FPGA内部由软件产生的三角波的正弦波经数字比较器比较产生。通过改变正弦波的幅值来调节调制比，调节SPWM波的占空比，从而调节电压来达到功率最大。采用MPPT算法对系
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光伏并网发电 单相全桥逆变电路 FPGA IR2110 最大功率跟踪
- 项目主要的控制算法部分用硬件描述语言实现，并做成控制模块添加到FPGA系统中。在软件设计部分，采用μC/OS-II进行多任务调度来实现PC机的人机界面控制、本地调试和远程控制接口的通讯等。
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功率因数控制器 PWM FPGA 功率因数
- LED点阵显示屏是集微电子技术、计算机技术、信息处理技术于一体的大型显示屏系统。它以其色彩鲜艳，动态范围广，亮度高，寿命长，工作稳定可靠等优点而成为众多显示媒体以及户外作业显示的理想选择。目前，已经被广泛应用到军事、车站、宾馆、体育、新闻、金融、证券、广告以及交通运输等许多行业。
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LED点阵 控制系统 发光管 FPGA CPLD
- RFID(无线射频识别)技术，又称为电子标签或者无线标签识别，是一种利用无线射频通信实现的非接触式自动识别技术，被列为21世纪最有前途的重要产业和应用技术之一。
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RFID V2pro FPGA 射频设别技术
- 本项目主要研究基于MicoBlaze导航处理器的组合导航的作用原理及其实现。目前已经完成大部分软件程序的编制，现已完成外围电路模块的研制工作。
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导航 FPGA
- 我们采用数据融合与智能技术，对数据进行预处理，加以控制地进行数据的远程传输，采用高性能多核处理器，进行批量数据的分析和网络状况的终端显示。
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FIFO FPGA
- 通过对被测信号的实时采样，利用等效采样原理，可以将采样率为1MHz等效为200MHz，提高了被测信号的最高频率，具有成本低，性能可靠，便易升级的特点。
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采样 FPGA
- 开发一款通用性强的网络数据采集控制器，适合PC（windows与Unix、Linux系统）与片上系统之间的通信（片上运行软核或硬核嵌入式系统） ，提取的资源是本地控制器参数（如PID参数、射频信号幅度相位信息和误差因子等）。
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MicroBlaze 采集控制器 FPGA
- 传统智能小车，特别是嵌入式系统，一般都是基于单片机或者ARM的嵌入式系统，基本上都由软件系统和硬件系统组成的，硬件系统方面，跟传统的搭建硬件环境一样，只能做相对裁剪和功能拓展，但是，本项目的课题是通过xilinx的FPGA开发板搭建嵌入式的硬件环境，从最小系统到IP核的添加，都是根据需要进行拓展的，实现一对一的拓展，不浪费资源，而且基于F
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智能小车 Spartan-6 FPGA 电源稳压芯片 全桥驱动
- 本项目设计方案是基于FPGA的嵌入式安全保密模块ESMF (Embedded Security Module based on FPGA)，并通过高密计算返回安全认证码，通过安全认证码与密匙校验，为用户解决高密数据存储、身份认证等很多安全问题，这将为软件版权的保护提供有效的途径。
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嵌入式安全保密模块 软件版权保护 FPGA ESMF
- 据日经新闻报道，ARM知识产权产品集团总裁Rene Haas表示，ARM与中国成立合资企业旨在培育安全的芯片技术。
Rene Haas表示，合资公司的意图是为中国合作伙伴开发适合中国市场的产品，特别在西方公司可能无法做的技术领域。ARM将与中国合作伙伴在几个月内组建合资企业，帮助中国企业开发半导体技术，包括可能使用军事或监控的产品。
Rene Haas说，例如，如果企业正在为中国军队或监控领域开发一个芯片系统，鉴于中国安全要求必须非常高，政府只与具备这种安全资质的企业合作，有了合资企业，过
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ARM IP
- 作者 王莹 近日，Cadence发布了首款面向汽车、监控、无人机和移动市场的神经网络DSP IP，引起了业界的关注。 Cadence公司Tensilica事业部资深市场群总监Steve Roddy专程来到北京，向媒体介绍其特点。 在神经网络的器件方面，英伟达主宰了通用GPU。此次Cadence Tensilica发布的神经网络DSP IP则是面向嵌入式芯片。 通常其他友商的方案是面向一个卷积神经网络(CNN)层，而最新的Cadence Tensilica Vision C5 DSP由于可配置，可以面
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Cadence 神经网络DSP IP Steve Roddy 201706
- 针对无线电能传输频率跟踪设计中传统锁相环电路设计复杂、跟踪速度慢、锁相频带窄和无超前滞后环节，单独模块设计修改繁琐等问题,对自变模全数字锁相环进行改进, 与传统的全数字锁相环相比，该锁相环采用可变模分频器，使得中心频率可变，锁相范围增大;通过前馈回路进行鉴频调频，提高了锁相速度;同时，其环路滤波器采用比例积分结构，使得锁相输出无静差且比例积分参数依据相位差自动进行调节;通过参数设置可调节输出信号的相位。应用modelsim进行仿真，并进行实物验证证实了该设计具有宽范围的锁相能力及快速精确的频率跟踪性能。
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全数字锁相环 比例积分控制 FPGA 无线电能传输 201706
- 高性能系统设计师在满足关键时序余量的同时要力争获得更高性能，而存储器接口设计则是一项艰巨挑战。双倍数据速率SDRAM和4倍数据速率SDRAM都采用源同步接口来把数据和时钟(或选通脉冲)由发射器传送到接收器。接收器接口内部利用时钟来锁存数据，此举可消除接口控制问题(例如在存储器和FPGA间的信号传递时间)，但也为设计师带来了必须解决的新挑战。 关键问题之一就是如何满足各种读取数据捕捉需求以实现高速接口。随着数据有效窗越来越小，该问题也益发重要;同时，更具挑战性的问题是，如何让接收到的时钟与数据中心对准
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FPGA 存储器
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