- 0 引言
基于SoPC 技术开发的嵌入式Nios Ⅱ软核多处理器系统具有可自主设计，重构性好，软硬件裁剪容易，系统扩充升级方便，能兼顾性能、体积、功耗、成本、可靠性等方面的要求。研发嵌入式Nios Ⅱ软核多处理器系统，是提高嵌入式系统性价比和实用性一种有效途径。
1 片上Nios Ⅱ嵌入式软核多处理器系统
嵌入式系统的核心是RISC 处理器，具有代表性的RISC软核处理器是Nios Ⅱ处理器。软核处理器是指用编程的方法生成的处理器。是一种将硬件逻辑、智能算法、硬件描述语言和编程有机的
- 关键字：
FPGA Nios Ⅱ SoPC
- 致力于提供功耗、安全、可靠与高性能半导体技术方案的领先供应商美高森美公司(Microsemi Corporation) 宣布SmartFusion®2 SoC FPGA和 IGLOO®2 FPGA产品系列是唯一首先成功完成美国国家安全局(NSA)信息安全保障局(IAD)安全实施指南(SIG)文件的FPGA器件。
NSA IAD 设立这一过程，旨为提供与一套信息保障 (IA) 系统使用模型最具相关性的设计和数据安全特性概述，并包括了用于基于合适用户场景的安全条例指南。通过清楚的Sm
- 关键字：
美高森美 FPGA SoC
- TrendForce旗下内存储存事业处DRAMeXchange最新调查显示，由于智能手机、平板电脑等移动装置需求稳健增长，固态硬盘在笔记本电脑以及服务器与数据中心的需求增加，而物联网应用也将逐渐导入NANDFlash，2015年NANDFlash整体产业规模将提升至266亿美元，年增长9%。
DRAMeXchange研究协理杨文得表示，2014年NANDFlash需求位增长率为36%，在更多元化的产品开始导入NANDFlash的挹注下，2015年的需求位增长率将依旧有35%。市场趋势观察的重
- 关键字：
NAND Flash 穿戴性装置
- 致力于提供功耗、安全、可靠与高性能半导体技术方案的领先供应商美高森美公司(Microsemi Corporation) 宣布已从Rambus公司属下Cryptography Research获得其现有差分功率分析(Differential Power Analysis, DPA)专利许可的延期，这项专利许可延期可让美高森美继续使用Cryptography Research专利的突破性DPA对策产品组合，提供业界领先的第三方处理器和FPGA安全启动解决方案。
美高森美是目前拥有使用DPA对策专利许
- 关键字：
美高森美 差分功率分析 FPGA
- 摘要：本文在SIP立体封装技术的基础上，设计了基于DSP、FPGA的复合电子系统模块。重点介绍了模块的功能构成及模块接口应用，为基于SIP小型化封装的复合电子系统(功能可订制)提供应用基础。
引言
随着电子技术的发展对系统模块小型化高可靠性提出了更高的要求。复合电子系统模块是欧比特公司推出的一款SIP模块，其将特定(可定制)的电子系统功能模块采用立体封装技术制作而成。本文介绍了基于DSP、FPGA的复合电子系统模块OBT-MCES-01的功能构成以及应用方法。
1 SIP简介
- 关键字：
复合电子系统 DSP FPGA ADC DAC RS422 CAN 201409
- 摘要：介绍了一种使用Altera DE2开发板以及Qt技术实现的定时音频广播系统。该系统使用C/S架构，使用跨平台Qt技术在Ubuntu系统平台下建立起服务器程序，用于管理所有在线的DE2音频播放终端，使用Sqlite轻量级数据库进行数据存储。通过基于Nios II实现的软核进行外围设备的管理，并播放位于SD卡中的音频文件。
引言
随着数字和网络等技术的发展，广播技术已经呈现出越来越多元化的趋势，其最主要的趋势便是从模拟到数字的转化。从宏观来说，广播技术大体上可以分为三类：传统公共广播系统
- 关键字：
FPGA 扬声器 SD卡 UDP Qt 201409
- 摘要：目前的内窥镜发展趋势推进了数字成像方法的采用。不过，这需要多种数字处理器处理和分配图像数据。另外还出现了新的设计挑战，即如何将所有电子组件及有关电源稳压器放进与以前安装的内窥镜摄像机控制单元 (CCU) 大小相同的空间中，以最大限度地减小安装和采用成本。
1 内窥镜发展历史
大多数历史学家都认为，Bozzini 的 Lichleiter 是第一个与我们今天所知的内窥镜相似的设备。该设备于 19 世纪初发明，它很不灵活，用倾斜的镜子将图像投射到医生眼中，只用一根蜡烛照明，图像质量很差。
- 关键字：
稳压器 内窥镜 CMOS FPGA LTM4644 201409
- 摘要：本文以ARM7内核的MCU LPC2458在片外FLASH上运行程序时，采用SWI软中断的方法实现同时写片外FLASH的例子，详细讲述ARM7内核的MCU如何设计SWI软中断程序的流程、方法和应用原理。
1 背景描述
笔者在设计一项目时采用LPC2458。此CPU为ARM7内核，带512K字节的片内FLASH，98k字节的片内RAM，支持片外LOCAL BUS总线，可从片外NOR FLASH启动CPU。由于代码量较大，程序放在片外的NOR FLASH中。且存在片外NOR FLASH在
- 关键字：
ARM7 LPC2458 FLASH MCU SWI CPU 201409
- 摘要：针对室内环境质量与人们的健康和工作效率密切相关的情况，设计了一种多参数多采集点室内环境监测系统。系统硬件主要包括单片机系统、FPGA数据采集电路、传感器信号调理电路等。软件包括单片机硬件驱动程序、FPGA数字逻辑设计和基于VB的上位机应用程序。实验结果表明：系统工作稳定，误差在设计允许范围内。
引言
随着经济持续快速发展，人们的生活水平不断提高，对各种室内环境的要求也越来越高。传统的室内环境监测设备实时性差、精度低、体积大、功耗大，难以适应现代经济发展的要求。基于以上背景，本文设计了
- 关键字：
FPGA 单片机 监测系统 传感器 STC89C52 RAM 201409
- Altera公司今天发布Quartus® II软件Arria® 10版v14.0——业界最先进的20 nm FPGA和SoC设计环境。Altera成熟可靠的Quartus II软件编译时间是业界最短的，支持性能最高的20 nm FPGA和SoC设计。客户可以使用这一最新版软件所包含的全系列20 nm优化IP内核，进一步加速其Arria 10 FPGA和SoC设计。
Altera的20 nm设计工具提供业界最先进的算法，其结果质量最好。与最相近竞争20 nm
- 关键字：
Altera Quartus II FPGA
- 致力于提供功耗、安全、可靠与高性能半导体技术方案的领先供应商美高森美公司(Microsemi Corporation) 宣布推出最新11.4版本Libero系统级芯片(SoC)综合设计软件，用于开发美高森美最新一代FPGA产品。
美高森美新型Libero SoC v11.4用于获奖的SmartFusion2™ SoC FPGA和IGLOO2™ FPGA，改善设计流程运行时间多达35%。新产品还提供了更高的设计效率，具有改善的SmartDesign图形设计画布、改善的文本编
- 关键字：
美高森 Libero SoC FPGA
- 0 前言
随着计算机和半导体技术的发展，LED大屏幕显示系统成为集计算机控制、视频、光电子、微电子、通信、数字图像处理技术为一体的显示设备。目前LED大屏幕显示器向更高亮度、更高耐气候性、更高的发光均匀性、更大屏幕化、更高的可靠性方向发展。LED显示屏产业正成为我国电子信息产业的重要组成部分。大屏幕显示技术的发展进步，需要处理的数据量大大增加，系统的频率越来越高，系统的规模越来越大，对显示控制系统的要求不断提高。以往的LED大屏幕显示系统用中小规模集成电路实现，系统体积较大、调试困难、不易修改。
- 关键字：
ARM FPGA PLD
- 如果设计中有多个模块，每个模块内部有许多寄存器或者存储块需要配置或者提供读出那么实现方式有多种，主要如下：
实现方式一：可以在模块顶部将所有寄存器引出，提供统一的模块进行配置和读出。这种方式简单是简单，但是顶层连接工作量较大，并且如果配置个数较多，导致顶层中寄存器的数目也会较多。
实现方式二：通过总线进行连接，为每个模块分配一个地址范围。这样寄存器等扩展就可以在模块内部进行扩展，而不用再顶层进行过多的顶层互联。如下图所示：
那如果进行总线的选择，那么有一种
- 关键字：
FPGA AVALON-MM AVALON-ST
- 1、前言
分频器是FPGA设计中使用频率非常高的基本单元之一。尽管目前在大部分设计中还广泛使用集成锁相环(如Altera的PLL，Xilinx的DLL)来进行时钟的分频、倍频以及相移设计，但是，对于时钟要求不太严格的设计，通过自主设计进行时钟分频的实现方法仍然非常流行。首先这种方法可以节省锁相环资源，再者这种方式只消耗不多的逻辑单元就可以达到对时钟的操作目的。
2、整数倍分频器的设计
2.1 偶数倍分频
偶数倍分频器的实现非常简单，只需要一个计数器进行计数就能实现。如需要N分频
- 关键字：
FPGA 分频器 PLL
- 当你的FPGA设计不能满足时序要求时，原因也许并不明显。解决方案不仅仅依赖于使用FPGA的实现工具来优化设计从而满足时序要求，也需要设计者具有明确目标和诊断/隔离时序问题的能力。设计者现在有一些小技巧和帮助来设置时钟;使用像Synopsys Synplify Premier一样的工具正确地设置时序约束;然后调整参数使之满足赛灵思FPGA设计性能的目标。
会有来自不同角度的挑战，包括：
● 更好的设计计划，例如完整的和精确的时序约束和时钟规范
● 节约时间的设计技术，例如为更好的性能结
- 关键字：
FPGA Synplify 时序
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