- 近日,赛灵思公司在北京举办隆重的25周年庆典,并宣布推出全新一代旗舰产品系列——高性能VirtexⓇ -6和低成本SpartanⓇ -6 FPGA,同时提出了“目标设计平台”的新理念。
出席庆典和新闻发布会的有赛灵思公司产品营销高级总监Chuck Tralka,亚太区执行总裁/质量管理和
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赛灵思 Virtex FPGA
- 摘要:本文采用FPGA器件EP1C6T144C8芯片代替单片机控制A/D转换芯片ADC0809进行采样控制,整个设计用VHDL语言描述,在QuartusⅡ平台下进行软件编程实现正确的A/D转换的工作时序控制过程,并将采样数据从二进制转化成B
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FPGA 转换 采样 控制模块
- 1 引言 传统的波形发生器多采用模拟分立元件实现,产生的波形种类要受到电路硬件的限制,体积大,灵活性和稳定性也相对较差。采用FPGA器件直接实现多种波形信号发生器,配以相应的外围器件实现的波形发生器具
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Builder Matlab DSP 多波形
- 介绍了视频采集存储系统的硬件设计及主要模块的数据处理流程、系统测试结果。采集制式为PAL的视频信号,经过视频解码器TVP5150转换为数字视频数据,利用TMS320DM642和CPLD器件及与非门Flash等主要器件实现了集视频数据采集、以太网传输、存储、压缩于一体的视频处理系统,该系统可用于工业流程检测、智能交通、机器人巡逻等涉及运动图像处理的领域。
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DSP 视频采集 存储 系统设计
- 多DSP系统互连方案分析,在通信系统中,特别是在VoIP网关、3G无线基站等系统中,随着输入语音数据和分组数据量的急剧增加,系统的处理能力也需极大地增加。这需要一种功能强大的实时分布式处理系统,系统往往需要进行非常复杂的数据处理。目前使
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分析 方案 系统 DSP DSP 主机接口 周边器件 外部存储器接口 交换阵列
- 引言 微控制器在汽车和消费类市场上得到了广泛应用,能够以相对较低的成本实现系统高度集成。然而,这类产品也有潜在的成本问题。例如,如果元件功能不符合要求,就必须采用外部逻辑、软件或者其他集成器件
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FPGA 汽车 电子设计
- MAX153 和MX7545 是美国MAXIM 公司近几年推出的8位A/D转换器和12位D/A 转换器。MAX153具有高达1MSPS的采样率,MX7545具有4MSPS的数/模转换速度。它们集跟踪/保持器于一体,因而由它们构成的数据采集和波形产生电路结构
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设计 接口 D/A A/D TMS320C30 DSP A/D D/A 时序关系
- 介绍基于89S51单片机和FPGA的频率特性测试仪的设计。该系统设计利用DDS原理由FPGA经D/A转换产生扫频信号,再经待测网络实现峰值检测和相位检测,从而完成了待测网络幅频和相频特性曲线的测量和显示。经过调试,示波器显示待测网络频率范围100 Hz~100 kHz的幅频和相频特性曲线,该系统工作稳定,操作方便。
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tt 测试仪 频率 FPGA 单片机 基于 转换器
- 安富利公司 (NYSE: AVT) 旗下安富利电子元件部、The MathWorks、德州仪器(TI) 和赛灵思(Xilinx)宣布将举办为期2天的协处理SpeedWay设计研讨会(Co-Processing SpeedWay Design Workshop™)。研讨会将以最新推出的Spartan-3A DSP FPGA / DaVinci开发平台为基础,讲解如何“用基于模型化的设计方法,进行FP
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安富利 德州仪器 FPGA DSP
- 摘要: 本文阐述了通用异步发生器UART 的功能特点,介绍了用硬件描述语言Verilog 来开发各个模块,并给出仿真结果。本设计使用Altera 的FPGA 芯片,将UART 的核心功能嵌入到FPGA 内部,能够实现异步通信的功能,可以
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FPGA UART 电路设计
- 为保证线阵CCD在图像测量中正常、稳定工作,必须设计出适合其工作的时序驱动电路。在分析TCDl501D线阵CCD驱动时序关系的基础上,通过分析CCD输出的图像信号,给出了内、外相关双采样的时序控制。最后,利用quanus7.2软件平台结合VHDL语言进行开发,对所需驱动脉冲进行仿真设计。仿真结果表明,该驱动电路简单、功耗小、成本低、抗干扰能力强,适用于设备小型化的要求。
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FPGA CCD 线阵 驱动
- 简单介绍了全数字锁相环(ADPLL)的结构和工作原理,提出一种在FPGA的基础上可增大全数字锁相环同步范围的设计方法,并给出了部分verilog HDL设计程序的代码和仿真波形。
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FPGA 全数字 锁相环
- 设计了一套基于TMS320VC5416型DSP的实验系统,用于实现QPSK的调制。阐述了QPSK算法的基本原理和调制方式及实现QPSK调制硬件的设计方案,最后说明在该系统上现实QPSK的设计流程以及实验波形图。
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设计 实现 调制 QPSK DSP 基于 转换器
- RS码是线性分组码中一种典型的纠错码,既能纠正随机错误,也能纠正突发错误,在现代通信领域越来越受到重视。文中介绍基于FPGA使用Verilog―HDL语言的RS(15,9)编码器的设计方法,并在QuartusII 5.O软件环境下进行了功能仿真,仿真结果与理论分析相一致,该设计方法对实现任意长度的RS编码有重要参考价值。
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FPGA RS编码器
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