- 提出一种设计全数字锁相环的新方法，采用基于PI控制算法的环路滤波器，在分析模拟锁相环系统的数学模型的基础上，建立了带宽自适应全数字锁相环的数学模型。使用DSP Builder在Matlab／Simulink环境下搭建系统模型，并采用FPGA实现了硬件电路。软件仿真和硬件测试的结果证明了该设计的正确性和易实现性。该锁相环具有锁频速度快、频率跟踪范围宽的特点。同时，系统设计表明基于DSP Builder的设计方法可缩短设计周期，提高设计的灵活性。
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相环 设计 实现 数字 适应 DSP Builder 带宽 基于
- 基于中档FPGA多相滤波器的设计实现, 在现代电子系统中，到处都可以看到数字信号处理( DSP )的应用，从MP3播放器、数码相机到手机。DSP设计人员的工具箱的支柱之一是有限脉冲响应( FIR )滤波器。FIR滤波器越长(有大量的抽头)，滤波器的响应越好。然而这
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设计 实现 滤波器 多相 FPGA 基于
- FPGAs的DSP性能分析, FPGA在高性能数字信号处理领域越来越受关注，如无线基站。在这些应用中， FPGAs通常被用来和DSP处理器并行工作。有更多的选择当然是好的，但这也意味着系统设计师需要一个确切的FPGAs及高端DSP信号处理器性能参数图
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分析 性能 DSP FPGAs
- 日前，德州仪器 (TI) 宣布推出两款免费软件开发工具，帮助 ARM®、Linux™ 以及系统开发人员便捷地利用 TI 集成型浮点与定点 DSP + ARM 处理器旗下 TMS320C6000™ 数字信号处理器 (DSP) 的实时高密度信号处理功能。C6EZRun 与 C6EZAccel 软件开发工具可帮助 ARM 开发人员便捷地进行 DSP 编程，不但可简化和加速开发进程，而且还可缩短 DSP 的开发启动时间与产品的上市时间，并降低开发成本。
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德州仪器 ARM DSP
- 基于FPGA的PCIE总线扩展卡的设计, PCIE(PCI express)是用来互联诸如计算机和通信平台应用中外围设备的第三代高性能I/0总线。PCIE体系结构继承了第二代总线体系结构最有用的特点，采用与PCI相同的使用模型和读/写通信模型，支持各种常见的事务。其存
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扩展 设计 总线 PCIE FPGA 基于
- 可程序逻辑闸阵列芯片(FPGA)双雄赛灵思(Xilinx)与阿尔特拉 (Altera)先后推出28纳米FPGA产品，不仅使FPGA市场战火升温，也让晶圆代工市场激烈角逐，在Xilinx首度与台积电携手合作后，Altera在28纳米产品的布局上亦相当积极，近期亦展示在28纳米 FPGA平台上的25-Gbps收发器，FPGA双雄的激烈竞赛，预料台积电将成为最大受惠者。
Altera指出，在28纳米FPGA中展示25-Gbps收发器，是收发器产品的里程碑，该芯片是Altera用于在28纳米FPGA上，
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Xilinx FPGA 28纳米
- 无论为数以百万计的用户搜索请求提供服务还是处理超大量的信息，都需要数量庞大的计算资源，进而消耗大量能源。事实上，用于计算与冷却的能耗费用是数据中心运营的最大成本 [1]。随着数据中心的数量和规模不断增长，
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FPGA 绿色搜索技术
- 摘 要： 提出了一种将堆栈空间划分为任务栈和中断嵌套栈的设计结构，使堆栈空间最小化。采用VHDL硬件语言，在FPGA设备上模拟实现了具有自动检验功能的栈空间管理器。栈空间管理器由不同功能的逻辑模块组成，主要阐
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FPGA 栈空间 管理器
- 摘 要: 为满足三维大地电磁勘探技术对多个采集站的同步需求，基于FPGA设计了一种晶振频率校准系统。系统可以调节各采集站的恒温压控晶体振荡器同步于GPS，从而使晶振能够输出高准确度和稳定度的同步信号。系统中
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FPGA 恒温晶振 频率校准 系统
- 基于VHDL和FPGA的多种分频的实现方法,分频器是数字系统设计中的基本电路，根据不同设计的需要，我们会遇到偶数分频、奇数分频、半整数分频等，有时要求等占空比，有时要求非等占空比。在同一个设计中有时要求多种形式的分频。通常由计数器或计数器的级联
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实现 方法 多种 FPGA VHDL 基于
- 基于DSP芯片TMS320LF2407的人机界面设计, 笔者采用TMS320LF2407作为系统的控制芯片，通过选择合适的液晶显示模块在3V电平构建了一个低功耗的中文人机界面。此中文人机显示界面是以TMS320LF2407为核心的运动控制系统中的重要组成部分。 一、TMS320LF240
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DSP
- 基于System ACE的DSP文件系统设计,引 言 目前，对图像处理系统的速度和精度要求越来越高，采样的数据量也越来越大。而嵌入式系统中的硬件资源环境一般比较苛刻，嵌入式微处理器和微控制器的内存一般都不大。为了能够实现DSP(Digital Signal Proce
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DSP
- 摘 要:为了有效防止机械式键盘按键抖动带来的数据错误,这里在Quartus Ⅱ开发环境下,采用VHDL 语言设计了一种能够将机械式4 times;4 矩阵键盘的按键值依次显示到8 个7 段数码管上的矩阵键盘及显示电路。仿真结果表
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FPGA/ CPLD 键盘 电路
- 全球可编程逻辑解决方案领导厂商赛灵思公司，2010年9月14日宣布与四川虹视显示技术有限公司(简称四川虹视)在成都高新区共同成立FPGA联合实验室, 致力于推动虹视公司最新的OLED产品技术研发，赛灵思全球消费市场总监Harry Raftopoulos，高级技术市场经理酆毅，四川虹视总经理郎丰伟，技术总监文东星、产品研发中心部长田朝勇等出席了签字揭牌仪式。
根据双方当天签署的协议，赛灵思公司计划向四川虹视提供技术培训，以及多套开发工具，如Spartan®-6 消费视频开发套件，Spart
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赛灵思 FPGA
- FPGA全局时钟资源一般使用全铜层工艺实现，并设计了专用时钟缓冲与驱动结构，从而使全局时钟到达芯片内部的...
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FPGA 全局时钟 BUFG
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