- Xilinx公司基于ASMBLTM(Advanced Silicon Modular Block)架构最近推出第4代Virtex系列器件Vitex-4平台FPGA，成为具有成本优势的ASIC和ASSP替代解决方案。
Vitex-4平台FPGA
Vitex-4平台FPGA系列(Vitex-4 LX、SX、FX)提供不同的内核功能组合(见图1)。逻辑、存储器、并行和串行I/O、嵌入式处理器、高性能DSP、增强时钟管理、硬IP、混合信号以及其他功能模块的优化组合使Vitex-4系列可以完美地满足特定
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FPGA 嵌入式
- 摘 要：本设计的目的是实现博物馆藏品防盗和保护的智能化。以微处理器为核心，利用美国国家半导体的彩色图像传感器LM9628和温度传感器LM19进行环境监控，并控制报警系统和空调系统以及进行图像处理。关键词：图像传感器；温度传感器；AVR单片机；CPLD引言博物馆内的藏品常常受到人为盗窃的威胁，周围环境的变化也会对其造成破坏，因此需要极为可靠的防盗系统及完善的空调系统，本设计的目的就是实现对馆藏品的智能化防盗和保护。博物馆关闭时便可将此防盗保护器启动，通过CMOS传感器对博
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AVR单片机 CPLD 图像传感器 温度传感器
- 摘 要：本文介绍了一种基于嵌入式微控制器MSP430构建的嵌入式同步时钟系统的设计与实现方案，在实现了网络时钟同步的基础上又提供了方便易用的网络管理接口。关键词：同步时钟；MSP430单片机；数字锁相环；CPLD同步时钟系统是同步设备中实现同步通信的核心，因此，要实现数字同步网的设备同步就要求同步时钟系统一方面要能提供精确的定时同步，另一方面还要能方便实现网络管理中心对同步时钟的管理。本文详细介绍了利用嵌入式微控制器MSP430单片机和数字锁相环(DPLL)来实现嵌入式
- 关键字：
CPLD MSP430单片机 数字锁相环 同步时钟
- 摘 要：本文介绍了一种基于嵌入式微控制器MSP430构建的嵌入式同步时钟系统的设计与实现方案，在实现了网络时钟同步的基础上又提供了方便易用的网络管理接口。关键词：同步时钟；MSP430单片机；数字锁相环；CPLD同步时钟系统是同步设备中实现同步通信的核心，因此，要实现数字同步网的设备同步就要求同步时钟系统一方面要能提供精确的定时同步，另一方面还要能方便实现网络管理中心对同步时钟的管理。本文详细介绍了利用嵌入式微控制器MSP430单片机和数字锁相环(DPLL)来实现嵌入式
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CPLD MSP430单片机 数字锁相环 同步时钟
- 摘 要：本文提出了采用基于GPS的行驶里程数据采集和通过网络通信控制器WebChip进行网络化数据管理的智能里程表设计,并给出了具体设计方案。关键词：车辆管理；GPS；WebChip；CPLD引言在铁路列车车辆管理过程中，对列车每一节车厢行驶里程的统计，是对车厢进行管理和维护的一个重要依据。因此，获取精确的行驶里程对于铁路系统的高效、安全运营无疑是非常重要的。计算行驶里程的传统方法：一种是靠人工估计，费时费力且不够准确；另一种是通过计算列车车轮行驶的距离，这种方法操作复
- 关键字：
CPLD GPS WebChip 车辆管理
- 摘 要： 本文总结了使用LeonardoSpectrum综合Xilinx FPGA的VHDL程序应用，以及在VHDL中使用不同类型RAM的方法。关键词： LeonardoSpectrum；FPGA；VHDLLeonardoSpectrum 是Mentor Graphics公司设计的功能强大的EPLD/FPGA/ASIC综合工具，支持大部分EPLD/FPGA厂商的产品。LeonardoSpectrum支持VHDL、Verilog、EDIF的综合、优化和定时分析，可
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FPGA LeonardoSpectrum VHDL
- 摘 要： 本文在阐述某种近距雷达目标检测原理和FPGA技术发展状况的基础上，着重讨论用FPGA设计高性能的数字信号处理系统的方法，并给出一个应用实例。关键词： FPGA；近距雷达；目标检测；数字信号处理前言FPGA及其相关技术是当代微电子技术迅速发展的产物，目前已经成为开发复杂数字系统的主要方式之一。某近距雷达系统要求利用在与被探测目标的短暂交会过程中，对获得的多普勒信号进行频谱分析并完成动目标的识别检测。交会的短暂性对信号处理系统的实时性提出了严格的要求，在
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FPGA 近距雷达 目标检测 数字信号处理
- 摘 要： 本文采用Altera的CPLD实现了PCI总线至UTOPIA接口的逻辑转换控制，为低成本实现ATM终端奠定了基础。关键词： CPLD ; PCI总线 ; UTOPIA2总线引言 EDA技术凭借其高速、方便等特点而被广泛应用于通信领域。本文采用Altera的CPLD实现了PCI总线至UTOPIA接口的逻辑转换控制，该设计再配上ATM线路成帧部件即可成为基于个人电脑的ATM终端设备，从而改善因成本较高、市场需求不足等原因
- 关键字：
CPLD PCI总线 UTOPIA2总线
- 概述 电子系统设计正在发生着重要的转变。可编程逻辑器件使设计者可以开发具有千万门以上、频率超过300MHz以及嵌入式处理器的电路，能够集成完整的系统。这一技术进步通过提供ASIC领域之外的全面的方法，正在引起设计过程的转变。在迅速变化的可编程逻辑领域，EDA提供商面临的挑战是，如何提供与硅容量和复杂性同步的设计工具和方法。例如，ASIC领域用了15年来合并硅处理和基于可靠的功能性EDA软件的设计方法。这种ASIC技术曾经是工业领域的驱动力和发展方向。可以说ASIC处理造就了电子工业廉价的方案，导
- 关键字：
FPGA
- 电子设计应用2004年第10期摘 要：GPIB接口是测试仪器中常用的接口方式。通过将接口设计分解为同步状态机设计和寄存器读写电路设计，采用Verilog语言实现了满足IEEE488.1协议的IP Core设计。将此IP Core固化到FPGA芯片中即可实现GPIB各种接口功能。关键词：GPIB接口；状态机；FPGA引言在自动测试领域中，GPIB通用接口是测试仪器常用的接口方式，具有一定的优势。通过GPIB组建自动测试系统方便且费用低廉。而GPIB控制芯片是自动测试系统中
- 关键字：
FPGA GPIB接口 状态机
- 电子设计应用2004年第10期摘 要：本文主要介绍了基于FPGA技术实现与PC串行通信的过程，给出了各个模块的具体实现方法，分析了实现结果，验证了串行通信的正确性。关键词：串行通信；FPGA引言串行通信即串行数据传输，实现FPGA与PC的串行通信在实际中，特别是在FPGA的调试中有着很重要的应用。调试过程一般是先进行软件编程仿真，然后将程序下载到芯片中验证设计的正确性，目前还没有更好的工具可以在下载后实时地对FPGA的工作情况和数据进行分析。通过串行通信，可以向FPGA
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FPGA 串行通信
- 电子设计应用2004年第9期摘 要：本文从系统总线设计、用户自定义指令和FPGA协处理器的应用这三个方面详细介绍了如何应用SoPC设计思想和SoPC Builder工具来开发电子系统。通过应用SoPC Builder开发工具，设计者可以摆脱传统的、易于出错的软硬件设计细节，从而达到加快项目开发、缩短开发周期、节约开发成本的目的。关键词：SoPC；SoPC Builder；FPGA引言随着技术的进一步发展，SoC设计面临着一些诸如如何进行软硬件协同设计，如何缩短电子产品开
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FPGA SoPC SoPC Builder
- 2004年4月A版
摘 要：本文提出了一种基于FPGA的误码测试方案，并在FPGA上实现了其功能。该方案不仅纳入了“同步保护”的思想，同时对误码率量级的判断也提出了一种简化而又可行的方法。
关键词：误码测试；FPGA；m序列；同步
在数字通信系统中，为了检测系统的性能，通常使用误码分析仪对其误码性能进行测量。误码分析仪给工程实际应用带来了极大的便利，比如它有丰富的测试接口和测试内容，并能将结果直观、准确的显示出来。但是它的价格昂贵，并且通常需要另加外部辅助长线驱动电路才能与某些系统接
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FPGA 嵌入式
cpld／fpga介绍
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