- 嵌入式操作系统(Embedded Operation System，EOS)是指用于嵌入式系统的操作系统。嵌入式系统分为4层，硬件层、驱动层、操作系统层和应用层。嵌入式
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ARM 嵌入式操作系统
- 在现代电子测量、通讯系统以及生物医学等领域，经常涉及对宽带模拟信号进行数据采集和存储，以便计算机进一步进行数据处理。为了对高速模拟信号进行不
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计算机 FPGA
- 从最近一段时间工作和学习的成果中，我总结了如下几种进行时序约束的方法。按照从易到难的顺序排列如下： 1. 核心频率约束 这是最基本的，所以标号为0。 2. 核心频率约束+时序例外约束 时序例外约束包括FalsePath、MulticyclePath、MaxDelay、MinDelay。但这还不是最完整的时序约束。如果仅有这些约束的话，说明设计者的思路还局限在FPGA芯片内部。 3. 核心频率约束+时序例外约束+I/O约束 I/O约束包括引脚分配位置、空闲引脚驱动方式、外部走线延时(Inpu
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FPGA 时序约束
- 文章罗列了关于ARM的22个常用概念。包括一些使用注意事项，ARM启动代码设计，ARM处理器运行模式，ARM体系结构所支持的异常类型和一些基本操作方法等等
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ARM 启动代码 异常类型 操作方法
- 当5G时代来临时，你是否准备好将自己从摩尔定律的放缓中解放出来，并为消费者和企业提供所需的移动体验?
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Arm CPU，摩尔定律
- 引言生物芯片是20世纪末随ldquo;人类基因组计划rdquo;的研究和发展而产生的一项高新技术，是人们高效地大规模获取生物信息的有效手段。目前大部分生
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测量 FPGA
- 0 引言在高压变频器正常运行过程中，如果功率单元出现故障，一般的实现方法是将此故障功率单元旁通，同时让其它两相相应的功率单元也同时旁通，这样使
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控制 FPGA
- 1设计摘要目前，研究自然化的人机交互是当今计算机科学技术领域的主要研究热点之一，手势输入作为一种自然、丰富、直接的交互手段在人机交互技术中占有
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计算机 FPGA
- 首届Arm人工智能开发者全球峰会将于2018年9月14日在上海举办。此次开发者峰会由上海市徐汇区政府指导，Arm中国及Arm人工智能生态联盟AIEC联合主办，旨在通过汇聚Arm AI生态圈的主流框架(TensorFlow / Caffe / MxNet / Paddle / ArmNN / Tengine等)、芯片和算法领域的顶尖精英，与AI开发者就如何共同创新核心AI技术、建设开放AI生态、推动前端和边缘AI的普及和普惠进行现场互动和深度交流。 开发者是AI领域最重要的群体和最主要的推动力量。此次
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Arm 人工智能
- FPGA/EPLD的自上而下(Top-Down)设计方法：传统的设计手段是采用原理图输入的方式进行的，通过调用FPGA/EPLD厂商所提供的相应物理元件库，在电路原理图
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FPGA EPLD 自上而下
- 现代飞机座舱显示技术的发展日新月异，需要显示各种传感器信息的数据已经达到海量规模。飞行员在不同飞行时段获得的信息也越来越多，为了使飞行员能够
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视频 FPGA
- 深亚微米时代，传统材料、结构乃至工艺都在趋于极限状态，摩尔定律也已有些捉襟见肘。而步入深亚纳米时代，晶体管的尺寸就将接近单个原子，无法再往下
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FPGA CPU 嵌入式 并行处理
- 许多高速数据采集应用，如激光雷达或光纤测试等，都需要从嘈杂的环境中采集小的重复信号，因此对于数据采集系统的设计来说，最大的挑战就是如何最大限
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噪声 FPGA 信号平均
- 中国广州，2018年8月16日，国内领先的可编程逻辑器件供应商——广东高云半导体科技股份有限公司(如下简称“高云半导体”)，今日宣布发布基于高云半导体FPGA的RISC-V微处理器早期使用者计划，该计划是基于晨熙家族 GW2A 系列FPGA芯片的包括系统级参考设计的FPGA编程BIT文件、GW2A开发板等的完整解决方案，其中系统级参考设计包括RISC-V MCU内核、AHB & APB总线、存储器控制单元及若干外设。 RISC-V作为指令集体系结构(ISA)的开放规范，RISC-V ISA设
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高云 FPGA RISC-V
- ARM处理器在全球范围的流行，32位的RISC嵌入式处理器已经成为嵌入式应用和设计的主流。与国内大量应用的8位单片机相比，32位的嵌入式CPU有着非常大的优
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嵌入式 处理器 ARM CPU
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