全球领先的数字信号处理器(DSP)内核和平台解决方案授权厂商CEVA公司宣布推出世界上首个专为先进无线基础设施解决方案而设计的浮点矢量(vector floating-point) DSP内核——CEVA-XC4500 DSP。
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CEVA ARM 嵌入式 DSP
您是不是需要复杂可编程逻辑器件(CPLD)但又不愿放弃固件?或者说您希望最好在单个芯片中同时集成微控制器和CPLD?PSoC® 5LP是赛普拉斯半导体公司的最新片上可编程系统，当它用作CPU时，它就是一款32位的67 MHz ARM Cortex-M3处理器，而用作CPLD时，其可编程逻辑提供的基于LUT的FPGA门，相当于20,000多个门。
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ARM 嵌入式 FPGA PSoC UDB
搞嵌入式的工程师们往往把单片机、ARM、DSP、FPGA搞的得心应手，而一旦进行系统设计，到了给电源系统供电，虽然也能让其精心设计的程序运行起来，但对于新手来说，有时可能效率低下，往往还有供电电流不足或过大引起这样那样的问题，本文十大金律轻松搞定DCDC电源转换电路设计。
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DC/DC FPGA DSP 稳压器
模数转换器(ADC)、数模转换器(DAC)听的多了，时间数字转换器(TDC——Timer Digital Converter)是什么原理的器件?为什么是ARM CortexM3，而不是M0、M4? 还有，超声波水表这种创新产品形式是否到了大规模商用阶段呢?本文将介绍TDC-GP22在智能超声波水表中起到何种关键作用，ARM CortexM3 MCU如何在超低功耗突破方面再助一臂之力?
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世强 TDC-GP22 ARM MCU 超声波
Testbench，就是测试平台的意思，具体概念就多不介绍了，相信略懂FPGA的人都知道，编写Testbench的主要目的是为了对使用硬件描述语言(HDL)设计的电路进行仿真验证，测试设计电路的功能、部分性能是否与预期的目标相符。
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FPGA Quartus Testbench 开发板 异步复位
安谋国际(ARM)展现其进攻汽车及工业控制市场的雄心。ARM于23日正式发布专为嵌入式系统处理器所设计的ARMv8-R架构，并强调其即时运算的效能，主要锁定汽车及工业控制运用。
ARM行销总监RichardYork表示，ARMv8-R架构承袭32位元ARMv7-R架构的优点，且与ARMv8-A架构相容;前一代的ARMv8-A架构诉求的是高效能，而ARMv7-R架构则更加强调其即时运算处理的能力。不过，ARMv7-R架构目前仅支援32位元暂存器(Register)，暂时无法满足64位元嵌入式应
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ARM 架构
2013年10月22日，莱迪思半导体公司(NASDAQ: LSCC)宣布推出新的超低密度iCE40™ FPGA，提供世界上最灵活的单芯片传感器解决方案，使得新一代环境感知、超低功耗的移动设备成为现实。iCE40 FPGA系列新增加的器件使客户能够在一个更小的空间内集成更多的功能。
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莱迪思 FPGA 传感器
致力于提供帮助功率管理、安全、可靠与高性能半导体技术产品的领先供应商美高森美公司(Microsemi Corporation，纽约纳斯达克交易所代号：MSCC) 宣布提供低成本IGLOO®2 FPGA评测工具套件，为客户提供PCI® Express (PCIe)兼容外形尺寸评测平台。
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美高森美 FPGA 以太网
ARM周二发布了2013财年第三季度财报，净利润为4850万英镑(约合7830万美元)，营收为1.84亿英镑。
在截至9月30日的第三财季，ARM总营收为1.84亿英镑，与去年同期的1.446亿英镑相比增长27%。按美元计算，ARM第三财季营收为2.867亿美元，与去年同期的2.279亿美元相比增长26%。
其中，版税营收为1.371亿美元，同比增长13%，占公司总营收的48%。授权营收为1.231亿美元，同比增长48%，占公司总营收的43%。
开发系统营收为1210万美元，同比持平
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ARM 芯片
ARM周二发布了2013财年第三季度财报，净利润为4850万英镑(约合7830万美元)，营收为1.84亿英镑。
在截至9月30日的第三财季，ARM总营收为1.84亿英镑，与去年同期的1.446亿英镑相比增长27%。按美元计算，ARM第三财季营收为2.867亿美元，与去年同期的2.279亿美元相比增长26%。
其中，版税营收为1.371亿美元，同比增长13%，占公司总营收的48%。授权营收为1.231亿美元，同比增长48%，占公司总营收的43%。
开发系统营收为1210万美
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ARM 处理器
将虚拟仪器技术同FPGA技术结合，设计了一个频率可控的DDS任意波形信号发生器。在阐述直接数字频率合成技术的工作原理、电路构成的基础上，分别介绍了上位机虚拟仪器监控面板的功能和结构，以及实现DDS功能的下位机FPGA器件各模块化电路的作用。经过设计和电路测试，输出波形达到了技术要求，工作稳定可靠。
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信号发生器 设计 DDS 仪器 FPGA 虚拟 基于
为了满足载荷与卫星进行可靠通信的目的，设计并实现了基于FPGA和BU-65170协议芯片的1553B远程终端。自行设计了用于控制BU-65170的主控制状态机，采用16位零等待缓冲接口模式，使用单消息和双缓冲模式进行消息传输。创新性地引入RS 422总线与1553B总线进行通信，方便测试过程，结果直观可见。采用专用测试板卡Alta ECD54-1553对系统进行测试，获得预期的可靠结果。FPGA取代传统CPU来控制1553B通信并集成数据传输功能，采用Verilog HDL硬件描述语言有利于软件移植，缩短
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终端 设计 实现 远程 1553B FPGA BU-65170 基于
简要介绍了FIR数字滤波器的结构特点和基本原理，提出基于FPGA和DSP Builder的FIR数字滤波器的基本设计流程和实现方案。在Mat lab／Simulink环境下，采用DSP Builder模块搭建FIR模型，根据FDATool工具对FIR滤波器进行了设计，然后进行系统级仿真和ModelSim功能仿真，其仿真结果表明其数字滤波器的滤波效果良好。通过SignalCompiler把模型转换成VHDL语言加入到FPGA的硬件设计中，从QuartusⅡ软件中的虚拟逻辑分析工具SignalTapⅡ中得到数
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设计 实现 滤波器 数字 FPGA FIR 基于
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