- 全球可编程平台领导厂商赛灵思公司 (Xilinx, Inc.)近日宣布推出具有全新功能的 ISE 13.3 设计套件,可帮助 DSP 设计人员在面向无线、医疗、航空航天与军用、高性能计算和视频应用的设计中轻松实现具备比特精度的单精度、双精度、完全定制精度浮点数学运算。
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赛灵思 DSP ISE 13.3
- 摘要:介绍了一种采用DM642和CPLD相配合的扩展键盘方法。CPLD管理键盘电路中的芯片逻辑,DM642的外部中断监控按键的状态。简单阐述了键盘的分类,给出系统的硬件电路原理图,在CCS软件中调试程序方法。仿真结果表明,
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CPLD 642 DM 外部中断
- 电子产品世界,为电子工程师提供全面的电子产品信息和行业解决方案,是电子工程师的技术中心和交流中心,是电子产品的市场中心,EEPW 20年的品牌历史,是电子工程师的网络家园
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NFC 近距离无线通信 13.56MHz 非接触式
- PN512是高度集成的13.56MHz无接触通信收发器,支持四种不同的工作模式:读/写模式支持ISO/IEC14443A/MIFARE和FeliCa方案以及支持ISO/IEC14443B,卡运作模式支持14443A/MIFARE和FeliCa方案和支持NFCIP-1模式.本文介绍PN5
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通信 收发 技术 接触 13.56MHz PN512 设计 基于
- MFRC523是NXP公司的一个的高集成读/写器,用于13.56MHz频率的非接触式通信。MFRC523阅读器支持ISO/IEC 14443 A/MIFARE模式。MFRC523的内部发射器无需额外的激活电路就能够驱动读/写器天线和收发器,其中读/写器天线用
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通信 设计 方案 13.56MHz 读写 MFRC523 非接触式 基于
- 在没有使用专用的ASIC解调、解码的基础上,利用较简单的电路形式并结合软件解调的方法,提出一种适合ISO14443 TYPE B标准的非接触式IC卡的读写器接收通道的设计方法。
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模块 设计 接收 IC 非接触式 13.56MHz
- 基于0.13微米CMOS工艺下平台式FPGA中可重构RAM模块的一种设计方法,1. 引言
对于需要大的片上存储器的各种不同的应用,FPGA 需要提供可重构且可串联的存储器阵列。通过不同的配置选择,嵌入式存储器阵列可以被合并从而达到位宽或字深的扩展并且可以作为单端口,双端口
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RAM 重构 模块 设计 方法 FPGA 平台 0.13 微米 CMOS 工艺
- 近年来,软件无线电(Software Radio)的技术受到广泛的关注。理想的软件无线电台要求对天线接收的模拟信号经过放大后直接采样,但是由于通常射频频率(GHz频段)过高,技术上所限难以实现,而多采用中频采样的方法。而对
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Telescopic 0.13 CMOS 工艺
13-外部中断介绍
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