- 基于FPGA的HDB3编解码器设计,本方案设计模块可以作为IP(Intellectual Property)核，与嵌入式处理器及其他功能模块或IP芯核相结合在一片FPGA上构成片上可编程系统SOPC，使得所设计的系统在其规模、可靠性、体积、功耗、性能等方面实现最优化。
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设计 解码器 HDB3 FPGA 基于 编解码器
- 由于On2的VP7 专有压缩技术具有种种优势，因此获得了市场的广泛采纳。黄金帧、出色的实时质量和解码器的简易性，都让On2 VP7成为目前网络视频及未来可能应用的理想选择。
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实时 网络视频 高质量 实现 解码器 黄金 编解码器
- TMS320DM642在移动平台ATP技术中的应用,介绍了一种DSP数字处理器TMS320DM642在移动平台ATP技术中的应用。DSP处理CCD采集的图像信号，并将相应信息实时反馈给电机控制部分，立即作出相应调整从而控制(2CD运动，使光斑落在视场中心。移动平台ATP(信标光捕获跟踪瞄准)技术是实现空间激光通信的关键技术，在卫星和航空航天等大容量通信方面具有巨大应用前景。
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技术 应用 ATP 平台 移动 TMS320DM642 编解码器
- 确保 QoE：我们需要什么样的体验质量？哪些薄弱环节需要加强？如何提高体验质量？
高级体验质量将决定电信级互联网视频能否得到广泛推广。互联网视频的体验质量包罗万象，比如最后一英里的 IP 数据包交付保证解决
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技术 质量监控 体验 嵌入式 LSI 编解码器
- 2006年9月，国家广电总局颁布了我国地面数字电视国家标准，该标准是清华DMB-T方案和上海交大ADTB-T方案的融合体，前者采用单载波调制，后者采用多载波调制。本文介绍了单载波调制和多载波调制的工作原理，以及ADTB-T
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对比 分析 技术 标准 数字电视 我国 编解码器
- 利用多内核处理器的并行编程功能实现视频代码转换,视频代码转换是指从一种压缩视频格式转换为另一种压缩视频格式，通常先要把某种格式解码为原始视频帧，然后用新的格式重新编码。在许多应用中高效的代码转换至关重要。例如，为了支持视频点播数据流，视频数据要以某种主流格式存储起来以节省空间，但必须支持众多不同的观看设备和解码器。为了做到这一点，需要在数据发送前以实时或者快于实时的速度进行代码转换。在视频节目制作阶段进行视频编辑时，也必须对视频数据进行解码、修改和重新编码。在普通家庭，为了能在家用视频服务器上使用视频，视
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实现 视频 代码 转换 功能 编程 内核 处理器 并行 利用 编解码器
- 随着硅工艺在几何尺寸上的不断缩小，芯片的设计者事实上能将所有系统功能整合在单一芯片上。许多芯片制造商和设计者在面对客户对于多功能、低功耗、低成本及小型化的需求时，认为SoC的高集成度是解决问题的万能药方。不幸的是，设计的生产力跟不上摩尔定律的速度。
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MPEG-4/JPEG 解码 IP 验证 设计 SoC 平台 利用 编解码器
- 基于ARM926EJ-S的MPEG-4软解码器的优化与实现,MPEG-4视频压缩标准自问世以来受到人们的广泛关注。近几年，嵌入式应用中对MPEG-4播放器的实现已经成为众多厂家的研究热点。专用的MPEG-4播放芯片已经非常普遍，但是减少功耗和降低成本一直是商家追求的目标，因此，随着嵌入式的主流微处理器ARM的处理能力越来越强，用他来实现MPEG-4系统的软解码成为了众多嵌入式设计公司研究的重点内容。由于MPEG-4系统庞大且需要大量的数据处理，因此在ARM中实现MPEG-4软解码需要对其原算法进行充分的优
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优化 实现 解码器 MPEG-4 ARM926EJ-S 基于 编解码器
- 介绍了一种多制式语音编解码器,在单片TMS320VC5409上完成4路话音的全双工通信,并实现G.729a、CVSD、ADPCM算法之间的编码转换,给出了算法的软硬件实现、算法的运算量及所占用的硬件资源。
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DSP 实现 及其 编码 语音 制式 编解码器
- 网络电视也称为IPTV，是三网合一应用中向用户提供的语音（VoIP）和数据服务之外的第三种服务。现有IPTV用户中，约80%通过xDSL接入，因此ADSL2+是现阶段的首选IPTV操作平台。尽管VDSL2带宽更高，但ADSL2+却拥有覆盖范围更广、成本更低这两项明显的优势。可以预计，在未来数年里，这两项xDSL技术将继续被用于IPTV，并且相得益彰。由于xDSL采用常规的铜导线传输，而铜导线这种传输介质本身易受干扰，因此IPTV有时也会受到影响。现在，已有创新性技术能够实现无干扰的IPTV接收。
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电视 闪烁 接收 IPTV 通过 编解码器
- Cirrus Logic最近推出多款环绕声编解码器。该系列产品将帮助音视频接收器及车载音响系统制造商将多通道环绕声性能整合到自己的入门级和中档产品中。
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系统 设计 门槛 音频 降低 环绕 解码器 集成 编解码器
- 根据低码率实时应用领域的特点，设计了一种H．264视频编码系统。采用FPGA的NiosII CPU架构，自定义硬件模块实现H．264．实时压缩编码。实验验证表明，H．264编码器对CIF大小的图像实现了实时编码，能满足对低码率实时应用的编码要求。
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编解码器 H．264 NiosII CPU
编解码器介绍
编解码器（codec）指的是一个能够对一个信号或者一个数据流进行变换的设备或者程序。这里指的变换既包括将信号或者数据流进行编码（通常是为了传输、存储或者加密）或者提取得到一个编码流的操作，也包括为了观察或者处理从这个编码流中恢复适合观察或操作的形式的操作。编解码器经常用在视频会议和流媒体等应用中。
经过编码的音频或者视频原始码流经常被叫做“Essence”（有译作“本体”，“精”），以区别于 [
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