考虑冲击环境下定时器会遇到的问题,并分析了单一的晶体振荡器和谐振振荡器都不能很好地满足抗冲击性和高精度两方面要求,因此提出了一种基于FPGA设计的双振荡定时器。此定时器能有效地解决爆破作业中延时雷管起爆精度和抗冲击性能之间的矛盾。更主要的是CPLD的时序比集成芯片更加容易控制。在FPGA实现,该设计的定时精度达到纳秒级,很好地满足系统性能要求。本方法具有结构简单、成本低、可靠性高、精度高等优点。
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定时器 纳秒级 FPGA
一种独立式多分辨率VGA/DVI压缩存储系统，该系统支持VGA/DVI输入，同时支持SVGA、XGA、SXGA、UXGA、1080p等任意分辨率图像的连续压缩和存储。在100 MHz时钟频率下，系统可以对图像SXGA和UXGA实时压缩为(25帧/s)和(17帧/s)。实验表明，在不同码率下，系统的单帧图像压缩性能与JPEG2000标准近似，PSNR值优于JPEG标准。
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VGA/DVI压缩存储系统 图像压缩 FPGA
为了解决SAR匹配成像数据以及合成孔径雷达中频采样后高速海量数据的存储问题，介绍了一种基于FPGA控制的NAND Flash数据存储及回放系统设计方案。实验证明,该系统能以3 Gb/s码流实时存储数据具有强实时性，且性能稳定，有很好的工程使用价值。
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合成孔径雷达 海量数据存储 FPGA
在通信系统中应用广泛。由于RS码的译码复杂度高，数字运算量大，常见的硬件及软件译码方案大多不能满足高速率的传输需求，一般适用于10Mbps以下。本文提出的欧氏算法和频谱结构分析相结合的RS硬件解码方案，适用于FPGA单片实现，速率高、延迟小、通用性强、使用灵活。笔者在FPGA芯片上实现了GF（2 8）上符号速率为50Mbps的流式解码方案，最大延时为640ns，参数可以根据需要灵活设置。
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RS编译码 差错控制编码技术 FPGA
为了准确截获并识别目标信号，针对军事通信信号环境设计了一种MSK信号检测识别方法，并使用FPGA进行了设计实现。
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MSK信号检测 频谱利用率 FPGA
针对现有的动态背景提取运动目标物体算法复杂且难以在硬件上实现的问题，研究了改进型surendra背景更新算法原理的特点，提出了改进型surendra背景更新算法的硬件结构，并对硬件结构进行综合、仿真后，在FPGA芯片上实现。
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运动目标提取 surendra背景更新算法 FPGA
为实现智能车全景视觉系统的应用研究平台，设计了一种基于FPGA+双DSP的实时6通道数字图像采集与处理系统。该系统由两片FPGA与两个DSP组成。第一个FPGA进行多通道视觉图像采集的同步控制、逻辑处理，第二片FPGA辅助DSP进行海量图像数据的高速并行处理。
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全景视觉系统 FPGA+DSP 数字图像采集与处理系统
本文主要完成了嵌入式图像监控系统的设计，该系统克服了模拟图像监控技术具有的弊端，在普通家庭、临时性作业场所中具有很强的应用前景。这些领域一般对视频传输指标的要求不一定很高，但要求便于携带，同时功耗较小(例如临时性场合等)，具有体积小、功耗低、成本低、速度快、稳定性好等特点，可以有效地克服传统的基于计算机的监控系统的缺点。系统可做为一个智能部件“嵌入”到各种应用系统中，如将其配上网络接口接上计算机系统，即可构成一个监控网络系统，是一种相对独立的OEM部件。
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图像监控系统 NiosII FPGA
针对高速视觉测量系统数据处理速度快、数据处理量大的特点，将FPGA技术与DSP技术相结合，研究了一种基于FPGA和多DSP的多通道并行处理的高速视觉测量系统。详细介绍了FPGA技术与多DSP技术在数字图像处理过程中的不同应用、高速视觉测量系统的总体结构以及各部分的工作原理。
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高速视觉测量系统 DSP FPGA
提出一种实时数字化光纤传输系统，该系统分为发送端和接收端。发送端用A／D转换器将输入的模拟信号数字化，再用FPGA对数据进行处理，并通过光纤传输。同时，FPGA还控制A／D转换器的工作。接收端用串行收发器TLK1501对接收数据进行解码处理，还原有效信号。实验表明，该系统实时性好、信号传输误码率低、工作性能稳定、抗干扰性强，系统具有可行性和有效性。
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高速数字信号传输 宽带 FPGA
参照ISO/IEC 18000-6 Type B 协议设计了一款工作频率为915 MHz的射频读卡器，采用FPGA完成协议中规定的数字信号处理，C8051F020单片机作为主控器。利用Verilog HDL硬件描述语言，搭建FPGA内部各个小模块及系统的验证平台，选用Altera公司Cyclone系列的EP1C6Q240C8芯片为目标器件，使用Quartus II进行综合，并通过时序和功能验证。
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射频读卡器 数字信号处理 FPGA
近年来，ITS在城市交通管理方面得到了普遍应用，在缓解道路交通、防 范交通违章及事故发生等方面获得了良好的效果。本文针对ITS应用，特别是电子警察系统的应用，提出了车辆违章视频检测方案，以适应ITS的发展需求。
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车辆违章检测 电子警察 FPGA
雷达信号的检测多是在干扰背景下进行，如何从干扰中提取目标信号，不仅要求有一定的信噪比，而且必需有恒虚警处理设备。恒虚警处理是雷达信号处理的重要组成部分，慢门限恒虚警处理主要是针对接收机热噪声，文中介绍一种基于FPGA嵌入式设计的慢门限恒虚警处理电路，给出了仿真模型及仿真结果，并已将其用于某检测器中，取得了良好的经济效益。
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慢门限恒虚警处理电路 内部噪声 FPGA
介绍了Xilinx FPGA中DCM的结构和相关特性，提出了一种基于Xilinx FPGA的DCM动态重配置的原理方法，并给出了一个具体的实现系统。系统仅通过外部和Xilinx XC4VFX100相连的少数控制线，就可以在输入100 MHz时钟源的条件下，对DCM进行50～300 MHz范围内准确、快速地变频。本设计系统具有接口简单、实时性强、稳定性高等特点，目前已成功应用到某星载系统中。
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DCM配置 时钟源 FPGA
循环冗余码校验CRC（Cyclic Redundancy Check）广泛用于通讯领域和数据存储的数据检错。基于FPGA在通讯领域和数据存储的应用越来越广泛,CRC的编码解码模块已经是FPGA上的常用模块了。采用超前位计算实现CRC在FPGA上的并行运算,通过实际应用证明该算法能有效实现硬件的速度与资源合理平衡。
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数据检错 CRC FPGA
现场可编程门阵列(fpga)介绍
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