你了解ADC吗?模数转换器(ADC)不同类型数字输出深

　　何种接口"最佳"?

　　首先需要考虑的是数据的传输速度和传输距离。一般而言，当ADC的速度和分辨率提高时，制造商会按CMOS、LVDS、CML的顺序升级，从而尽可能精确、高效地将数据从ADC传输到接收器(通常是FPGA或ASIC)。采样速率低于150-200 MSPS且分辨率低于14位的ADC一般可以使用CMOS输出。但是，当一个封装内的ADC数量增加时，CMOS输出的数量也会增加，最终会需要一个采用更少输出数的更高效接口。例如，对于一个四通道14位ADC，光数据位就需要60个输出引脚。如果采用DDR(双倍数据速率)LVDS输出接口，同样的四通道ADC只需要32个输出引脚;JESD204 CML输出则只需要6个输出引脚。不仅引脚数量，数据速率和功耗要求也会成为问题。当CMOS接口的数据传输速率提高时，功耗随之增加，功耗限制最终会使数据速率达到一定的上限后就不能再提高。与此同时，噪声也会成为问题。与LVDS和CML所用的差分信号相比，CMOS等所用的单端信号更易受噪声和接地反弹影响。同样，随着速度和分辨率进一步提高，LVDS也会变得不堪使用。这时，使用CML驱动器更合乎道理，因为它能支持高得多的数据速率。由于能够支持更高的数据速率，所以数据可以实现串行化，从而减少所需的输出驱动器数量。

　　结束语

　　目前ADC采用的三类主要数字输出各有优劣。考虑采用CMOS、LVDS或CML输出驱动器的ADC时，必须注意这些优缺点。设计系统时，每类驱动器都有必须特别重视的品质和要求，以便确保接收器件(FPGA或ASIC等)能够正确捕捉到ADC数据。必须了解需要驱动的负载，使用适当的端接，针对ADC所用的不同类型数字输出采用适当的布局布线技术。随着ADC速度和分辨率的提高，相应的输出数据速率也会提高，通常会予以串行化以获得更高的吞吐速率。这种情况下，适当设计系统并采用最佳布局布线技术变得更加重要。