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智原科技 文章

智原系统单芯片ASIC设计接量连续三年倍数增长

  • ASIC设计服务暨IP研发销售厂商智原科技9月18日发布其系统单芯片(SoC)设计案数量已连续三年倍增,其中以28纳米与40纳米工艺为主;相较于先进工艺,这两个工艺的进入商业门坎较低,相对应的IP布局完整且低风险,为客户提供更具竞争力的SoC成本优势。
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智原荣获ISO9001 Plus品质知识典范奖,高经营品质打造设计服务

  •   ASIC 设计服务暨 IP 研发销售领导厂商-智原科技(Faraday Technology, TAIEX: 3035)于日前获颁 ISO9001 Plus 典范奖项。ISO9001:2015是ISO 15年来最大改版,能成为首批获得SGS专业验证的厂商,是对智原在品质承诺、经营与职能发展表现上的高度肯定和最具体验证。   智原科技成立于1993年,累积20余年在 IP (矽智财)与 ASIC 设计服务的丰富经验,不但自主产出了3,000多支的 IP,更有2,000多个专案的成功量产经验,客户遍及台
  • 关键字: ASIC  智原科技  

智原科技采用Cadence数字实现与验证解决方案

  • 全球电子设计创新领先企业Cadence设计系统公司(NASDAQ: CDNS)日前宣布,位于台湾新竹的智原科技 (Faraday Technology Corp.) 通过采用Cadence®完整的工具流程,已成功完成该公司最大型的SoC (系统单芯片) 项目开发,该项目是用于4G基站的3亿门芯片设计。
  • 关键字: Cadence  智原科技  SoC  

智原科技采用Cadence数字实现与验证解决方案

  •   全球电子设计创新领先企业Cadence设计系统公司布,位于台湾新竹的智原科技 (Faraday Technology Corp.) 通过采用Cadence?完整的工具流程,已成功完成该公司最大型的SoC (系统单芯片) 项目开发,该项目是用于4G基站的3亿门芯片设计。通过在其分层式 (hierarchical) 设计流程中部署Cadence Encounter? 数字设计工具,智原科技的设计团队在短短的七个月内,就完成了这个复杂SoC从输入数据到流片的工作。   通过采用Encounter?数字
  • 关键字: 智原科技  Cadence  
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智原科技介绍

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