业界越来越多地谈论 RISC-V 架构带来的好处，但它甚至是正确的起点吗？虽然它可能并不完美，但它可能会提供逐步前进所需的灵活性。计算机架构和软件追随了 80 年前开发的处理器的脚步。他们的目标是使用一种基础技术来解决顺序标量算术问题，只要它有足够的内存，就可以解决任何有限问题。芯片行业已经表明不愿意放弃这种方法，尤其是在仍在运行 50 年前开发的软件的行业。软件范式和向后兼容性具有巨大的影响。编程以任何有意义的方式从单处理器迁移到多处理器架构花了几十年的时间，直到 NVIDIA 开发了 CUDA，针对大
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RISC-V
德国RISC-V 处理器开发商Codasip的董事会将要出售公司。该公司在首席执行官 Ron Black 的领导下，希望在未来三个月内出售该公司。它开发了使用开放式 RISC-V 指令集生产处理器内核的工具，并获得了高达 380m 欧元的资金，其中包括各种股权和赠款，其中包括后续项目资金。目前有 250 名员工，其中 57% 从事硬件工作，30% 从事软件工作。近年来，RISC-V 开发一直在努力，市场竞争更加激烈。Synopsys 去年推出了全系列 RISC-V 内核 IP，而主要芯片制造商的
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RISC-V 处理器 Codasip
作为全球三大RISC-V峰会之一，备受瞩目的第五届RISC-V中国峰会将于7月16日至19日在上海张江科学会堂隆重举行。本届峰会由上海开放处理器产业创新中心（SOPIC）主办，上海国有资本投资有限公司、上海张江高科技园区开发股份有限公司、RISC-V国际开源实验室和中电标协RISC-V工委会联合主办，中国RISC-V产业联盟（CRVIC）、中国开放指令生态（RISC-V）联盟（CRVA）、RISC-V中国社区（CNRV）等多方协办，将汇聚全球顶尖企业和专家，共同探讨RISC-V技术的前沿发展与产业应用。峰
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RISC-V RISC-V中国峰会
RISC-V 或许并非许多应用的完美解决方案，但它或许能提供一条演进路径。
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RISC-V
全球领先的嵌入式软件解决方案供应商IAR正式发布其旗舰产品的重大更新版本：Arm开发工具链v9.70和RISC-V开发工具链v3.40，大幅提升了IAR开发平台在性能、安全性和自动化方面的能力，助力汽车、工业、医疗和物联网等行业中的敏捷、可扩展嵌入式应用。为应对嵌入式系统日益增长的复杂性，全新的IAR开发工具链支持云端许可、CI/CD管道集成和多种架构的开发。随着Arm和RISC-V持续推动技术演进，IAR推出统一的开发平台，提供高质量且具安全保障的开发体验。新版本帮助客户提升研发效率、降低研发成本、缩短
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IAR RISC-V
英国芯片设计公司 Aion Silicon（前身为 Sondrel）赢得了一个 $12m 的项目，用于开发用于高性能计算 （HPC） 和人工智能 （AI） 应用的 RISC-V 加速器。该项目涵盖了从完整的 RTL 架构和验证到可测试设计、物理实现和使用 RISC-V 开放指令集架构 （ISA） 和矢量扩展在前沿节点上流片的所有设计工作，以加速 AI 工作负载。Aion 已经从设计服务（例如最近的视频芯片 ASIC 合同）转变为提供全方位服务的芯片供应，包括与代工厂合作。它之前曾为“全球 HPC 竞赛需要
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Aion Silicon RISC-V AI芯片
提到服务器 CPU 芯片，X86 和 ARM 架构是大众认知中的「常客」。而最近，随着一系列热点事件的发布，基于 RISC-V 架构的服务器 CPU 迅速 「破圈」，闯入大众视野。RISC-V 服务器 CPU，纷纷亮相RISC-V 架构有着开源、指令精简和可扩展的优势，在注重能效比的物联网领域收获颇丰。不过，这并不意味着 RISC-V 无法进军有更高性能要求的 PC 和服务器市场。如今，已有多家公司的 RISC-V 架构服务器 CPU 芯片亮相。玄铁C930阿里巴巴达摩院旗下品牌玄铁，
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RISC-V 服务器CPU
芬兰的 Flow Computing 已开始对其并行处理单元 （PPU） AI 模块的 RISC-V 编译器进行 alpha 测试。PPU 能够通过使用编译器使源代码利用该架构，将任何 CPU 架构增加多达 100 倍。第一次目标编译表明，通过重新编译现有代码，可以显著减少 RISC-V CPU 模型中常见的循环，达到 100 倍的预期性能。相比之下，只需将一些 CPU 内核替换为 PPU，即可在不更改源代码的情况下进行 2 倍的改进，而无需重新编译。编译器识别现有源代码中可由 PPU 有效加速的并行元素
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并行AI RISC-V 编译器 Alpha测试
西班牙的 SemiDynamics 开发了一种完全可编程的神经处理单元 （NPU） IP，它结合了 CPU、向量和张量处理，可为大型语言模型和 AI 推荐系统提供高达 256 TOPS 的吞吐量。Cervell NPU 基于 RISC-V 开放指令集架构，可从 8 个内核扩展到 64 个内核。这使设计人员能够根据应用的要求调整性能，从紧凑型边缘部署中 1GHz 的 8 TOPS INT8 到数据中心芯片中高端 AI 推理中的 256 TOPS INT4。这是继 12 月推出的一体化架构之后发布的，本白皮书
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SemiDynamics RISC-V NPU
4月15~17日，沁恒多维度、多层次的USB/Type-C/蓝牙/以太网接口芯片和青稞RISC-V系列MCU/SoC亮相2025上海慕尼黑电子展，现场人气火爆。RISC-V全家桶、Type-C全家桶等特色版块，工业控制、物联网、计算机手机周边等场景专题，9大版面充分诠释了沁恒对专业RISC-V玩家的定义：技术上一捅到底、产品上百花齐放，应用上互连互通。一捅到底的技术处理器“核”技术是数据处理的关键，接口底层PHY“根”技术是信息交换的窗口。秉承由核到芯、由内而外的全栈自研模式，沁恒青稞RISC-V贯穿了内
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RISC-V 沁恒 上海慕展
全球半导体产业竞争日趋激烈，RISC-V（第五代精简指令集计算机）凭借开源等优势有望改写芯片市场竞争格局。随着国际形势不断复杂化，RISC-V为中国在处理器设计领域实现自主可控提供了一条加速路径。近年，在政策支持、产业投资以及RISC-V架构自身优势的共同推动下，中国已成为全球RISC-V开发和应用的主要中心，国内RISC-V芯片正加速突围崛起。RISC-V快速崛起，生态链蓬勃发展RISC-V诞生于2010年左右加州大学伯克利分校的一项学术研究，其初衷是创建一种现代、简洁、可扩展且不受现有架构（如ARM、
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芯片规则 RISC-V
上个月，一个 Google 安全研究人员团队发布了一个工具，该工具可以修改基于 Zen 微架构的 AMD 处理器的微码，即 Zentool。虽然这是一个安全漏洞，但对某些人来说，这是一个机会:来自中国某项目组的成员正在举办一项竞赛，旨在为 AMD 基于 Zen 的现代 CPU 开发微码，使其能够本地执行 RISC-V 程序。最终目标可能是使用现有的芯片构建终极 RISC-V CPU。x86 是大约 48 年前开发的复杂指令集计算机 （CISC） 指令集架构 （ISA）。但是，
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AMD Zen处理器 RISC-V 代码
2025年4月9日——中国数字EDA龙头企业上海合见工业软件集团有限公司（简称“合见工软”）与北京开源芯片研究院（简称"开芯院"）宣布双方就“香山”高性能开源RISC-V处理器项目深化技术合作的又一重要成果，依托合见工软自主研发的全场景验证硬件系统UniVista Unified Verification Hardware System（UVHS），双方成功实现“香山”第三代昆明湖架构RISC-V处理器在16核大系统的软硬件协同实测验证。此次技术突破显著提升了处理器的开发验证效率，为后
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合见工软 开芯院 RISC-V
对于使用基于 RISC-V 的平台的开发人员，该架构提供了独特的功能，可帮助实现功能安全和信息安全目标。例如，从开放式架构到丰富的工具生态系统，安全关键型软件团队看到了满足 DO-178C 和 ISO 26262 准则的好处，以及减少合规工作的机会。了解如何将 RISC-V 的模块化、简单性和可扩展性与行业标准对应起来可能很困难。本文介绍了开发人员可以利用 RISC-V 实现认证安全关键型系统的合规性的七种方式。降低系统复杂性RISC-V 的开放标准指令集架构 （ISA） 与专有架构相
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安全关键系统认证 RISC-V
国芯科技(688262.SH)公告称，公司基于RISC-V架构多核CPU自主研发的超高性能云安全芯片CCP917T新产品于近日在公司内部测试中获得成功。国芯科技本次内测成功的超高性能云安全芯片CCP917T，拥有超高的算法性能和接口带宽，为云安全应用场景下的数据处理提供高带宽、低延迟、快响应支撑。可以广泛应用于信息安全各个领域：● 需处理大规模加密数据流、虚拟化资源动态分配，以及存储加密服务的云计算● 超低时延、海量连接场景需高效密码运算的5G网络● 需处理高并发交易、
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国芯科技 RISC-V 云安全芯片
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