Analog Devices, Inc.(NASDAQ：ADI)与Xilinx® Inc.和MathWorks Inc.将合作举办一系列面向模拟、混合信号和嵌入式系统工程师的设计会议。会议的主题是“Discuss. Design. Deliver.”，高性能模拟、现场可编程门阵列(FPGA)方面的专家将齐聚一堂，并结合建模工具展示完整的信号链和可供系统立即使用的解决方案，以应对复杂的设计挑战。
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ADI Xilinx 混合信号
随着现代通信技术的迅速发展，信号的调制方式向多样化发展，解渊技术也随之不断向前发展。为了对高速大带宽的信号进行实时解调，现在很多的解调关键算法都是在高速硬件上用可编程逻辑器件(FPGA)实观，利用FPGA强大的
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Xilinx FPGA 部分动态可重构 信号解调系统
在过去30年，消费者目睹了电视广播以及我们总体上访问媒体方式的巨大而又快速的转变。如果您是从上个世纪70年代走过来的，你就可以看到电视从过去到现在有多么明显的进步。那时模拟广播仅提供三个主要频道，画质只相
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Smarter Xilinx Vision 方案
本文设计的系统主要研究了基于Zed board的人体生理状态监测系统设计与实现。现在体动信号(Ballistocardiogram，BCG)与心电信号(Electrocardiogram，ECG)同步监测的系统还很少有，这样的系统可以更加全面的监测心脏的活动状态，使在家庭、办公等环境下，长时间实时监护和评估心脏功能变为可能
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Xilinx 心电信号 体动信号
随着网络带宽的不断增加和数据率的不断提高，单端互联的方式由于噪声等的影响已经不能满足设计的要求。在高速数据通信系统中，由于LVDS(低压差分信号)有着良好的抗干扰能力而被广泛使用。然而由于许多MCU和DSP不支持LVDS标准的信号而使得接口设计复杂且难于调试。
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Xilinx LVDS Spartan-6
Zynq-7000系列器件将处理器的软件可编程能力与 FPGA 的硬件可编程能力实现完美结合，以低功耗和低成本等系统优势实现无以伦比的系统性能、灵活性、可扩展性，同时可以加速产品上市进程。
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Xilinx Zynq-7000 FPGA 201301
在All Programmable FPGA、SoC和3D IC方面有指标意义的美商赛灵思(Xilinx, Inc.) ，今(31日)宣布在开发与推出最新一代20奈米All Programmable元件方面有叁项重大凸破。20奈米系列元件在系统效能、低功耗及可编程系统整合度均超前业界。20奈米系列元件将广泛支援新一代的系统，并提供最具竞争力的可编程替代方案，取代各种ASIC与ASSP。
Xilinx Vivado设计套件是首款针对可编程元件打造的SoC设计套件，将支援2013年3月推出的首批20
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Xilinx SoC 设计套件
前不久，赛灵思(Xilinx)发表其20 nm产品路线图，在之前的28nm产品上，Xilinx声称他们领先竞争对手一代，落实了All Programmable器件战略(FPGA、SoC和3D IC)，推出了Vivado设计环境和开发套件，结合其丰富的IP资源，为市场提供了高性能、低功耗和有利于减少系统/BOM成本的产品。赛灵思公司全球高级副总裁，亚太区执行总裁汤立人表示，Xilinx在20nm产品的表现上还将保持领先一代的优势,下一代FPGA及第二代SoC和3D IC将与Vivado设计套件&ldqu
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Xilinx FPGA 20nm
1 引言在高速信号处理系统中, 需要缓存高速、大量的数据, 存储器的选择与应用已成为系统实现的关键所在。DDR SDRAM是一种高速CMOS、动态随机访问存储器, 它采用双倍数据速率结构来完成高速操作。SDR SDRAM一个时钟周
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Xilinx SDRAM FPGA DDR
基于FFT算法的电力系统谐波检测装置，大多采用DSP芯片设计。DSP芯片是采用哈佛结构设计的一种CPU，运算能力很强，速度很快；但是其顺序 执行的模式限制了其进行FFT运算的速度。而现场可编程逻辑门阵列（Field Progra
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检测 设计 谐波 电力 Xilinx FPGA 基于
今天，“2012年嵌入式系统创新与应用技术论坛”在北京大学举行。共有200名左右的听众出席了这次会议。
“计算能力如何在5年内提高100倍？最大的挑战是功耗。主要两个解决途径，一是编程语言，二是计算机架构改变。”中国科学院院士、航天总公司771所的沈绪榜先生首先做了理论性报告——《粗粒度的时空计算》。他说，高科技本质上是数学技术。计算机是数学家发明的，是以无穷的计算时间和无穷的存储空间支持数学上的infinite的，因此也产生了
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嵌入式 电子产品世界 沈绪榜 Xilinx Freescale
通常FPGA工程师编译较大的工程时比较头疼，因为编译时间非常长，常常需要花费几个小时，如果是在调试阶段，每次修改一个错误需要几小时，这样效率就非常低。导致编译时间较长的原因有两点：1. 设计中资源利用比较大
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Xilinx 增量 编译技术
FPGA 设计人员在满足关键时序余量的同时力争实现更高性能，在这种情况下，存储器接口的设计是一个一向构成艰难而耗时的挑战。Xilinx FPGA 提供 I/O 模块和逻辑资源，从而使接口设计变得更简单、更可靠。尽管如此，I/
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Xilinx FPGA 存储器接口 生成器
All Programmable技术和器件的全球领先企业赛灵思公司(Xilinx, Inc. (NASDAQ:XLNX) )在西班牙巴塞罗那举行的2012年电信级以太网世界大会(Carrier Ethernet World Congress 2012)上展示了All Programmable技术在电信级光学网络中的优势。
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Xilinx 以太网 FPGA
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