摘 要:本文提出了一种LED点阵屏实现256级灰度显示的新方法。详细分析了其工作原理。并依据其原理,设计出了基于FPGA 的控制电路。关键词:256级灰度;LED点阵屏;FPGA;电路设计
引言256级灰度LED点阵屏在很多领域越来越显示出其广阔的应用前景,本文提出一种新的控制方式,即逐位分时控制方式。随着大规模可编程逻辑器件的出现,由纯硬件完成的高速、复杂控制成为可能。
逐位分时点亮工作原理所谓逐位分时点亮,即从一个字节数据中依次提取出一位数据,分8次点亮对应的像
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256级灰度 FPGA LED点阵屏 电路设计 发光二极管 LED
摘 要:本文提出了一种高效的复信号处理芯片的设计方法。本芯片是某雷达信号处理机的一部分,接收3组ADC的输出复数据,依次完成去直流、加窗、512点FFT、求功率谱和累加3组信号的功率谱等功能。在这5种功能中,加窗、512点FFT和求功率谱复用一个蝶形单元。本芯片由单片FPGA实现,计算精度高、速度较快,满足雷达系统的实时处理要求。关键词: FFT;蝶形单元;块浮点;功率谱; FPGA
引言复信号处理芯片是某雷达系统的一部分。雷达系统的实时处理特点要求芯片运
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FFT FPGA 蝶形单元 功率谱 块浮点
根据Dataquest的统计数据,PLD是半导体行业中增长最快的细分市场,复合年度增长率(CAGR)达19.5%。这一数字是ASIC市场预计9%复合年度增长率的两倍多。过去,可编程芯片在半导体行业中一直是很重要的外围器件,由于其灵活性而被广泛用于ASIC仿真、胶合逻辑,或者作为适应标准变化的一种解决方案。今天,在与ASIC和ASSP的市场份额竞争中,PLD取得了很大进步。目前,该技术正逐渐成为主要设计技术,而且业界也在普遍向可编程芯片转移。作为重要的ASIC替代解决方案,PLD现在已成为大势所趋。促进这种
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Xilinx
微电子学的发展彻底改变了计算机的设计:集成电路技术增加了能够安装到单个芯片中的元器件数目及其复杂度。因此,采用这种技术可以构建低成本、专用的外围器件,从而迅速地解决复杂的问题。
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FPGA 脉动 阵列
可编程解决方案全球领导供应商赛灵思公司(Xilinx, Inc. (NASDAQ: XLNX) )今天公布了专门为支持"适应未来"的可编程无线基站而设计的一整套芯片、软件和IP解决方案。赛灵思灵活经济的解决方案可以替代传统的ASIC(专用集成电路)解决方案,通过加快产品上市速度、实现零沉没工程成本(NRE)以及提供现场可升级能力,它可以大大降低资本支出(CAPEX)和运营费用(OPEX)。 通过远程升级,服务供应商可大大延长基站寿命,同时避免高昂的运输费用和硬件开发费用。例如,通过远程下载软件对赛灵思器件
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XILINX
全球领先的可编程逻辑供应商赛灵思公司(Xilinx, Inc.)今天宣布其Spartan-3现场可编程门阵列(FPGA)器件被用来成功开发和生产出了一款灵活和低成本的车载信息系统。该系统将被集成应用于每一辆菲亚特汽车中。根据与菲亚特汽车公司共同确定的一款参考设计,微软公司的汽车业务部与赛灵思、三星、ScanSoft、西门子、SiRF和Magneti-Marelli公司合作共同开发解决方案,每家企业都分别提供了系统的主要部分,包括芯片组、处理器、通信模块、语音引擎和硬件开发等。 赛灵思Spartan-3 F
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XILINX
摘 要:本文介绍了高速ADC AD9430的功能,详细说明了使用高速FPGA来控制AD9430构成高速(140MSPS)、高精度(12位)数据采集系统的设计方法,并给出了具体实现的系统框图和测试结果。关键词:数据采集;FPGA;AD9430引言结合实际任务的要求,本文提出了一种基于AD9430的高速数据采集系统,主要用于采集雷达回波。在这个系统中,选用高速逻辑器件控制A/D转换和FIFO存储,同时通过FPDP(Front Panel Data Port)总线将采集的数据发送出去。由
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AD9430 FPGA 数据采集
摘 要:本文在分析了非对称同步FIFO的结构特点及其设计难点的基础上,采用VHDL描述语言,并结合FPGA,实现了一种非对称同步FIFO的设计。关键词:非对称同步FIFO;VHDL;FPGA;DLL;BlockRAM引言FIFO是一种常用于数据缓存的电路器件,可应用于包括高速数据采集、多处理器接口和通信中的高速缓冲等各种领域。然而在某些应用,例如在某数据采集和处理系统中,需要通过同步FIFO来连接8位A/D和16位数据总线的MCU,但是由于目前同步FIFO器件的输入与输
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BlockRAM DLL FPGA VHDL 非对称同步FIFO 存储器
摘 要:本文提出了一种利用边沿触发鉴相缩短锁相环捕获时间的方案,并详细介绍了该方案基于FPGA的实现方法。通过对所设计的锁相环进行计算机仿真和硬件测试,表明该方案确实可以提高锁相环的捕获性能。关键词:数字锁相环(DPLL);捕获时间;FPGA;VHDL引言捕获时间是锁相环的一个重要参数,指的是锁相环从起始状态到达锁定状态所需时间。在一些系统中,如跳频通信系统,由于系统工作频率不断地发生快速变化(每秒几百次到几千次,甚至高达上万次),要求锁相环能够对信号相位快速捕获。因此
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FPGA VHDL 捕获时间 数字锁相环(DPLL)
赛灵思公司(Xilinx, Inc.)今天确认在12月结束的财政季度里,其CPLD市场份额继续保持增长。CPLD的发展势头明显有利于赛灵思。在2004公历年第四季度中,赛灵思CPLD的销售收入约占其总收入的10%。此外,这也是赛灵思在CPLD市场中的份额连续第16个季度保持增长。随着公司在个人消费、通信、存储和服务器市场不断赢得设计客户,赛灵思相信已经成为目前全球第二大CPLD供应商。 XC9500 和 CoolRunner系列的联合增长推动市场扩展采用由XC9500XL 和 CoolRunner-II器
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XILINX
VirtexE系列是XILINX公司生产的新型FPGA芯片,可用来进行数十万逻辑门级的系统设计和百兆赫兹级的高速电路设计。
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FPGA 50E XCV 50
介绍了一种基于ALTERA公司大规模可编程逻辑器件EPF10K10的多功能光栅尺处理品电路。叙述了该电路的主要电路――四倍频细分、辨向电路、计数电路、接口处理电路的设计原理,风时给出了详细的电路和仿真波形。
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FPGA 光栅 信号 模块
全球可编程逻辑解决方案领导供应商赛灵思公司(Xilinx, Inc.)今天宣布在亚太地区扩展其曾获殊荣的客户支持服务,以配合该公司在亚太区和中国积极发展的计划。这些服务将设在赛灵思公司上海办事处,主要服务项目包括:
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XILINX
摘 要:本文介绍了一种同步测周期计数器的设计,并基于该计数器设计了一个高精度的数字频率计。文中给出了计数器的VHDL编码,并对频率计的FPGA实现进行了仿真验证,给出了测试结果。关键词:频率计;VHDL;FPGA;周期测量
在现代数字电路设计中,采用FPGA结合硬件描述语言VHDL可以设计出各种复杂的时序和逻辑电路,具有设计灵活、可编程、高性能等优点。本文将介绍一种基于FPGA,采用同步测周期的方法来实现宽频段高精度数字频率计的设计。
图1 同步测周期计数器
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FPGA VHDL 频率计 周期测量
全球可编程逻辑解决方案供应商赛灵思公司(Xilinx)今天根据数以千计个体现了Virtex-4Ô多平台FPGA系列显著的低功耗优势的器件所反映的特性,提供了有关这一系列产品的最新数据。与任何竞争的90nm FPGA相比,Virtex-4器件的启动浪涌功耗降低了94%;静态功耗降低了78%。功耗的显著下降是由于采用了独特的节能配置电路和90nm三栅极氧化层技术。Virtex-4 FPGA固有的功耗优势减轻了系统电源和冷却系统的负担,从而改善了系统的长期可靠性并降低了系统总成本。设计者在得益于功耗
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Xilinx
xilinx fpga介绍
Xilinx FPGA
Xilinx FPGA主要分为两大类,一种侧重低成本应用,容量中等,性能可以满足一般的逻辑设计要求,如Spartan系列;还有一种侧重于高性能应用,容量大,性能能满足各类高端应用,如Virtex系列,用户可以根据自己实际应用要求进行选择。 在性能可以满足的情况下,优先选择低成本器件。
Xilinx FPGA可编程逻辑解决方案缩短了电子设备制造商开发产品的时间 [
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