位于英国剑桥的电力电子技术创新企业Pulsiv Limited宣布推出效率超高*的65W USB-C GaN优化参考设计，该设计旨在解决电源中的复杂热性能挑战。这一备受期待的突破性开发成果将提供其他设计中所未有的独特功能和优势组合，必将彻底改变USB-C快速充电领域。 PSV-RDAD-65USB参考设计将Pulsiv OSMIUM技术与行业标准的准谐振反激变换器和高度优化、超紧凑的磁性组件相结合。它能大幅降低工作温度、尽量减小损耗并缩小尺寸，引领了一系列突破功率转换现有边界的设计，旨在打造一个可持续的U
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Pulsiv USB-C 半有源桥
摘要：● 新思科技ARC HS4xFS处理器IP和新思科技IP开发流程均通过独立审计机构SGS-TṺV Saar的ISO/SAE 21434认证。● 获得ISO/SAE 21434认证可应对不断变化的网络安全威胁，有助于在整个生命周期内为汽车系统提供长期的安全性与可靠性。● 经过安全风险分析（SRA）认证的新思科技ARC HS4xFS处理器IP助力开发者能够以安全的方式将IP集成到系统中，从而满足ISO/SAE 21434要求。●&n
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新思科技 ISO/SAE 21434 网络安全合规认证 IP 汽车安全
在提到干扰对USB的影响时，差分数据传输与简单的同轴电缆相比具有很大的优势。在感性干扰效应(磁场)情况下，导线的绞合可以弥补干扰效应。●USB控制器的输入/输出不是完全对称的，因此USB信号显示出共模干扰。●Layout与HF/EMC不兼容，寄生电容和缺少波阻匹配会产生共模干扰。●电路设计(USB滤波器)不充分，滤波器影响信号质量，和/或插损太低。●接口设计(插座，外壳)不充分。不良的接地会减小电缆的屏蔽衰耗。滤波器具有不良的接地参考。●USB电缆不对称、屏蔽不良以及没有足够好的接地。这种电缆会劣化信号质
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EMC 静电测试 USB
本系列文章从数字芯片设计项目技术总监的角度出发，介绍了如何将芯片的产品定义与设计和验证规划进行结合，详细讲述了在FPGA上使用IP核来开发ASIC原型项目时，必须认真考虑的一些问题。文章从介绍使用预先定制功能即IP核的必要性开始，通过阐述开发ASIC原型设计时需要考虑到的IP核相关因素，用八个重要主题详细分享了利用ASIC所用IP来在FPGA上开发原型验证系统设计时需要考量的因素。在上篇文章中，我们介绍了将ASIC IP移植到FPGA原型平台上的必要性，并对原型设计中各种考量因素进行了总体概述，分析开发A
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ASIC IP FPGA SmartDV
今天给大家分享我在github上看到的一个有意思的项目：使用微控制器 PIC16F1459 构建 DIP 开关 USB U盘。（附带电路原理图，PCB布局设计，原始应用程序。）主要是用拨片开关来进行配置设备，只需要拨动红色开关就可以轻松配置文件。不需要编辑 XML 和 JSON 文件来存储硬件或软件的配置设置。这个项目分享给大家，步骤讲解得很详细，如果感兴趣的可以动手试试。先放上成品图。DIP 开关插电脑上图DIP 开关 U 盘的后视图和前视图（颜值还挺高的）一、元件选择作者总共设计制作了两种不同版本的D
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MCU PIC16F1459 USB U盘
致力于亚太地区市场的国际领先半导体元器件分销商—大联大控股近日宣布，其旗下友尚推出基于意法半导体（ST）ST-ONEHP器件的140W USB PD3.1快充方案。图示1—大联大友尚基于ST产品的140W USB PD3.1快充方案的展示板图近年来，快充行业不断经历创新升级，每一次技术的跃进都为充电的效率与安全性带来革命性变革。特别是USB PD3.1快充标准的引入，更是为该行业的发展树立了新的里程碑。该标准不仅将最大充电功率提升至240W，同时新增多组固定和可调输出电压档位，可为各种电子设备提供更加灵活
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友尚集团 ST 140W USB PD3.1 快充方案
一站式定制芯片及IP供应商——灿芯半导体（上海）股份有限公司近日宣布成功研发出一款通用高性能小数分频锁相环（fractional-N PLL） IP，支持24bits高精度小数分频，最高输出频率4.5Ghz，另外还支持扩频时钟（SSC）功能，可以为客户提供多功能的小数分频 PLL解决方案。PLL电路一般用于产生输出频率，输出频率值与PLL的参考输入频率呈倍数关系。小数分频PLL通过频率乘法比例的小数值，实现更精确的输出频率控制，从而提供更高精度和准确度的输出频率。SSC发生器是在一定频率范围内调制时钟信号
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灿芯半导体 小数分频 锁相环 IP
半导体制程进入2奈米，撷发科技董事长杨健盟指出，IC设计难度陡增，未来硅智财、ASIC角色将更加吃重，协助IC设计以SoC方式因应AI新世代。杨健盟分析，过往IDM分拆晶圆代工之典范，将在IC设计上发生，AI时代IC设计大者恒大趋势成形。 撷发科技已获国际芯片大厂AI芯片外包订单，杨健盟认为，现在芯片晶体管动辄百亿个，考验IC设计业者研发量能。大量采用基础、接口IP使研发能力更能专注前段设计，海外大厂甚至将后段交由ASIC业者，未来倚重IP、ASIC趋势只会更加明显。中国台湾半导体产业链在逻辑先进制程、先
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IC设计 IP ASIC
根据Technavio的报告，全球半导体知识产权（IP）市场规模预计将在2024年至2028年间增长27.1亿美元。预计在预测期内，市场的复合年增长率（CAGR）将超过7.47%。复杂芯片设计和多核技术的使用推动了市场的增长，同时纳米光子集成电路（ICs）的出现也是一大趋势。然而，半导体IP的重复使用构成了一项挑战。主要市场参与者包括Achronix Semiconductor Corp.、Advanced Micro Devices Inc.、Alphawave IP Group plc、Arm Ltd
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半导体知识产权 IP
EVLVIPGAN100PD是一个 100 W 的QR 模式的反激适配器电源，具有USB Type-CTM PD的高效能参考设计方案，它是一款基于 VIPERGAN100 的隔离式电源是一款新型离线高压转换器，具有
650 V HEMT 功率 GaN 晶体管，专为准谐振反激式转换器设计，能够在宽范围内提供高达 100 W
的输出功率。该方案具有：峰值效率 > 92%，符合IEC55022
B级传导电磁干扰，有减少的EMI滤波器。评估板是使用意法半导体公司的新型先进离线切换器VI
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ST VIPERGAN100 USB 电源输送适配器
IT之家 5 月 31 日消息，存储模组企业宇瞻昨日宣布将在 6 月 4 日开幕的 2024 台北国际电脑展上以“智慧引领 前瞻未来”为主轴，带来系列存储新品。宇瞻将在展会上展出全球首款采用单芯片控制方案的 USB4 移动固态硬盘。根据IT之家以往报道，群联在 CES 2024 上就展示了符合宇瞻新闻稿中描述的单芯片主控 U21，该主控支持至大 8TB 容量，顺序读写均可达 USB4 满速。宇瞻还将带来原生 DDR5-6400 的 DDR5 U-DIMM / SO-DIMM
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存储 USB 4 宇瞻 台北国际电脑展
芯片设计公司Arm今日发布了针对旗舰智能手机的新一代CPU和GPU IP（设计方案）：Cortex-X925 CPU、Immortalis G925 GPU。新产品均使用了其最新的Armv9架构，基于台积电3nm制程工艺方案，针对终端设备在AI应用上的性能进行设计优化。此外还将提供软件工具，让开发人员更容易在采用Arm架构的芯片上运行生成式AI聊天机器人和其他AI代码。预计搭载最新内核设计的手机将于2024年底上市。据官方介绍，新的CPU与GPU IP是目前旗下同类产品中性能最强的一代，新CPU性能提升3
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arm CPU GPU IP 3nm
● 西门子集成的验证套件能够在整个IC设计周期内提供无缝的IP质量保证，为IP开发团队提供完整的工作流程西门子数字化工业软件日前推出 Solido™ IP 验证套件 (Solido IP Validation Suite)，这是一套完整的自动化签核解决方案，可为包括标准单元、存储器和 IP 模块在内的设计知识产权 (IP) 提供质量保证。这一全新的解决方案提供完整的质量保证 (QA) 覆盖范围，涵盖所有 IP 设计视图和格式，还可提供 “版本到版本” 的 IP 认证，能够提升完整芯
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西门子 Solido IP IC设计 IC 设计
Diodes 公司 (Diodes)近日推出10Gbps符合汽车规格的交叉开关(Crossbar Switch)，为先进的车内连接功能带来更多便利与性能。Diodes 全新开关PI3USB31532Q的设计可通过 USB Type-C® 连接器实现USB 3.2 与 DisplayPort™ 2.1 信号路由，确保信号高度完整性，相较于传统交叉多路复用器与 ReDriver™ 信号调节器更省电。此款交叉开关适用于汽车后排娱乐系统与配备高分辨率大型显示屏的智能座舱。PI3USB31532Q 支持三种符合 U
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Diodes 交叉开关 USB-C
尽管USB Type-C®主要作为笔记本电脑、平板电脑和智能手机的新一代、更快充电标准而为人所熟知，但在电力输送和连接应用领域也变得日益普及。USB Type-C 的速度和效率非常高：随着 USB 电力输送 (USB PD) R3.1 规范的发展，一个 USB Type-C 连接器便可支持高达 240W（48V 和 5A）的功率，相较于 USB Std-A 连接器的 7.5W（5V 和 1.5A），这是一个显著的提升。USB Type-C 的广泛采用并非偶然，欧盟、印度、巴西和韩国纷纷制定并实施了相关规定
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202406 车载信息娱乐 USB PD 电力输送 德州仪器
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