- 设计好工程文件后，首先要进行工程的约束。约束主要包括器件选择、管脚分配及时序约束等。时序约束属于较为高级的应用，通过时序约束可以使工程设计文件的综合更加优化。下面对这几种约束方式进行介绍。
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QuartusII 约束 FPGA 配置
- 逻辑锁定方法学（LogicLock Methodology）内容就是在设计时采用逻辑锁定的基于模块设计流程（LogicLock block-based design flow），来达到固定单模块优化的目的。这种设计方法学中第一次引入了高效团队合作方法：它可以让每个单模块设计者独立优化他的设计，并把所用资源锁定。
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QuartusII LogicLock FPGA 逻辑锁定工具
- 显示器因为其输出信息量大，输出形式多样等特点已经成为现在大多数设计的常用输出设备。在 FPGA 的设计中可以使用很少的资源，就产生 VGA 各种控制信号。这个示例在 RHicSP2200B FPGA 开发板/学习板上使用 VGA 接口在显示器上显示了文字以及简单的图形，可以作为VGA 显示设计的参考，如果在使用这个例子的过程
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VGA 接口 FPGA
- 本节旨在通过给定的工程实例——“正弦波发生器”来熟悉Altera Quartus II高级调试功能SignalTap II和Intent Memory Content Editor的使用方法。同时使用基于Altera FPGA的开发板将该实例进行下载验证，完成工程设计的硬件实现。在本节中，将主要讲解下面知识点。
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QuartusII SignalTapII FPGA
- 据估计，目前盛行的假冒电子产品已经占到整个市场份额的10%，这一数据得到了美国反灰色市场和反假冒联盟(AGMA)的支持。AGMA是由惠普、思科和其它顶级电子OEM公司组成的一个行业组织。据该组织估计，制造商因盗版造成的损失超过1000亿美元，而对最终用户来说，信誉损毁和可靠性问题带来的隐性成本则更难以确定。
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AGMA 可编程逻辑 FPGA
- 本节旨在通过Quartus软件自带的工程实例——“lockmult”来熟悉Altera Quartus II逻辑锁定功能LogicLock的使用方法。在本节中，将主要讲解下面知识点。
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QuartusII LogicLock FPGA
- 针对机载信息采集系统可靠性、数据管理高效性以及硬件成本的需求，介绍了基于硬件描述语言Verilog HDL设计的SDX总线与Wishbo ne总线接口转化的设计与实现，并通过Modelsim进行功能仿真，在QuartusⅡ软件平台上综合，最终在Altera公司的CyclONeⅢ系列FPGA上调试。实验证明了设计的可行性。
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SDX总线 Wishbone总线 FPGA
- 随着数据存储量的日益加大以及存储速度的加快，大容量的高速存储变得越来越重要。内存条既能满足大容量的存储又能满足读写速度快的要求，这样使得对内存条控制的应用越来越广泛。首先介绍了内存条的工作原理，内存条电路设计的注意事项，以及如何使用FPGA实现对DDR内存条的控制，最后给出控制的仿真波形。
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DDR 内存条 FPGA
- 介绍了LVDS技术的原理，对LVDS接口在高速数据传输系统中的应用做了简要的分析，着重介绍了基于FPGA的LVDS_TX模块的应用，并通过其在DAC系统中的应用实验进一步说明了LVDS接口的优点。
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LVDS接口 高速数据传输 FPGA
- 随着信息技术的发展，基于微处理器的数字信号处理在测控、通讯、雷达等各个领域得到广泛的应用。被处理的模拟信号也在向高频、宽带方面发展，但这需要高速、高分辨率的数字采集卡以将模拟信号数字化。美国国家半导体公司新推出的系列高速、高分辨率模/数转换器（如CLC5958）就非常适用于需要高速、高分辨率的信号采集系统。
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CLC5958型 A/D转换器 FPGA PCI
- 这里我们使用一个波形发生器作为例子，来说明如何使用Modelsim对Quartus II生成的IP Core和相应的HDL文件进行功能仿真和时序仿真。这个例子里面使用到了由Quartus II生成的一个片上ROM存储单元。这种存储单元和RAM一样，都是基本的FPGA片上存储单元，在以后的设计里面会经常使用到。
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仿真验证 功能仿真 FPGA 时序仿真
- 设计了在FPGA与DSP之间进行图像数据传输的硬件结构，介绍了EDMA的工作原理、传输参数配置和EDMA的传输流程。在开发的实验平台上实现了这一传输过程。借助TI公司的DSP调试平台CCS把接收到的图像数据恢复成图像，验证了传输过程的正确性和稳定性。
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EDMA 数据传输 FPGA
- 随着设计量和复杂度的不断增加，数字设计验证变得越来越难，所消耗的成本也越来越高。面对这种挑战，验证工程师必须依靠相应的验证工具和方法才行。对于大型的设计，比如上百万门的设计验证，工程师必须使用一整套规范的验证工具；而对于较小的设计，使用具有HDL testbench的仿真器是一个不错的选择。
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仿真验证 仿真测试文件 FPGA Testbench
- 为提高功放效率，以适应现代社会高效、节能和小型化的发展趋势，以D类功率放大器为核心，以单片机89C51和可编程逻辑器件（FPGA）进行控制及时数据的处理，实现了对音频信号的高效率放大。系统最大不失真输出功率大于1 W,可实现电压放大倍数1~20连续可调，并增加了短路保护断电功能，输出噪声低。系统可对功率进行计算显示，具有4位数字显示，精度优于5%
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音频放大器 D类功率放大 FPGA
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