- 说到异步时钟域的信号处理，想必是一个FPGA设计中很关键的技术，也是令很多工程师对FPGA望而却步的原因。但是异步信号的处理真的有那么神秘吗?那么就让特权同学和你一起慢慢解开这些所谓的难点问题，不过请注意，今后的这些关于异步信号处理的文章里将会重点从工程实践的角度出发，以一些特权同学遇到过的典型案例的设计为依托，从代码的角度来剖析一些特权同学认为经典的跨时钟域信号处理的方式。这些文章都是即兴而写，可能不会做太多的分类或者归纳，也有一些特例，希望网友自己把握。
另外，关于异步时钟域的话题，推荐大家
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FPGA MCU
- 只有最初级的逻辑电路才使用单一的时钟。大多数与数据传输相关的应用都有与生俱来的挑战，即跨越多个时钟域的数据移动，例如磁盘控制器、CDROM/DVD 控制器、调制解调器、网卡以及网络处理器等。当信号从一个时钟域传送到另一个时钟域时，出现在新时钟域的信号是异步信号。
在现代 IC、ASIC 以及 FPGA 设计中，许多软件程序可以帮助工程师建立几百万门的电路，但这些程序都无法解决信号同步问题。设计者需要了解可靠的设计技巧，以减少电路在跨时钟域通信时的故障风险。
基础
从事多时钟设计的第一
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FPGA 异步信号 FIFO
- 相信学过单片机的同学对I2C总线都不陌生吧，今天我们来学习怎么用verilog语言来实现它，并在FPGA学习版上显示。
i2c总线在近年来微电子通信控制领域广泛采用的一种新型的总线标准，他是同步通信的一种特殊方式，具有接口少，控制简单，器件封装形式小，通信速率高等优点。在主从通信中，可以有多个i2c总线器件同时接到i2c总线上，所有与i2c兼容的器件都有标准的接口，通过地址来识别通信对象，使他们可以经由i2c总线互相直接通信。
i2c总线由两条线控制，一条时钟线SCL，一条数据线SDA，这
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FPGA i2c verilog
- 市场研究机构ICInsights最新报告称，中国IC设计企业在2014年全球前五十无晶圆厂IC供应商排行榜上占据9个席位。这9家厂商包括海思、展讯、大唐微、南瑞智芯、华大、中兴、瑞芯微、锐迪科、全志。而2009年只有1家企业入围，这表明中国无晶圆厂IC产业确实成长显著。
然而，上述9家入围企业中，有5家都聚焦于目前最热门的智能手机市场。当然，这些年智能手机终端产业确实增长迅速，也为中国IC设计提供了发展空间和机遇。但我国拥有的是全球最大的信息消费市场，每年进口集成电路产品超过2000亿美元，对I
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海思 展讯 FPGA
- 对自己的设计的实现方式越了解，对自己的设计的时序要求越了解，对目标器件的资源分布和结构越了解，对EDA工具执行约束的效果越了解，那么对设计的时序约束目标就会越清晰，相应地，设计的时序收敛过程就会更可控。
下文总结了几种进行时序约束的方法。按照从易到难的顺序排列如下：
0.核心频率约束
这是最基本的，所以标号为0.
1.核心频率约束+时序例外约束
时序例外约束包括FalsePath、MulticyclePath、MaxDelay、MinDelay.但这还不是最完整的时序约束
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FPGA 时序约束
- 以前在学单片机的时候，觉得串口通信其实很简单，只要一个指令数据就能轻易的接收或者发送。前几天试着用FPGA实现，发现里面的学问还不少，并没有想象的那么简单。当然代码肯定是参考别人的，不过我还是认真研究了整段代码的，下面的程序就是我在看懂了别人代码后自己敲的，花了也不少时间，理解的也差不多，下面我就在这里给那些和我一样的初学者介绍一下吧，解释的不对的地方还望各位大神指正，大家好一起学习~
1、顶层模块
写程序都一样，不能多有的程序都写在一个模块里，那样看起来很麻烦，出了错误也不好维护，对于一
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FPGA 状态机
- 一、关于HDL
1. HDL简介
HDL ： Hardware Discription Language 硬件描述语言，即描述FPGA/CPLD内部逻辑门的工作状态，来实现一定电路。
随着EDA技术的发展，使用硬件语言设计PLD/FPGA成为一种趋势。目前硬件描述语言有VHDL、Verilog、Superlog、System C、Cynlib C++、C Level等。 各种语言有各种优势，根据业界应用而定。
2. VHDL和Verilog区别
在业界，VHDL和Veri
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FPGA Verilog
- 刚开始玩CPLD/FPGA开发板的时候使用的一块基于EPM240T100的板子，alter的这块芯片虽说功耗小体积小，但是资源还是很小的，你写点稍微复杂的程序，如果不注意coding style，很容易就溢出了。当时做一个三位数的解码基本就让我苦死了，对coding style的重要性也算是有一个比较深刻的认识了。
后来因为一直在玩xilinx的spartan3 xc3s400，这块芯片资源相当丰富，甚至于我在它里面缓存了一帧640*480*3/8BYTE的数据都没有问题(VGA显示用)。而最近
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FPGA verilog RTL
- 学习FPGA其实也不算久，开始的时候参考别人的代码并不多，大多是自己写的，那时候做时序逻辑多一些。参加了中嵌的培训班，一个多月的时间在熟悉ISE软件的使用以及verilog语法方面下了苦功，也参考了不少书，算是为自己打下了比较好的基础。因为那时候培训的方向是软件无线电方面的，所以做了很多有关的模块程序，之前的日志里也发表了很多，关键是一个兴趣，感觉仿真后看到自己的一个个算法思想得到实现真有成就感。后来停了一段时间，因为实在没有比较有意思的活干了。
直到前段时间开始使用SP306的开发板，然后会参
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FPGA verilog
- 现场可编程门阵列(FPGA)作为专用集成电路(ASIC)领域的一种半定制电路，可以根据设计的需要灵活实现各种接口或者总线的输出，在设备端的通信产品中已得到越来越广泛的使用。FPGA是基于静态随机存储器(SRAM)结构的，断电后程序丢失后的每次上电都需要重新加载程序。且随着FPGA规模的升级，加载程序的容量也越来越大，如Xilinx公司的Spartan - 6系列中的6SLX150T，其加载容量最大可以达到4.125 MB.
1 FPGA常用配置方式
FPGA的配置数据通常存放在系统中的存储
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CPLD FPGA modelsim
- 如果设计师可以在开发过程早期就满足基于FPGA的设计，提出的功耗要求和约束条件，那么在系统的最终实现阶段就能形成极具竞争力的优势。然而，根据整个技术文献中这种自我暗示式的反复祷告，今天基于FPGA的系统中还有什么会使得完全遵循这个建议变得不切实际或过于困难呢?尽管能够使用各种开发工具，如专门针对FPGA项目开发的早期功耗预估器和功耗分析器，但对电源设计师来说，在设计过程早期就考虑最坏情况而不是最佳情况的电源系统是有好处的，因为在许多方面仍有太多的不确定性，比如在硬件设计完成和功耗可以测量之前，静态小电
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FPGA 电源设计
- 以单片机和可编程逻辑器件(FPGA)为控制核心，设计了一个程控滤波器，实现了小信号程控放大、程控调整滤波器截止频率和幅频特性测试的功能。其中放大模块由可变增益放大器AD603实现，最大增益60dB，10dB步进可调，增益误差小于1%.程控滤波模块由MAX297低通滤波、TLC1068高通滤波及椭圆低通滤波器构成，滤波模式用模拟开关选择。本系统程控调整有源滤波的-3dB截止频率，使其在1~30kHz范围内可调，误差小于1.5%.此外，采用有效值采样芯片AD637及12位并行A/D转换器MAX120实现了
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单片机 FPGA AD637
- AMD宣布其嵌入式 Radeon HD 7850 GPU 协助Analogic公司旗下 BK Ultrasound 医用超音波产品的超音波系统 bk3000 发挥卓越应用效能。新款 BK Ultrasound 医用超音波 bk3000 搭载AMD嵌入式 Radeon 绘图技术，可望使成像及系统效能到全新境界。
AMD嵌入式 Radeon HD 7850 GPU 采用AMD屡屡获奖的次世代绘图核心(GCN)架构为基础，带动各种嵌入式应用在视觉与平行处理功能提升。除了超音波外， GPGPU 的其他应
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AMD嵌 Radeon GPU FPGA
- 致力于在电源、安全、可靠和性能方面提供差异化半导体技术方案的领先供应商美高森美公司(Microsemi Corporation) 宣布完成9项全新的美国国家标准与技术研究所(National Institute of Standards and Technology, NIST)加密算法验证程序(CAVP)认证。
美高森美SmartFusion®2 SoC FPGA和 IGLOO®2 FPGA通过的认证项目包括NIST “Suite B”中的AES加密/解
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美高森美 NIST FPGA
- 汽车在给人们生活带来便利的同时也带来了交通事故。其中超速行驶是造成交通事故的重要隐患之一。据研究表明，目前针对车辆超速行驶情况的道路抓拍系统中所使用的图像传感器大多为小面阵器件，普遍为100万～200万像素,从而导致抓拍图像的像素比较低、能够同时抓拍的车道数较少等等问题。面对这一系列问题，大面阵的图像传感器便逐渐成了人们关注的热点。在设计过程中，分析了具有500万像素的CMOS图像传感器MT9P401的工作模式,选用QuartusⅡ做为开发工具，使用Verilog HDL语言对驱动电路设计方案进行了硬
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FPGA 图像传感器
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