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DSP 存储系统 SDRAM
- 存储器是容量数据处理电路的重要组成部分。随着数据处理技术的进一步发展，对于存储器的容量和性能提出了越来 ...
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多路读写 SDRAM 数据处理
- 采用Xilinx 和FPGA的DDR2 SDRAM存储器接口控制器的设计,本白皮书讨论各种存储器接口控制器设计所面临的挑战和 Xilinx 的解决方案，同时也说明如何使用 Xilinx软件工具和经过硬件验证的参考设计来为您自己的应用(从低成本的 DDR SDRAM 应用到像 667 Mb/sDDR2 SDRAM 这样的更
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接口 控制器 设计 存储器 SDRAM Xilinx FPGA DDR2 采用
- 摘要：充分利用DDR2 SDRAM速度快、FLASH掉电不消失、MATLAB/Simulink易产生矢量信号的特点，以FPGA为逻辑时序控制器，设计并实现了一种灵活、简单、低成本的矢量信号发生器。本文以产生3载波WCDMA为例，详细介绍了矢量信号发生器的设计方案与实现过程，使用Verilog HDL描述并实现了DDR2 SDRAM的时序控制和FPGA的逻辑控制。
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DDR2 SDRAM FLASH 201205
- 基于OMAP-L138 DSP和Spartan-6的SDR系统实现, Critical Link公司的某客户需要针对多个应用开发一个扩频无线电收发器。该客户已经开发出一套算法，准备用于对信号进行调制和解调，但他们却缺少构建完整系统的资源和专业知识。客户希望利用软件定义无线电(SDR)系统
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系统 实现 SDR Spartan-6 OMAP-L138 DSP 基于
- 在高速数字视频系统应用中，使用大容量存储器实现数据缓存是一个必不可少的环节。SDRAM就是经常用到的一种存储器。但是，在主芯片与SDRAM之间产生的时序抖动问题阻碍了产品的大规模生产。在数字电视接收机的生产实际
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控制 分析 时序 SDRAM 视频系统 嵌入式
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绿色无线通信 基站 体系结构 软件无线电 SDR)
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DSP 存储系统 SDRAM
- 前个周末接到了一个朋友的电话，询问我如果内存有问题，需要测试哪些项目？对于这个很常见的问题，我习惯性的回答他...
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DDR测试 SDRAM 时钟分析
- ASIC、FPGA和DSP的应用领域呈现相互覆盖的趋势，使设计人员必须在软件无线电结构设计中重新考虑器件选择策略问题。本文从可编程性、集成度、开发周期、性能和功率五个方面论述了选择ASIC、FPGA和DSP的重要准则。
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策略 选择 器件 结构设计 SDR
- 本文主要讨论模拟数字转换在SDR实现中的挑战，以及ADC的哪些突破可以促进软件无线电的实际应用。存在的问题SDR对于电信公司来说，可以以最少的基础设施部署成本，满足覆盖范围宽广的无线电频率与标准，并应付它们的
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ADC SDR
- Cyclone II实现DDR SDRAM接口的方法,在不增加电路板复杂度的情况下要想增强系统性能，改善数据位宽是一个有效的手段。通常来说，可以把系统频率扩大一倍或者把数据I/O管脚增加一倍来实现双倍的数据位宽。这两种方法都是我们不希望用到的，因为它们会增加
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接口 方法 SDRAM DDR II 实现 Cyclone
- 摘要：SDRAM的读写逻辑复杂，最高时钟频率达100 MHz以上，普通单片机无法实现复杂的SDRAM控制操作，复杂可编程逻辑器件CPLD具有编程方便，集成度高，速度快，价格低等优点。因此选用CPLD设计SDRAM接口控制模块，简化
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设计 控制器 SDRAM EPM1240 基于
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