要掌握半导体市场成长趋势从来都不是件简单的任务,但那些来自各家分析机构、产业组织甚至厂商自己的预测数字,仍对于整个产业界发展走向具备关键影响力 ──究竟那些预测数字准不准确?预测的方法是否需要随着时间推移而有所改变?
在8月下旬于台湾(新竹)举行的年度Mentor Forum技术论坛上,EDA供应商明导国际(Mentor Graphics)执行长Walden C. Rhines (Wally)以“预测下一波半导体成长(Predicting the Next Wave of Semic
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Mentor Graphics IoT
全球人工智能(AI)热潮兴起,面对潜在庞大应用芯片商机,芯片制造商早已摩拳擦掌抢进,带动竞争日趋激烈,此前NVIDIA即表示,借由其GP-GPU运算倡议在数据中心市场取得很大进展,当前采用GPU芯片处理深度学习(DL)神经网路这类AI应用已成主流,
据Venture Beat网站报导,对此英特尔(Intel)数据中心解决方案团队总经理暨企业副总裁Jason Waxman发文反击,称Xeon芯片才是全球AI服务器市场的绝对领导性产品。
Waxman指出,Xeon芯片在全球AI服务器市场占有主
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英特尔 Xe
2016年8月25日,Mentor Graphics公司和贵州大学宣布成立“电子系统与集成电路设计联合实验室”,并在贵阳举办EDA技术及人才培养技术交流会与实验室揭牌仪式。贵州大学,华芯通,振华电子集团,航天十院,中科渝芯等企事业单位参加了此次活动并进行了现场交流。这次活动得到了中国政府及集成电路界的相关领导及专家的重视与参与,原工业和信息化部电子信息司司长,现中国国家集成电路基金投资公司总裁丁文武先生,国家集成电路重大专项专家组主要成员:王东琳所长,楠亚丁所长,郭晋所长,陈军
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Mentor Graphics EDA
Mentor Graphics 公司发布了最新版Xpedition® 印刷电路板 (PCB) 设计流程工具,以解决当今高级系统设计日益复杂化的问题。电子产品密度的不断提高促使公司以更低成本开发高度紧凑且功能更多的系统设计。为有效管理高级 PCB 系统对密度与性能的需求,新款 Xpedition 流程的高级技术可以设计并验证 3D 刚性-柔性结构,以及实现带有复杂约束的高速拓扑的自动化布局。
“我们的客户是开发世界最高级电子系统的行业领导者。他们需要从针对高性能、高级封装、刚性
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Mentor Graphics PCB
Mentor Graphics 公司为 Verification Academy 增加全新的 SystemVerilog 课程和模式库以帮助验证工程师提高专业技能、生产率及设计质量。针对 UVM 验证的 SystemVerilog 面向对象编程 (OOP) 课程由一位业内资深的 SystemVerilog 专家开发,可帮助工程师扩展 SystemVerilog 技能并在新概念、新技术与新方法学方面保持与时俱进。可供搜索的通用模式库为反复出现的普遍问题提供解决方案,让组织能够记录并分享最佳实践,从而提升
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Mentor Graphics SystemVerilog
Mentor Graphics公司今天宣布,构建用户可编程及高性能的网络开关开创者Barefoot Networks 已成功采用 Veloce® 硬件加速仿真平台验证其 6.5Tbps TofinoTM 开关。Barefoot之所以选择Veloce硬件加速器平台,主要是考虑到 Veloce 硬件加速仿真平台不仅具有高容量与卓越的虚拟化技术,还拥有远程访问选项以及在网络设计验证领域有口皆碑的成功经验。
Barefoot Networks 对目前主流的硬件加速器进行了基准测试,经过长期缜密的
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Mentor Graphics Veloce
Mentor Graphics 公司今天宣布在 PADS® PCB 产品创建平台中新增一些功能。全新的模拟/混合信号 (AMS) 以及高速分析产品能够解决混合信号设计、DDR 实施以及正确的电气设计 signoff 的相关工程挑战。全新的 PADS AMS 设计套件、PADS AMS 云、PADS HyperLynx® DRC 以及 PADS HyperLynx DDR 产品不仅紧密集成,而且非常经济实惠,可以简化设计流程,确保实现电路性能目标,从而减少原型和设计改版次数。扩展的 PA
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Mentor Graphics PADS
Mentor Graphics®公司(纳斯达克代码:MENT)今天宣布推出 Tanner Calibre One IC 验证套件,作为 Tanner™ 模拟/混合信号 (AMS) 物理设计环境不可或缺的一部分,使 Tanner EDA 的用户群可以轻松使用 Calibre® 验证工具的所有功能。该套件大大改善了 IC 设计和验证解决方案,使 Tanner 客户可以在更为集成的环境中使用 Calibre 物理和电路验证工具,尤其是在 Tanner L-Edit™
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Mentor Graphics Calibre
Mentor Graphics公司今天宣布推出全新的 MicReD® Power Tester 600A 产品,其在功率循环中能测试电动和混合动力车 (EV/HEV) 的功率半导体器件的可靠性。借助 MicReD Power Tester 600A 产品,EV/HEV 研发和可靠性工程师能测试功率半导体器件(如绝缘栅双极性晶体管 – IGBT、MOSFET、晶体管以及充电器),以便检查对完成任务来说至关重要的热可靠性和生命周期性能。热可靠性问题可能导致需要召回 EV/HEV 汽车,
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Mentor Graphics IGBT
Mentor Graphics公司今日宣布,Mentor® 硬件加速仿真服务采用具有专业服务和 IP 的 Veloce® 硬件加速仿真平台 ,借此加速仿真验证并降低与片上系统 (SoC) 设计相关的风险。对于选择日后购买或已拥有 Veloce 平台并需要额外短期容量的公司而言,Mentor 硬件加速仿真服务为其提供了能满足其迫切需求的 Veloce 硬件加速仿真平台。
国际汽车供应商 Continental 采用 Mentor 硬件加速仿真服务验证复杂的 SoC,最终如期一次性通
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Mentor Graphics SoC
Mentor Graphics公司今天宣布,借由完成 TSMC 10 纳米 FinFET V1.0 认证,进一步增强和优化Calibre® 平台和 Analog FastSPICE™ (AFS) 平台。除此之外,Calibre 和 Analog FastSPICE 平台已可应用在基于TSMC 7 纳米 FinFET
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Mentor Graphics SPICE
Mentor Graphics公司(纳斯达克代码:MENT)今天发布了一款结合设计、版图布局和验证的解决方案,为TSMC集成扇出型 (InFO) 晶圆级封装技术的设计应用提供支持。该解决方案包含 Calibre® nmDRC 物理验证产品、Calibre RVE™ 结果查看平台和Xpedition® Package Integrator 流程。它让共同客户能够将TSMC InFO技术
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Mentor Graphics TSMC
Mentor Graphics 公司今天宣布, 推出用于 Veloce® 硬件仿真平台的新型应用程序,自此开辟了硬件仿 真的新纪元。新型 Veloce Apps 包括 Veloce Deterministic ICE、 Veloce DFT 和 Veloce FastPath,可以解决复杂 SoC 和系统设计中的关键系统级验证难题。这些应用程序在升 级的 Veloce OS3 操作系统上运行,而新的操作系统极大加快了设计编译周期、门级流 程和结果重新检查( “ 可见性时间&rdqu
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Mentor Graphics 硬件仿真
2015年10月19日,Mentor Graphics公司今天宣布,推出支持25G、50G和100G以太网的Veloce® VirtuaLAB Ethernet环境。这种支持有助于实现今天正在创建的基于大规模以太网设计的高效的、基于仿真的验证。
连接需求的激增对交换机和路由器设计的尺寸有着深远的影响,使之成为了今天开发的最大的IC设计。设计的绝对尺寸、早期发布的压力,以及需要验证所有路径,都推动着将验证从模拟转向基于仿真流程方法的转变。
Juniper Networks硅和系统工程
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Mentor Graphics ASIC
Mentor Graphics公司今天正式发出第 26 届年度技术领导奖 (TLA) 大赛的参赛邀请,这一大赛延续了该公司一直以来表彰卓越印刷电路板 (PCB) 设计的传统。本大赛始于 1988 年,现已成为电子设计自动化 (EDA) 行业持续时间最长的竞赛评比项目。大赛设立的奖项旨在表彰通过采用 Mentor Graphics 公司的创新技术来解决当今复杂 PCB 系统设计的难题,并制造出业界领先产品的工程师和 CAD 设计师。
本次大赛的评审由 PCB 业内的杰出专家担任,包括:Michae
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Mentor Graphics PCB
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