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hdl)设计 文章 最新资讯

基于FPGA的手持式示波器设计

  • 在此设计的低成本手持式示波器是以ADC128S022模/数转换芯片为数据采集前端;使用FPGA片内双口内建RAM进行数据存储、有限状态机实现示波器的触发控制和显示驱动;最后再用LCD12864液晶模块完成终端的低成本图形显示。在DE0-Nano FPGA(Altera Cyclone IV)开发板上的测试结果表明,所设计的手持式示波器可以实现模拟信号任意电平上升沿或下降沿的触发测量;垂直灵敏度和扫描速度调节、波形参数的直接读出等功能。
  • 关键字: 设计  示波器  手持  FPGA  基于  

高速便携式RS 232/422信号模拟器设计

  • 为了飞行试验中机载测试设备或仪器外场排故的需要,利用FPGA和USB接口技术成功设计了可模拟当前各种飞机RS 232/422总线信号的高速便携式模拟器。该信号模拟器能产生24种标准或者非标准波特率的RS 232/422信号,拥有USB接口、键盘和LED显示屏等功能,具有设置简便,使用灵活,可靠性高以及耗电量低等特点。
  • 关键字: 模拟器  设计  信号  RS  便携式  高速  

全数字跟踪接收机的设计与实现

  • 随着软件无线电在中频领域的广泛应用,采用数字信号处理技术设计了基于FPGA全数字中频跟踪接收机并应用于遥感卫星天线接收系统中。给出了详细的理论说明和体统组成。该接收机结构简单,成本低,调试方便。在测试和实际应用中,该跟踪接收机输入信号的动态范围大,AGC和误差电压精度等指标较模拟接收机都有显著的提高。
  • 关键字: 实现  设计  接收机  跟踪  数字  

基于FPGA的八通道超声探伤系统设计

  • 文中提出了一种基于FPGA的八通道超声探伤系统设计方案。该系统利用低功耗可变增益运放和八通道ADC构成高集成度的前端放大和数据采集模块;采用FPGA和ARM作为数字信号处理的核心和人机交互的通道。为了满足探伤系统实时、高速的要求,我们采用了硬件报警,缺陷回波峰值包络存储等关键技术。此外,该系统在小型化和数字化方面有显著提高,为便携式多通道超声检测系统设计奠定基础。
  • 关键字: 系统  设计  探伤  超声  FPGA  通道  基于  

设计更安全、更小的下一代高性能医疗产品

  • 医疗设备系统设计人员面对诸多问题,系统问题包括减小体积、增加功能性和延长可植入人体设备电池的寿命,同时通 ...
  • 关键字: 设计  高性能  医疗产品  

浅谈LED路灯的设计与关键要素

  • 近几年来各类型LED路灯产品的开发在两岸三地蓬勃发展,尤其在2008年台湾与大陆皆规划了也许多的LED示范道路的...
  • 关键字: LED    LED路灯    设计  

采用AT89S52单片机的家庭智能浇花器设计方案

  • 随着人们生活水平的提高,花卉逐渐收到人们的青睐,陶冶情操,净化空气。利用单片机设计了一款家庭智能浇花器实现自动浇花,节省人力,方便人们出差的时候,不至于影响花卉的生长,如果在家也可以关断浇花器,手动浇
  • 关键字: 花器  设计  方案  智能  家庭  AT89S52  单片机  采用  

Verilog HDL设计进阶:有限状态机的设计原理及其代

  • 由于Verilog HDL和 VHDL 行为描述用于综合的历史还只有短短的几年,可综合风格的Verilog HDL 和VHDL的语法只是它们各自语言的一个子集。又由于HDL的可综合性研究近年来非常活跃,可综合子集的国际标准目前尚未最后形
  • 关键字: Verilog  HDL  进阶  代码    

Verilog HDL高级语法结构―函数(function)

  • 函数的目的是返回一个用于表达式的值。
    1.函数定义语法function 返回值的类型或范围> (函数名);
    端口说明语句>
    变量类型说明语句> begin
    语句>
    ...
    end
    endfunction 请注
  • 关键字: function  Verilog  HDL  函数    

Verilog HDL高级语法结构―任务(TASK)

  • 如果传给任务的变量值和任务完成后接收结果的变量已定义,就可以用一条语句启动任务。任务完成以后控制就传回启动过程。如任务内部有定时控制,则启动的时间可以与控制返回的时间不同。任务可以启动其他的任务,其他
  • 关键字: Verilog  TASK  HDL    

Verilog HDL硬件描述语言:task和function说明语句

  • task和function说明语句的区别task和function说明语句分别用来定义任务和函数。利用任务和函数可以把一个很大的程序模块分解成许多较小的任务和函数便于理解和调试。输入、输出和总线信号的值可以传入或传出任务和函
  • 关键字: function  Verilog  task  HDL    

verilog HDL基础教程之:实例3 数字跑表

  • 实例的内容及目标1.实例的主要内容本节通过Verilog HDL语言编写一个具有“百分秒、秒、分”计时功能的数字跑表,可以实现一个小时以内精确至百分之一秒的计时。数字跑表的显示可以通过编写数码管显示程序来
  • 关键字: verilog  HDL  基础教程  实例    

Verilog HDL基础教程之:时序逻辑电路

  • 在Verilog HDL语言中,时序逻辑电路使用always语句块来实现。例如,实现一个带有异步复位信号的D触发器如下。例1:带异步复位的D触发器1。wire Din;wire clock,rst;reg Dout;always @ (posedge clock or negedge rs
  • 关键字: Verilog  HDL  基础教程  时序逻辑电路    

Verilog HDL语言学前必知的基础

  • Verilog HDL的历史和进展 1.什么是Verilog HDLVerilog HDL是硬件描述语言的一种,用于数字电子系统设计。它允许设计者用它来进行各种级别的逻辑设计,可以用它进行数字逻辑系统的仿真验证、时序分析、逻辑综合。它是
  • 关键字: Verilog  HDL  基础    

Verilog HDL基础教程之:赋值语句和块语句

  • 非阻塞赋值和阻塞赋值在Verilog HDL语言中,信号有两种赋值方式:非阻塞(Non_Blocking)赋值方式和阻塞(Blocking)赋值方式。(1)非阻塞赋值方式。典型语句:b = a;① 块结束后才完成赋值操作。② b的值并不是立刻就改
  • 关键字: Verilog  HDL  基础教程    
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